JAJSKM7D November   2020  – May 2025 AWR6843AOP

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 機能ブロック図
  6. 5 デバイスの比較
    1. 5.1 関連製品
  7. 6 端子構成および機能
    1. 6.1 ピン配置図
    2. 6.2 信号の説明
      1. 6.2.1 ピンの機能 - デジタルおよびアナログ [ALP パッケージ]
    3. 6.3 ピン属性
  8. 7 仕様
    1. 7.1  絶対最大定格
    2. 7.2  ESD 定格
    3. 7.3  電源投入時間 (POH)
    4. 7.4  推奨動作条件
    5. 7.5  ワンタイム プログラマブル (OTP) eFuse の VPP 仕様
      1. 7.5.1 OTP eFuse プログラミングの推奨動作条件
      2. 7.5.2 ハードウェア要件
      3. 7.5.3 ハードウェア保証への影響
    6. 7.6  電源仕様
    7. 7.7  消費電力の概略
    8. 7.8  パワー セーブ モード
    9. 7.9  RF 仕様
    10. 7.10 CPU の仕様
    11. 7.11 FCBGA パッケージの熱抵抗特性 [ALP0180A]
    12. 7.12 タイミングおよびスイッチング特性
      1. 7.12.1  アンテナ放射パターン
        1. 7.12.1.1 レシーバのアンテナ放射パターン
        2. 7.12.1.2 トランスミッタのアンテナ放射パターン
      2. 7.12.2  アンテナ位置
      3. 7.12.3  電源シーケンスおよびリセット タイミング
      4. 7.12.4  入力クロックおよび発振器
        1. 7.12.4.1 クロック仕様
      5. 7.12.5  マルチバッファ付き / 標準シリアル ペリフェラル インターフェイス (MibSPI)
        1. 7.12.5.1 ペリフェラルの概要
        2. 7.12.5.2 MibSPI 送信および受信 RAM の構成
          1. 7.12.5.2.1 SPI のタイミング条件
          2. 7.12.5.2.2 SPI コントローラ モードのスイッチング パラメータ (クロック位相 = 0、SPICLK = 出力、SPISIMO = 出力、SPISOMI = 入力)
          3. 7.12.5.2.3 SPI コントローラ モードのスイッチング パラメータ (クロック位相 = 1、SPICLK = 出力、SPISIMO = 出力、SPISOMI = 入力)
        3. 7.12.5.3 SPI ペリフェラル モードの I/O タイミング
          1. 7.12.5.3.1 SPI ペリフェラル モードのスイッチング パラメータ (SPICLK = 入力、SPISIMO = 入力、SPISOMI = 出力) #GUID-F179918D-8747-4E9F-AE33-23F33763D52C/T4362547-70 #GUID-F179918D-8747-4E9F-AE33-23F33763D52C/T4362547-71 #GUID-F179918D-8747-4E9F-AE33-23F33763D52C/T4362547-73
        4. 7.12.5.4 代表的なインターフェイス プロトコルの図 (ペリフェラル モード)
      6. 7.12.6  LVDS インターフェイスの構成
        1. 7.12.6.1 LVDS インターフェイスのタイミング
      7. 7.12.7  汎用入出力 (General-Purpose Input/Output)
        1. 7.12.7.1 出力タイミングと負荷容量 (CL) のスイッチング特性
      8. 7.12.8  CAN-FD (Controller Area Network - Flexible Data-rate)
        1. 7.12.8.1 CANx TX および RX ピンの動的特性
      9. 7.12.9  シリアル通信インターフェイス (SCI)
        1. 7.12.9.1 SCI のタイミング要件
      10. 7.12.10 I2C (Inter-Integrated Circuit Interface)
        1. 7.12.10.1 I2C のタイミング要件
      11. 7.12.11 クワッド シリアル ペリフェラル インターフェイス (QSPI)
        1. 7.12.11.1 QSPI のタイミング条件
        2. 7.12.11.2 QSPI 入力 (読み取り) タイミングのタイミング要件
        3. 7.12.11.3 QSPI スイッチング特性
      12. 7.12.12 ETM トレース インターフェイス
        1. 7.12.12.1 ETMTRACE のタイミング条件
        2. 7.12.12.2 ETM TRACE のスイッチング特性
      13. 7.12.13 データ変更モジュール (DMM)
        1. 7.12.13.1 DMM のタイミング要件
      14. 7.12.14 JTAG インターフェイス
        1. 7.12.14.1 JTAG のタイミング条件
        2. 7.12.14.2 IEEE 1149.1 JTAG のタイミング要件
        3. 7.12.14.3 IEEE 1149.1 JTAG の推奨動作条件に対するスイッチング特性
  9. 8 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 サブシステム
      1. 8.3.1 RF およびアナログ サブシステム
        1. 8.3.1.1 クロック サブシステム
        2. 8.3.1.2 送信サブシステム
        3. 8.3.1.3 受信サブシステム
      2. 8.3.2 プロセッサ サブシステム
      3. 8.3.3 車載用インターフェイス
      4. 8.3.4 ホスト インターフェイス
      5. 8.3.5 メイン サブシステム Cortex-R4F
      6. 8.3.6 DSP サブシステム
      7. 8.3.7 ハードウェア アクセラレータ
    4. 8.4 その他のサブシステム
      1. 8.4.1 ユーザー アプリケーション向け ADC チャネル (サービス)
        1. 8.4.1.1 GP-ADC パラメータ
    5. 8.5 ブート モード
      1. 8.5.1 フラッシュ モード
      2. 8.5.2 機能モード
  10. 9 監視と診断
    1. 9.1 監視と診断のメカニズム
      1. 9.1.1 エラー通知モジュール
  11. 10アプリケーション、実装、およびレイアウト
    1. 10.1 アプリケーション情報
    2. 10.2 リファレンス回路図
  12. 11デバイスおよびドキュメントのサポート
    1. 11.1 デバイスの命名規則
    2. 11.2 ツールとソフトウェア
    3. 11.3 ドキュメントのサポート
    4. 11.4 サポート・リソース
    5. 11.5 商標
    6. 11.6 静電気放電に関する注意事項
    7. 11.7 用語集
  13. 12改訂履歴
  14. 13メカニカル、パッケージ、および注文情報
    1. 13.1 パッケージ情報
    2. 13.2 ALP, 15 × 15 mm のトレイ情報

6.3 ピン属性

表 6-1 ピン属性 (ALP180A パッケージ)
ボール番号 [1] ボール名 [2] 信号名 [3] PINCNTL アドレス [4] モード [5] [9] タイプ [6] ボール リセット状態 [7] プルアップ / ダウン タイプ [8]
M2 GPIO_0 GPIO_13 0xFFFFEA04 0 IO 出力ディセーブル プルダウン
GPIO_0 1 IO
PMIC_CLKOUT 2 O
EPWM1B 10 O
ePWM2A 11 O
L3 GPIO_1 GPIO_16 0xFFFFEA08 0 IO 出力ディセーブル プルダウン
GPIO_1 1 IO
SYNC_OUT 2 O
DMM_MUX_IN 12 I
SPIB_CS_N_1 13 IO
SPIB_CS_N_2 14 IO
EPWM1SYNCI 15 I
K3 GPIO_2 GPIO_26 0xFFFFEA64 0 IO 出力ディセーブル プルダウン
GPIO_2 1 IO
OSC_CLKOUT 2 O
MSS_UARTB_TX 7 O
BSS_UART_TX 8 O
SYNC_OUT 9 O
PMIC_CLKOUT 10 O
CHIRP_START 11 O
CHIRP_END 12 O
FRAME_START 13 O
U7 GPIO_31 (DP0) TRACE_DATA_0 0xFFFFEA7C 0 O 出力ディセーブル プルダウン
GPIO_31 1 IO
DMM0 2 I
MSS_UARTA_TX 4 IO
U6 GPIO_32 (DP1) TRACE_DATA_1 0xFFFFEA80 0 O 出力ディセーブル プルダウン
GPIO_32 1 IO
DMM1 2 I
V5 GPIO_33 (DP2) TRACE_DATA_2 0xFFFFEA84 0 O 出力ディセーブル プルダウン
GPIO_33 1 IO
DMM2 2 I
U5 GPIO_34 (DP3) TRACE_DATA_3 0xFFFFEA88 0 O 出力ディセーブル プルダウン
GPIO_34 1 IO
DMM3 2 I
EPWM3SYNCO 4 O
V3 GPIO_35 (DP4) TRACE_DATA_4 0xFFFFEA8C 0 O 出力ディセーブル プルダウン
GPIO_35 1 IO
DMM4 2 I
EPWM2SYNCO 4 O
M1 GPIO_36 (DP5) TRACE_DATA_5 0xFFFFEA90 0 O 出力ディセーブル プルダウン
GPIO_36 1 IO
DMM5 2 I
MSS_UARTB_TX 5 O
L2 GPIO_37 (DP6) TRACE_DATA_6 0xFFFFEA94 0 O 出力ディセーブル プルダウン
GPIO_37 1 IO
DMM6 2 I
BSS_UART_TX 5 O
L1 GPIO_38 (DP7) TRACE_DATA_7 0xFFFFEA98 0 O 出力ディセーブル プルダウン
GPIO_38 1 IO
DMM7 2 I
DSS_UART_TX 5 O
C3 GPIO_39 (DP8) TRACE_DATA_8 0xFFFFEA9C 0 O 出力ディセーブル プルダウン
GPIO_39 1 IO
DMM8 2 I
CAN1_FD_TX 4 O
EPWM1SYNCI 5 I
B3 GPIO_40 (DP9) TRACE_DATA_9 0xFFFFEAA0 0 O 出力ディセーブル プルダウン
GPIO_40 1 IO
DMM9 2 I
CAN1_FD_RX 4 I
EPWM1SYNCO 5 O
C4 GPIO_41 (DP10) TRACE_DATA_10 0xFFFFEAA4 0 O 出力ディセーブル プルダウン
GPIO_41 1 IO
DMM10 2 I
EPWM3A 4 O
A3 GPIO_42 (DP11) TRACE_DATA_11 0xFFFFEAA8 0 O 出力ディセーブル プルダウン
GPIO_42 1 IO
DMM11 2 I
EPWM3B 4 O
B4 GPIO_43 (DP12) TRACE_DATA_12 0xFFFFEAAC 0 O 出力ディセーブル プルダウン
GPIO_43 1 IO
DMM12 2 I
EPWM1A 4 O
CAN2_FD_TX 5 O
A4 GPIO_44 (DP13) TRACE_DATA_13 0xFFFFEAB0 0 O 出力ディセーブル プルダウン
GPIO_44 1 IO
DMM13 2 I
EPWM1B 4 O
CAN1_FD_RX 5 I
C5 GPIO_45 (DP14) TRACE_DATA_14 0xFFFFEAB4 0 O 出力ディセーブル プルダウン
GPIO_45 1 IO
DMM14 2 I
EPWM2A 4 O
B5 GPIO_46 (DP15) TRACE_DATA_15 0xFFFFEAB8 0 O 出力ディセーブル プルダウン
GPIO_46 1 IO
DMM15 2 I
EPWM2B 4 O
U3 GPIO_47 (DMM_CLK) TRACE_CLK 0xFFFFEABC 0 O 出力ディセーブル プルダウン
GPIO_47 1 IO
DMM_CLK 2 I
U4 DMM_SYNC TRACE_CTL 0xFFFFEAC0 0 O 出力ディセーブル プルダウン
DMM_SYNC 2 I
V13 MCU_CLKOUT GPIO_25 0xFFFFEA60 0 IO 出力ディセーブル プルダウン
MCU_CLKOUT 1 O
CHIRP_START 2 O
CHIRP_END 6 O
FRAME_START 7 O
EPWM1A 12 O
U14 NERROR_IN NERROR_IN 0xFFFFEA44 0 I 入力
U15 NERROR_OUT NERROR_OUT 0xFFFFEA4C 0 O Hi-Z (オープン ドレイン)
V10 PMIC_CLKOUT SOP[2] 0xFFFFEA68 パワーアップ時 I 出力ディセーブル プルダウン
GPIO_27 0 IO
PMIC_CLKOUT 1 O
CHIRP_START 6 O
CHIRP_END 7 O
FRAME_START 8 O
EPWM1B 11 O
EPWM2A 12 O
H3 QSPI[0] GPIO_8 0xFFFFEA2C 0 IO 出力ディセーブル プルダウン
QSPI[0] 1 IO
SPIB_MISO 2 IO
G2 QSPI[1] GPIO_9 0xFFFFEA30 0 IO 出力ディセーブル プルダウン
QSPI[1] 1 I
SPIB_MOSI 2 IO
SPIB_CS_N_2 8 IO
J3 QSPI[2] GPIO_10 0xFFFFEA34 0 IO 出力ディセーブル プルダウン
QSPI[2] 1 I
CAN1_FD_TX 8 O
K2 QSPI[3] GPIO_11 0xFFFFEA38 0 IO 出力ディセーブル プルダウン
QSPI[3] 1 I
CAN1_FD_RX 8 I
H2 QSPI_CLK GPIO_7 0xFFFFEA3C 0 IO 出力ディセーブル プルダウン
QSPI_CLK 1 O
SPIB_CLK 2 IO
DSS_UART_TX 6 O
J2 QSPI_CS_N GPIO_6 0xFFFFEA40 0 IO 出力ディセーブル プルアップ
QSPI_CS_N 1 O
SPIB_CS_N 2 IO
V16 RS232_RX GPIO_15 0xFFFFEA74 0 IO 入力イネーブル プルアップ
RS232_RX 1 I
MSS_UARTA_RX 2 I
BSS_UART_TX 6 IO
MSS_UARTB_RX 7 IO
CAN1_FD_RX 8 I
I2C_SCL 9 IO
EPWM2A 10 O
EPWM2B 11 O
EPWM3A 12 O
U16 RS232_TX GPIO_14 0xFFFFEA78 0 IO 出力イネーブル
RS232_TX 1 O
MSS_UARTA_TX 5 IO
MSS_UARTB_TX 6 IO
BSS_UART_TX 7 IO
CAN1_FD_TX 10 O
I2C_SDA 11 IO
EPWM1A 12 O
EPWM1B 13 O
NDMM_EN 14 I
EPWM2A 15 O
D2 SPIA_CLK GPIO_3 0xFFFFEA14 0 IO 出力ディセーブル プルアップ
SPIA_CLK 1 IO
CAN2_FD_RX 6 I
DSS_UART_TX 7 O
C2 SPIA_CS_N GPIO_30 0xFFFFEA18 0 IO 出力ディセーブル プルアップ
SPIA_CS_N 1 IO
CAN1_FD_TX 6 O
D1 SPIA_MISO GPIO_20 0xFFFFEA10 0 IO 出力ディセーブル プルアップ
SPIA_MISO 1 IO
CAN1_FD_TX 2 O
F2 SPIA_MOSI GPIO_19 0xFFFFEA0C 0 IO 出力ディセーブル プルアップ
SPIA_MOSI 1 IO
CAN1_FD_RX 2 I
DSS_UART_TX 8 O
E2 SPIB_CLK GPIO_5 0xFFFFEA24 0 IO 出力ディセーブル プルアップ
SPIB_CLK 1 IO
MSS_UARTA_RX 2 I
MSS_UARTB_TX 6 O
BSS_UART_TX 7 O
CAN1_FD_RX 8 I
D3 SPIB_CS_N GPIO_4 0xFFFFEA28 0 IO 出力ディセーブル プルアップ
SPIB_CS_N 1 IO
MSS_UARTA_TX 2 O
MSS_UARTB_TX 6 O
BSS_UART_TX 7 IO
QSPI_CLK_EXT 8 I
CAN1_FD_TX 9 O
G3 SPIB_MISO GPIO_22 0xFFFFEA20 0 IO 出力ディセーブル プルアップ
SPIB_MISO 1 IO
I2C_SCL 2 IO
DSS_UART_TX 6 O
G1 SPIB_MOSI GPIO_21 0xFFFFEA1C 0 IO 出力ディセーブル プルアップ
SPIB_MOSI 1 IO
I2C_SDA 2 IO
B2 SPI_HOST_INTR GPIO_12 0xFFFFEA00 0 IO 出力ディセーブル プルダウン
SPI_HOST_INTR 1 O
SPIB_CS_N_1 6 IO
U12 SYNC_IN GPIO_28 0xFFFFEA6C 0 IO 出力ディセーブル プルダウン
SYNC_IN 1 I
MSS_UARTB_RX 6 IO
DMM_MUX_IN 7 I
SYNC_OUT 9 O
M3 SYNC_OUT SOP[1] 0xFFFFEA70 パワーアップ時 I 出力ディセーブル プルダウン
GPIO_29 0 IO
SYNC_OUT 1 O
DMM_MUX_IN 9 I
SPIB_CS_N_1 10 IO
SPIB_CS_N_2 11 IO
T3 TCK GPIO_17 0xFFFFEA50 0 IO 入力イネーブル プルダウン
TCK 1 I
MSS_UARTB_TX 2 O
CAN1_FD_TX 8 O
U9 TDI GPIO_23 0xFFFFEA58 0 IO 入力イネーブル プルアップ
TDI 1 I
MSS_UARTA_RX 2 I
U10 TDO SOP[0] 0xFFFFEA5C パワーアップ時 I 出力イネーブル
GPIO_24 0 IO
TDO 1 O
MSS_UARTA_TX 2 O
MSS_UARTB_TX 6 O
BSS_UART_TX 7 O
NDMM_EN 9 I
U8 TMS GPIO_18 0xFFFFEA54 0 IO 入力イネーブル プルダウン
TMS 1 I
BSS_UART_TX 2 O
CAN1_FD_RX 6 I
U13 WARM_RESET WARM_RESET 0xFFFFEA48 0 IO Hi-Z 入力 (オープン ドレイン)
R2 LVDS_CLKM LVDS_CLKM O
R1 LVDS_CLKP LVDS_CLKP O
N2 LVDS_TXP[0] LVDS_TXP[0] O
N1 LVDS_TXM[0] LVDS_TXM[0] O
P2 LVDS_TXP[1] LVDS_TXP[1] O
P1 LVDS_TXM[1] LVDS_TXM[1] O
T1 LVDS_FRCLKP LVDS_FRCLKP O
T2 LVDS_FRCLKM LVDS_FRCLKM O
U11 NRESET NRESET I
A7 CLKP CLKP I
B7 CLKM CLKM I
A14 OSC_CLKOUT OSC_CLKOUT O
A16 VBGAP VBGAP O
E1 VDDIN VDDIN PWR
J1 VDDIN VDDIN PWR
V4 VDDIN VDDIN PWR
V8 VDDIN VDDIN PWR
V15 VDDIN VDDIN PWR
A5 VIN_SRAM VIN_SRAM PWR
V6 VIN_SRAM VIN_SRAM PWR
V12 VIN_SRAM VIN_SRAM PWR
C1 VNWA VNWA PWR
V7 VNWA VNWA PWR
V14 VNWA VNWA PWR
H1 VIOIN VIOIN PWR
V9 VIOIN VIOIN PWR
B1 VIOIN_18 VIOIN_18 PWR
F1 VIOIN_18 VIOIN_18 PWR
K1 VIOIN_18 VIOIN_18 PWR
V11 VIOIN_18 VIOIN_18 PWR
C15 VIN_18CLK VIN_18CLK PWR
C18 VIN_18CLK VIN_18CLK PWR
U2 VIOIN_18DIFF VIOIN_18DIFF PWR
V2 VPP VPP PWR
J16 VIN_13RF1 VIN_13RF1 PWR
J17 VIN_13RF1 VIN_13RF1 PWR
J18 VIN_13RF1 VIN_13RF1 PWR
H16 VIN_13RF2 VIN_13RF2 PWR
H17 VIN_13RF2 VIN_13RF2 PWR
H18 VIN_13RF2 VIN_13RF2 PWR
M16 VIN_18BB VIN_18BB PWR
M17 VIN_18BB VIN_18BB PWR
M18 VIN_18BB VIN_18BB PWR
A12 VIN_18VCO VIN_18VCO PWR
C11 VIN_18VCO VIN_18VCO PWR
A1 VSS VSS GND
A2 VSS VSS GND
E3 VSS VSS GND
F3 VSS VSS GND
N3 VSS VSS GND
P3 VSS VSS GND
R3 VSS VSS GND
T4 VSS VSS GND
T5 VSS VSS GND
T6 VSS VSS GND
T7 VSS VSS GND
T8 VSS VSS GND
T9 VSS VSS GND
T10 VSS VSS GND
T11 VSS VSS GND
T12 VSS VSS GND
T13 VSS VSS GND
T14 VSS VSS GND
T15 VSS VSS GND
T16 VSS VSS GND
U1 VSS VSS GND
V1 VSS VSS GND
A6 VSSA VSSA GND
A8 VSSA VSSA GND
A11 VSSA VSSA GND
A13 VSSA VSSA GND
A15 VSSA VSSA GND
A17 VSSA VSSA GND
A18 VSSA VSSA GND
B6 VSSA VSSA GND
B8 VSSA VSSA GND
B9 VSSA VSSA GND
B10 VSSA VSSA GND
B11 VSSA VSSA GND
B12 VSSA VSSA GND
B13 VSSA VSSA GND
B14 VSSA VSSA GND
B15 VSSA VSSA GND
B16 VSSA VSSA GND
B17 VSSA VSSA GND
B18 VSSA VSSA GND
C6 VSSA VSSA GND
C7 VSSA VSSA GND
C8 VSSA VSSA GND
C12 VSSA VSSA GND
C13 VSSA VSSA GND
C14 VSSA VSSA GND
C16 VSSA VSSA GND
C17 VSSA VSSA GND
D16 VSSA VSSA GND
D17 VSSA VSSA GND
D18 VSSA VSSA GND
E16 VSSA VSSA GND
E17 VSSA VSSA GND
E18 VSSA VSSA GND
F16 VSSA VSSA GND
F17 VSSA VSSA GND
F18 VSSA VSSA GND
K16 VSSA VSSA GND
K17 VSSA VSSA GND
K18 VSSA VSSA GND
L16 VSSA VSSA GND
L17 VSSA VSSA GND
L18 VSSA VSSA GND
N16 VSSA VSSA GND
N17 VSSA VSSA GND
N18 VSSA VSSA GND
P16 VSSA VSSA GND
R16 VSSA VSSA GND
R17 VSSA VSSA GND
T17 VSSA VSSA GND
U17 VSSA VSSA GND
U18 VSSA VSSA GND
V17 VSSA VSSA GND
V18 VSSA VSSA GND
A10 VOUT_14APLL VOUT_14APLL O
A9 VOUT_14SYNTH VOUT_14SYNTH O
G16 VOUT_PA VOUT_PA IO
G17 VOUT_PA VOUT_PA IO
G18 VOUT_PA VOUT_PA IO
P18 アナログ テスト 1/GPADC1 アナログ テスト 1/GPADC1 IO
P17 アナログ テスト 2/GPADC2 アナログ テスト 2/GPADC2 IO
R18 アナログ テスト 3/GPADC3 アナログ テスト 3/GPADC3 IO
T18 アナログ テスト 4/GPADC4 アナログ テスト 4/GPADC4 IO
C9 ANAMUX/GPADC5 ANAMUX/GPADC5 IO
C10 VSENSE/GPADC6 VSENSE/GPADC6 IO

以下は、表の列ヘッダーについて説明しています。

  1. ボール番号：底面の各信号に関連付けられた底面側のボール番号。
  2. ボール名：パッケージ デバイスのメカニカル名 (名前は muxmode 1 に由来します)。
  3. 信号名：各ボールで多重化された信号の名前 (ボールの名前は muxmode 1 での信号名であることにも注意)。
  4. PINCNTL アドレス：PinMux 制御用 MSS アドレス
  5. モード：多重化モード番号：このボール番号に対応する特定の信号名を選択するために PinMux 制御レジスタに書き込まれる値。モード列にはビット範囲値があります。
  6. タイプ：信号の種類と方向：
    • I = 入力
    • O = 出力
    • IO = 入出力
  7. ボール リセット状態：パワーオン リセット (NRESET) がアサートされた後、電源が安定した後の端子の状態
  8. プルアップ / ダウン タイプ：内部プルアップまたはプルダウン抵抗が存在することを示します。プルアップおよびプルダウン抵抗は、ソフトウェアによって有効化または無効化できます。
    • プルアップ：内部プルアップ
    • プルダウン：内部プルダウン
    • 空欄はプルアップ / ダウンがないことを意味します。
  9. ピン多重化制御値はレジスタの下位 4 ビットに割り当てられています。

IO MUX レジスタは MSS メモリ マップで使用可能で、それぞれのデバイス ピンへのマッピングは以下の通りです。

表 6-2 PAD IO 制御レジスタ
デフォルトのピン / ボール名 パッケージのボール / ピン (アドレス) ピン多重化構成レジスタ
SPI_HOST_INTR B2 0xFFFFEA00
GPIO_0 M2 0xFFFFEA04
GPIO_1 L3 0xFFFFEA08
SPIA_MOSI F2 0xFFFFEA0C
SPIA_MISO D1 0xFFFFEA10
SPIA_CLK D2 0xFFFFEA14
SPIA_CS_N C2 0xFFFFEA18
SPIB_MOSI G1 0xFFFFEA1C
SPIB_MISO G3 0xFFFFEA20
SPIB_CLK E2 0xFFFFEA24
SPIB_CS_N D3 0xFFFFEA28
QSPI[0] H3 0xFFFFEA2C
QSPI[1] G2 0xFFFFEA30
QSPI[2] J3 0xFFFFEA34
QSPI[3] K2 0xFFFFEA38
QSPI_CLK H2 0xFFFFEA3C
QSPI_CS_N J2 0xFFFFEA40
NERROR_IN U14 0xFFFFEA44
WARM_RESET U13 0xFFFFEA48
NERROR_OUT U15 0xFFFFEA4C
TCK T3 0xFFFFEA50
TMS U8 0xFFFFEA54
TDI U9 0xFFFFEA58
TDO U10 0xFFFFEA5C
MCU_CLKOUT V13 0xFFFFEA60
GPIO_2 K3 0xFFFFEA64
PMIC_CLKOUT V10 0xFFFFEA68
SYNC_IN U12 0xFFFFEA6C
SYNC_OUT M3 0xFFFFEA70
RS232_RX V16 0xFFFFEA74
RS232_TX U16 0xFFFFEA78
GPIO_31 U7 0xFFFFEA7C
GPIO_32 U6 0xFFFFEA80
GPIO_33 V5 0xFFFFEA84
GPIO_34 U5 0xFFFFEA88
GPIO_35 V3 0xFFFFEA8C
GPIO_36 M1 0xFFFFEA90
GPIO_37 L2 0xFFFFEA94
GPIO_38 L1 0xFFFFEA98
GPIO_39 C3 0xFFFFEA9C
GPIO_40 B3 0xFFFFEAA0
GPIO_41 C4 0xFFFFEAA4
GPIO_42 A3 0xFFFFEAA8
GPIO_43 B4 0xFFFFEAAC
GPIO_44 A4 0xFFFFEAB0
GPIO_45 C5 0xFFFFEAB4
GPIO_46 B5 0xFFFFEAB8
GPIO_47 U3 0xFFFFEABC
DMM_SYNC U4 0xFFFFEAC0

レジスタのレイアウトは次の通りです。

表 6-3 PAD IO レジスタ ビットの説明
ビット フィールド タイプ リセット (パワー オン デフォルト) 説明
31-11 NU RW 0 予約済み
10 SC RW 0 IO スルー レート制御：
0 = 高いスルーレート
1 = 低いスルーレート
9 PUPDSEL RW 0 プルアップ / プルダウン選択
0 = プルダウン
1 = プルアップ (このフィールドは、プル禁止 が 0 に設定されている場合のみ有効)
8 PI RW 0 プル禁止 / プル ディセーブル
0 = イネーブル
1 = ディセーブル
7 OE_OVERRIDE RW 1 出力オーバーライド
6 OE_OVERRIDE_CTRL RW 1 出力オーバーライド制御：
(ここで 1 が設定されている場合、この IO に関連付けられているペリフェラル ブロックハードウェア (例えば SPI チップ セレクト) によるいかなる出力操作もオーバーライドされます)
5 IE_OVERRIDE RW 0 入力オーバーライド
4 IE_OVERRIDE_CTRL RW 0 入力オーバーライド制御：
(ここで 1 が設定されている場合、この IO の入力値は指定された値でオーバーライドされます)
3-0 FUNC_SEL RW 1 ピン多重化の機能選択 (「ピン多重化シート」を参照)