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SN74LV4T32

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Vierfach-OR-Gatter mit einer einzigen Stromversorgung, 1,8 V bis 5,5 V

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SN74LV4T32

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Produktdetails

Technology family LVxT Number of channels 4 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (MBps) 150 IOH (max) (mA) -8 IOL (max) (mA) 8 Supply current (max) (µA) 2 Features Balanced outputs, Over-voltage tolerant inputs Input type Standard CMOS, TTL-Compatible CMOS Output type Push-Pull Operating temperature range (°C) -40 to 125
Technology family LVxT Number of channels 4 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (MBps) 150 IOH (max) (mA) -8 IOL (max) (mA) 8 Supply current (max) (µA) 2 Features Balanced outputs, Over-voltage tolerant inputs Input type Standard CMOS, TTL-Compatible CMOS Output type Push-Pull Operating temperature range (°C) -40 to 125
TSSOP (PW) 14 32 mm² 5 x 6.4 WQFN (BQA) 14 7.5 mm² 3 x 2.5
  • Wide operating range of 1.8 V to 5.5 V

  • Single-supply voltage translator (refer to LVxT Enhanced Input Voltage):

    • Up translation:
      • 1.2 V to 1.8 V
      • 1.5 V to 2.5 V
      • 1.8 V to 3.3 V
      • 3.3 V to 5.0 V
    • Down translation:
      • 5.0 V, 3.3 V, 2.5 V to 1.8 V
      • 5.0 V, 3.3 V to 2.5 V
      • 5.0 V to 3.3 V
  • 5.5-V tolerant input pins
  • Supports standard pinouts
  • Up to 150 Mbps with 5-V or 3.3-V V CC
  • Latch-up performance exceeds 250 mA per JESD 17
  • Wide operating range of 1.8 V to 5.5 V

  • Single-supply voltage translator (refer to LVxT Enhanced Input Voltage):

    • Up translation:
      • 1.2 V to 1.8 V
      • 1.5 V to 2.5 V
      • 1.8 V to 3.3 V
      • 3.3 V to 5.0 V
    • Down translation:
      • 5.0 V, 3.3 V, 2.5 V to 1.8 V
      • 5.0 V, 3.3 V to 2.5 V
      • 5.0 V to 3.3 V
  • 5.5-V tolerant input pins
  • Supports standard pinouts
  • Up to 150 Mbps with 5-V or 3.3-V V CC
  • Latch-up performance exceeds 250 mA per JESD 17

The SN74LV4T32 contains four independent 2-input OR Gates with Schmitt-trigger inputs. Each gate performs the Boolean function Y = A + B in positive logic. The output level is referenced to the supply voltage (V CC) and supports 1.8-V, 2.5-V, 3.3-V, and 5-V CMOS levels.

The input is designed with a lower threshold circuit to support up translation for lower voltage CMOS inputs (for example, 1.2 V input to 1.8 V output or 1.8 V input to 3.3 V output). In addition, the 5-V tolerant input pins enable down translation (for example, 3.3 V to 2.5 V output).

The SN74LV4T32 contains four independent 2-input OR Gates with Schmitt-trigger inputs. Each gate performs the Boolean function Y = A + B in positive logic. The output level is referenced to the supply voltage (V CC) and supports 1.8-V, 2.5-V, 3.3-V, and 5-V CMOS levels.

The input is designed with a lower threshold circuit to support up translation for lower voltage CMOS inputs (for example, 1.2 V input to 1.8 V output or 1.8 V input to 3.3 V output). In addition, the 5-V tolerant input pins enable down translation (for example, 3.3 V to 2.5 V output).
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Technische Dokumentation

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Typ Titel Datum
* Data sheet SN74LV4T32 Quadruple 2-Input Positive-OR Gates With Integrated Translation datasheet PDF | HTML 18 Mai 2023

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logik-EVM mit Unterstützung von 14 bis 24 Pin PW-, DB-, D-, DW-, NS-, P-, N- und DGV-Geh

Dieses EVM ist für die Unterstützung aller Logikbausteine mit D, DW, DB, NS, PW, TJJ oder DGV-Gehäuse in einem 14- bis 24-poligen Gehäuse ausgelegt.

Benutzerhandbuch: PDF | HTML
Nicht verfügbar auf TI.com
Gehäuse Pins Herunterladen
TSSOP (PW) 14 Ansichtsoptionen
WQFN (BQA) 14 Ansichtsoptionen
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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  • RoHS
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  • Bausteinkennzeichnung
  • Blei-Finish/Ball-Material
  • MSL-Rating / Spitzenrückfluss
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  • Materialinhalt
  • Qualifikationszusammenfassung
  • Kontinuierliches Zuverlässigkeitsmonitoring

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