JAJSGJ3E November   2018  – August 2023 DAC60501 , DAC70501 , DAC80501

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Revision History
  6. 5 Device Comparison Table
  7. 6 Pin Configuration and Functions
  8. 7 Specifications
    1. 7.1  Absolute Maximum Ratings
    2. 7.2  ESD Ratings
    3. 7.3  Recommended Operating Conditions
    4. 7.4  Thermal Information
    5. 7.5  Electrical Characteristics
    6. 7.6  Timing Requirements: SPI Mode
    7. 7.7  Timing Requirements: I2C Standard Mode
    8. 7.8  Timing Requirements: I2C Fast Mode
    9. 7.9  Timing Requirements: I2C Fast-Mode Plus
    10. 7.10 Timing Diagrams
    11. 7.11 Typical Characteristics
  9. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 DAC Architecture
        1. 8.3.1.1 DAC Transfer Function
        2. 8.3.1.2 DAC Register Structure
        3. 8.3.1.3 Output Amplifier
      2. 8.3.2 Internal Reference
        1. 8.3.2.1 Solder Heat Reflow
      3. 8.3.3 Power-On-Reset (POR)
      4. 8.3.4 Software Reset
    4. 8.4 Device Functional Modes
      1. 8.4.1 Power-Down Mode
    5. 8.5 Programming
      1. 8.5.1 Serial Interface
        1. 8.5.1.1 SPI Mode
          1. 8.5.1.1.1 SYNC Interrupt
        2. 8.5.1.2 I2C Mode
          1. 8.5.1.2.1 F/S Mode Protocol
          2. 8.5.1.2.2 I2C Update Sequence
            1. 8.5.1.2.2.1 Address Byte
            2. 8.5.1.2.2.2 Command Byte
            3. 8.5.1.2.2.3 Data Byte (MSDB and LSDB)
          3. 8.5.1.2.3 I2C Read Sequence
    6. 8.6 Register Map
  10. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Charge Injection
        2. 9.2.2.2 Voltage Droop
        3. 9.2.2.3 Output Offset Error
        4. 9.2.2.4 Switch Selection
        5. 9.2.2.5 Amplifier Selection
        6. 9.2.2.6 Hold Capacitor Selection
      3. 9.2.3 Application Curves
    3. 9.3 Power Supply Recommendations
    4. 9.4 Layout
      1. 9.4.1 Layout Guidelines
      2. 9.4.2 Layout Example
  11. 10Device and Documentation Support
    1. 10.1 Documentation Support
      1. 10.1.1 Related Documentation
    2. 10.2 ドキュメントの更新通知を受け取る方法
    3. 10.3 サポート・リソース
    4. 10.4 Trademarks
    5. 10.5 静電気放電に関する注意事項
    6. 10.6 用語集
  12. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

16 ビット DAC80501、14 ビット DAC70501、12 ビット DAC60501 (DACx0501) デジタル/アナログ・コンバータ (DAC) は、高精度で低消費電力の電圧出力デバイスです。DACx0501 は設計で単調性が規定され、1LSB を下回る優れた直線性を備えています。これらのデバイスには、2.5V、5ppm/°Cの内部基準電圧が搭載され、フルスケール出力電圧範囲は1.25V、2.5V、5Vです。DACx0501にはパワーオン・リセット (POR) 回路が組み込まれており、DAC出力がゼロ・スケールまたは中間スケールで起動し、デバイスに有効なコードが書き込まれるまでそのスケールが維持されることを保証します。これらのデバイスは消費電流が 1mA と小さく、消費電流を 15µA (標準値、5V 時) に低減させるパワーダウン機能を備えています。

DACx0501 のデジタル・インターフェイスは、SPI2C ピンを使用して SPI または I2C モードに構成できます。SPI モードの場合、DACx0501 は最高 50MHz のクロック速度で動作する汎用 3 線式シリアル・インターフェイスを使用します。I2C モードでは、DACx0501 は標準モード (100Kbps)、高速モード (400Kbps)、高速モード・プラス (1.0Mbps) で動作します。

製品情報
部品番号(1) 分解能 パッケージ(2)
DAC80501 16 ビット WSON (8)
VSSOP (10)
DAC70501 14 ビット WSON (8)
VSSOP (10)
DAC60501 12 ビット WSON (8)
VSSOP (10)
(1) 「Device Comparison Table」を参照してください。
(2) 利用可能なすべてのパッケージについては、データシートの末尾にあるパッケージ・オプションについての付録を参照してください。

 

GUID-36787F4E-1387-46E8-90EA-B22B32DF5906-low.gif機能ブロック図
GUID-ED6A5548-6DC4-4F19-9545-A6EE0CD2FFBF-low.gifDACx0501 でのオフセット・トリミング