JAJSQ67D december   2014  – may 2023 TPS65263-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Revision History
  6. 5 Pin Configuration and Functions
  7. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Typical Characteristics
  8. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1  Adjusting the Output Voltage
      2. 7.3.2  Enable and Adjusting UVLO
      3. 7.3.3  Soft-Start Time
      4. 7.3.4  Power-Up Sequencing
      5. 7.3.5  V7V Low-Dropout Regulator and Bootstrap
      6. 7.3.6  Out-of-Phase Operation
      7. 7.3.7  Output Overvoltage Protection (OVP)
      8. 7.3.8  PSM
      9. 7.3.9  Slope Compensation
      10. 7.3.10 Overcurrent Protection
        1. 7.3.10.1 High-Side MOSFET Overcurrent Protection
        2. 7.3.10.2 Low-Side MOSFET Overcurrent Protection
      11. 7.3.11 Power Good
        1. 7.3.11.1 Adjustable Switching Frequency
      12. 7.3.12 Thermal Shutdown
    4. 7.4 Device Functional Modes
      1. 7.4.1 Serial Interface Description
      2. 7.4.2 I2C Update Sequence
    5. 7.5 Register Maps
      1. 7.5.1 VOUT2_SEL: Vout2 Voltage Selection Register (Address = 0x01H)
      2. 7.5.2 VOUT1_COM: Buck1 Command Register (offset = 0x03H)
      3. 7.5.3 VOUT2_COM: Buck2 Command Register (offset = 0x04H)
      4. 7.5.4 VOUT3_COM: Buck3 Command Register (offset = 0x05H)
      5. 7.5.5 SYS_STATUS: System Status Register (offset = 0x06H)
  9. 8 Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Application
      1. 8.2.1 Design Requirements
      2. 8.2.2 Detailed Design Procedure
        1. 8.2.2.1 Output Inductor Selection
        2. 8.2.2.2 Output Capacitor Selection
        3. 8.2.2.3 Input Capacitor Selection
        4. 8.2.2.4 Loop Compensation
      3. 8.2.3 Application Curves
    3. 8.3 Power Supply Recommendations
    4. 8.4 Layout
      1. 8.4.1 Layout Guidelines
      2. 8.4.2 Layout Example
  10. 9 Device and Documentation Support
    1. 9.1 ドキュメントの更新通知を受け取る方法
    2. 9.2 サポート・リソース
    3. 9.3 Trademarks
    4. 9.4 静電気放電に関する注意事項
    5. 9.5 用語集
  11. 10Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

TPS65263-Q1 には、トリプル同期整流降圧型コンバータが組み込まれており、4.0～18V の広い入力電圧範囲に対応します。コンバータは一定周波数のピーク電流モードで、アプリケーションを簡素化しながら、目的のアプリケーションに合わせてシステムを最適化するオプションを設計者が選択できるよう設計されています。コンバータのスイッチング周波数は、外付け抵抗により 200kHz～2.3MHz の範囲で調整できます。buck1 と buck2、buck3 は位相差 180°で動作するため (buck2 と buck3 は同相動作)、入力フィルタの要件が最小化されます。

それぞれの buck の初期スタートアップ電圧は、外付けのフィードバック抵抗で設定できます。buck2 の出力電圧は、0.68～1.95V の範囲で、I2C 制御の 7 ビット VID を使用して 10mV 刻みで動的に設定可能です。VID 電圧の遷移スルー・レートは、I2C バスによる 3 ビットの制御によりプログラム可能なため、VID 電圧遷移時のオーバーシュートやアンダーシュートを最適化できます。

TPS65263-Q1 の各バックについて、出力電圧のイネーブルとディセーブル、軽負荷時のパルス・スキップ・モード (PSM) または強制連続電流 (FCC) モードの設定、パワー・グッド・ステータス、過電流警告、ダイ温度警告の読み出しを、I2C で制御できます。

TPS65263-Q1 には過電圧、過電流、短絡、過熱保護が搭載されています。

パッケージ情報 (1)
部品番号 パッケージ 本体サイズ (公称)
TPS65263-Q1 RHB (VQFN、32) 5.00mm × 5.00mm
(1) 利用可能なパッケージについては、このデータシートの末尾にある注文情報を参照してください。
GUID-20230501-SS0I-NJK8-0JGX-G7BGBFPRGMSB-low.svgアプリケーション回路図
GUID-8E39E34C-A729-46DC-BE00-7209776F800A-low.gif効率と出力負荷との関係