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SN74AHCT1G125

ACTIVO

Búfer único de 4.5 V a 5.5 V con entradas CMOS compatibles con TTL y salidas de 3 estados

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SN74AHCT1G125

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Detalles del producto

Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 1 IOL (max) (mA) 8 Supply current (max) (µA) 10 IOH (max) (mA) -8 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 1 IOL (max) (mA) 8 Supply current (max) (µA) 10 IOH (max) (mA) -8 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-5X3 (DRL) 5 2.56 mm² 1.6 x 1.6 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • Operating range of 4.5V to 5.5V
  • Max tpd of 6ns at 5V
  • Low power consumption, 10µA max ICC
  • ±8mA output drive at 5V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250mA per JESD 17
  • Operating range of 4.5V to 5.5V
  • Max tpd of 6ns at 5V
  • Low power consumption, 10µA max ICC
  • ±8mA output drive at 5V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250mA per JESD 17

The SN74AHCT1G125 device is a single bus buffer gate/line driver with 3-state output. The output is disabled when the output-enable ( OE) input is high. When OE is low, data is passed from the A input to the Y output.

The SN74AHCT1G125 device is a single bus buffer gate/line driver with 3-state output. The output is disabled when the output-enable ( OE) input is high. When OE is low, data is passed from the A input to the Y output.
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Documentación técnica

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Tipo Título Fecha
* Data sheet SN74AHCT1G125 Single Bus Buffer Gate With 3-State Output datasheet (Rev. P) PDF | HTML 19 mar 2024
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Application note Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 01 ago 1997
Application note CMOS Power Consumption and CPD Calculation (Rev. B) 01 jun 1997
Application note Live Insertion 01 oct 1996

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

5-8-LOGIC-EVM — Módulo de evaluación lógica genérico para encapsulados DCK, DCT, DCU, DRL y DBV de 5 a 8 pines

Módulo de evaluación (EVM) flexible diseñado para admitir cualquier dispositivo que tenga un encapsulado DCK, DCT, DCU, DRL o DBV en un recuento de 5 a 8 pines.
Guía del usuario: PDF
No disponible en TI.com
Modelo de simulación

HSPICE Model for SN74AHCT1G125

SCLJ016.ZIP (85 KB) - HSpice Model
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Modelo de simulación

SN74AHCT1G125 Behavioral SPICE Model

SCLM245.ZIP (7 KB) - PSpice Model
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Modelo de simulación

SN74AHCT1G125 IBIS Model

SCLM018.ZIP (7 KB) - IBIS Model
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Modelo de simulación

SN74AHCT1G125 PSpice Model

SCYM002.ZIP (21 KB) - PSpice Model
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Paquete Pasadores Descargar
SOT-23 (DBV) 5 Ver opciones
SOT-5X3 (DRL) 5 Ver opciones
SOT-SC70 (DCK) 5 Ver opciones
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Soporte y capacitación

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