ADC12QJ1600-EP
- High reliability enhanced product:
- Controlled Baseline
- One Assembly and Test Site
- One Fabrication Site
- –55°C to 125°C Temperature Range
- Extended Product Life Cycle
- Extended Product-Change Notification
- Product Traceability
- ADC Core:
- Resolution: 12 Bit
- Maximum sampling rate: 1.6 GSPS
- Non-interleaved architecture
- Internal dither reduces high-order harmonics
- Performance specifications (–1 dBFS):
- SNR (100 MHz): 57.4 dBFS
- ENOB (100 MHz): 9.1 Bits
- SFDR (100 MHz): 64 dBc
- Noise floor (–20 dBFS): –147 dBFS
- Full-scale input voltage: 800 mVPP-DIFF
- Full-power input bandwidth: 6 GHz
- JESD204C Serial data interface:
- Support for 2 to 8 total SerDes lanes
- Maximum baud-rate: 17.16 Gbps
- 64B/66B and 8B/10B encoding modes
- Subclass-1 support for deterministic latency
- Compatible with JESD204B receivers
- Optional internal sampling clock generation
- Internal PLL and VCO (7.2–8.2 GHz)
- SYSREF Windowing eases synchronization
- Four clock outputs simplify system clocking
- Reference clocks for FPGA or adjacent ADC
- Reference clock for SerDes transceivers
- Timestamp input and output for pulsed systems
- Power consumption (1 GSPS): 1.9W
- Power supplies: 1.1 V, 1.9 V
ADC12QJ1600-EP is a quad channel, 12-bit, 1.6 GSPS analog-to-digital converters (ADC). Low power consumption, high sampling rate and 12-bit resolution makes the device suited for a variety of multi-channel communications systems.
Full-power input bandwidth (-3 dB) of 6 GHz enables direct RF sampling of of L-band and S-band.
A number of clocking features are included to relax system hardware requirements, such as an internal phase-locked loop (PLL) with integrated voltage-controlled oscillator (VCO) to generate the sampling clock. Four clock outputs are provided to clock the logic and SerDes of the FPGA or ASIC. A timestamp input and output is provided for pulsed systems.
JESD204C serialized interface decreases system size by reducing the amount of printed circuit board (PCB) routing. Interface modes support from 2 to 8 lanes (dual and quad channel devices) or 1 to 4 lanes (for the single channel device), with SerDes baud-rates up to 17.16 Gbps, to allow the optimal configuration for each application.
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기술 문서
유형 | 직함 | 날짜 | ||
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* | Data sheet | ADC12QJ1600-EP Quad Channel 1.6-GSPS, 12-Bit, Analog-to-Digital Converter (ADC) with JESD204C Interface datasheet (Rev. A) | PDF | HTML | 2022/12/07 |
설계 및 개발
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ADC12QJ1600EVM — JESD204C 인터페이스를 지원하는 ADC12QJ1600-Q1 4채널 12비트, 1.6GSPS ADC 평가 모듈
ADC12QJ1600 평가 모듈(EVM)은 ADC12QJ1600-Q1 제품을 평가하는 데 사용합니다. ADC12QJ1600-Q1은 저전력, 12비트, 쿼드 채널, 1.6 GSPS ADC(아날로그-디지털 컨버터)로 버퍼 아날로그 입력과 온칩 PLL이 포함된 일체형 디지털 다운 컨버터를 지원하며 JESD204B/C 인터페이스를 사용합니다. EVM에는 광범위한 신호 소스 및 주파수를 수용할 수 있는 변압기 결합 아날로그 입력이 있습니다.
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TSW12QJ1600 평가 모듈(EVM)은 다양한 프런트 엔드 옵션을 갖춘 ADC12QJ1600-Q1 ADC(아날로그-디지털 컨버터)를 평가하는 데 사용됩니다. ADC12QJ1600-Q1은 4개의 아날로그 입력 채널을 사용하여 최대 1.6 GSPS(초당 기가 샘플링 속도)에서 작동할 수 있는 12비트 ADC입니다.
이 설계에는 동일한 PCB(인쇄 회로 기판)에 2개의 ADC12QJ1600-Q1 장치가 있으며, 이 장치는 다중 ADC 동기화와 결정적 지연 시간을 시연하고 다양한 프론트 엔드 옵션(AC 결합 변압기, LMH32401을 (...)
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패키지 | 핀 | 다운로드 |
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FCCSP (ALR) | 144 | 옵션 보기 |
주문 및 품질
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