JAJSSY8 January   2024 SN74LV4T125-EP

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 その他の製品シリーズ
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性
    6. 6.6 スイッチング特性
    7. 6.7 ノイズ特性
    8. 6.8 代表的特性
  8. 7 パラメータ測定情報
  9. 8 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1 平衡化された CMOS 3 ステート出力
      2. 8.3.2 クランプ ダイオード構造
      3. 8.3.3 LVxT 拡張入力電圧
        1. 8.3.3.1 降圧変換
        2. 8.3.3.2 昇圧変換
    4. 8.4 デバイスの機能モード
  10. 9 アプリケーションと実装
    1. 9.1 アプリケーション情報
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 設計要件
      2. 9.2.2 詳細な設計手順
      3. 9.2.3 アプリケーション曲線
    3. 9.3 電源に関する推奨事項
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントの更新通知を受け取る方法
    2. 10.2 サポート・リソース
    3. 10.3 商標
    4. 10.4 静電気放電に関する注意事項
    5. 10.5 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

SN74LV4T125-EP は、4 つの独立した 3 ステート出力付きバッファを内蔵し、広い電圧範囲で動作してレベル変換を実現します。各バッファはブール関数 Y = A を正論理で実行します。OE ピンに HIGH を印加することで、出力をハイ インピーダンス (Hi-Z) 状態にできます。出力レベルは常に電源電圧 (VCC) を基準としており、1.8V、2.5V、3.3V、5V の CMOS レベルをサポートしています。

入力は低スレッショルド回路を使用して設計され、低電圧 CMOS 入力の昇圧変換 (例：1.2V 入力から 1.8V 出力、1.8V 入力から 3.3V 出力) をサポートします。また、5V 許容入力ピンにより、降圧変換 (例：3.3V から 2.5V 出力) が可能です。

パッケージ情報
部品番号(1) パッケージ(2) パッケージ サイズ(3) 本体サイズ (公称)(4)
SN74LV4T125-EP PW (TSSOP、14) 5mm × 6.4mm 5mm × 4.4mm
(2) 詳細については、セクション 12 を参照してください。
(3) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
(4) 本体サイズ (長さ×幅) は公称値であり、ピンは含まれません。
GUID-9AB2696E-AB42-4889-90C9-96595DC92550-low.gif概略論理図 (正論理)