JAJSP90B October   2022  – November 2023 TMS320F2800132 , TMS320F2800133 , TMS320F2800135 , TMS320F2800137

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
    1. 3.1 機能ブロック図
  5. 4 デバイスの比較
    1. 4.1 関連製品
  6. 5 ピン構成および機能
    1. 5.1 ピン配置図
    2. 5.2 ピン属性
    3. 5.3 信号の説明
      1. 5.3.1 アナログ信号
      2. 5.3.2 デジタル信号
      3. 5.3.3 電源およびグランド
      4. 5.3.4 テスト、JTAG、リセット
    4. 5.4 ピン多重化
      1. 5.4.1 GPIO 多重化ピン
        1. 5.4.1.1 GPIO 多重化ピン
      2. 5.4.2 ADC ピンのデジタル入力 (AIO)
      3. 5.4.3 ADC ピン上のデジタル入出力 (AGPIO)
      4. 5.4.4 GPIO 入力クロスバー
      5. 5.4.5 GPIO 出力クロスバーおよび ePWM クロスバー
    5. 5.5 GPIO および ADC の割り当て
    6. 5.6 内部プルアップおよびプルダウン付きのピン
    7. 5.7 未使用ピンの接続
  7. 6 仕様
    1. 6.1  絶対最大定格
    2. 6.2  ESD 定格
    3. 6.3  推奨動作条件
    4. 6.4  消費電力の概略
      1. 6.4.1 システム消費電流 - VREG イネーブル - 内部電源
      2. 6.4.2 システム消費電流 - VREG ディセーブル - 外部電源
      3. 6.4.3 動作モード・テストの説明
      4. 6.4.4 消費電流のグラフ
      5. 6.4.5 消費電流の低減
        1. 6.4.5.1 ペリフェラル・ディセーブル時の標準的な電流低減
    5. 6.5  電気的特性
    6. 6.6  PM パッケージの熱抵抗特性
    7. 6.7  PT パッケージの熱抵抗特性
    8. 6.8  RGZ パッケージの熱抵抗特性
    9. 6.9  RHB パッケージの熱抵抗特性
    10. 6.10 熱設計の検討事項
    11. 6.11 システム
      1. 6.11.1  パワー・マネージメント・モジュール (PMM)
        1. 6.11.1.1 概要
        2. 6.11.1.2 概要
          1. 6.11.1.2.1 電源レール監視
            1. 6.11.1.2.1.1 I/O POR (パワーオン・リセット) 監視
            2. 6.11.1.2.1.2 I/O BOR (ブラウンアウト・リセット) 監視
            3. 6.11.1.2.1.3 VDD POR (パワーオン・リセット) 監視
          2. 6.11.1.2.2 外部監視回路の使用
          3. 6.11.1.2.3 遅延ブロック
          4. 6.11.1.2.4 内部1.2V LDO 電圧レギュレータ (VREG)
          5. 6.11.1.2.5 VREGENZ
        3. 6.11.1.3 外付け部品
          1. 6.11.1.3.1 デカップリング・コンデンサ
            1. 6.11.1.3.1.1 VDDIO デカップリング
            2. 6.11.1.3.1.2 VDD デカップリング
        4. 6.11.1.4 電源シーケンス
          1. 6.11.1.4.1 電源ピンの一括接続
          2. 6.11.1.4.2 信号ピンの電源シーケンス
          3. 6.11.1.4.3 電源ピンの電源シーケンス
            1. 6.11.1.4.3.1 外部 VREG / VDD モード・シーケンス
            2. 6.11.1.4.3.2 内部 VREG/VDD モード・シーケンス
            3. 6.11.1.4.3.3 電源シーケンスの概要と違反の影響
            4. 6.11.1.4.3.4 電源スルーレート
        5. 6.11.1.5 推奨動作条件の PMM への適用
        6. 6.11.1.6 パワー・マネージメント・モジュールの電気的データおよびタイミング
          1. 6.11.1.6.1 パワー・マネージメント・モジュールの動作条件
          2. 6.11.1.6.2 パワー・マネージメント・モジュールの特性
          3.        電源電圧
      2. 6.11.2  リセット・タイミング
        1. 6.11.2.1 リセット・ソース
        2. 6.11.2.2 リセットの電気的データおよびタイミング
          1. 6.11.2.2.1 リセット - XRSn - タイミング要件
          2. 6.11.2.2.2 リセット - XRSn - スイッチング特性
          3. 6.11.2.2.3 リセットのタイミング図
      3. 6.11.3  クロック仕様
        1. 6.11.3.1 クロック・ソース
        2. 6.11.3.2 クロック周波数、要件、および特性
          1. 6.11.3.2.1 入力クロック周波数およびタイミング要件、PLL ロック時間
            1. 6.11.3.2.1.1 入力クロック周波数
            2. 6.11.3.2.1.2 XTAL 発振器の特性
            3. 6.11.3.2.1.3 外部の (水晶振動子ではない) クロック・ソース使用時の X1 入力レベルの特性
            4. 6.11.3.2.1.4 X1 のタイミング要件
            5. 6.11.3.2.1.5 AUXCLKIN のタイミング要件
            6. 6.11.3.2.1.6 APLL 特性
            7. 6.11.3.2.1.7 XCLKOUT のスイッチング特性 - PLL バイパスまたはイネーブル
            8. 6.11.3.2.1.8 内部クロック周波数
        3. 6.11.3.3 入力クロックおよび PLL
        4. 6.11.3.4 XTAL 発振器
          1. 6.11.3.4.1 概要
          2. 6.11.3.4.2 概要
            1. 6.11.3.4.2.1 電気発振回路
              1. 6.11.3.4.2.1.1 動作モード
                1. 6.11.3.4.2.1.1.1 水晶動作モード
                2. 6.11.3.4.2.1.1.2 シングルエンド動作モード
              2. 6.11.3.4.2.1.2 XCLKOUT での XTAL 出力
            2. 6.11.3.4.2.2 水晶振動子
            3. 6.11.3.4.2.3 GPIO 動作モード
          3. 6.11.3.4.3 機能動作
            1. 6.11.3.4.3.1 ESR – 等価直列抵抗
            2. 6.11.3.4.3.2 Rneg – 負性抵抗
            3. 6.11.3.4.3.3 起動時間
              1. 6.11.3.4.3.3.1 X1 / X2 事前条件
            4. 6.11.3.4.3.4 DL – 励振レベル
          4. 6.11.3.4.4 水晶振動子の選択方法
          5. 6.11.3.4.5 テスト
          6. 6.11.3.4.6 一般的な問題とデバッグのヒント
          7. 6.11.3.4.7 水晶発振回路の仕様
            1. 6.11.3.4.7.1 水晶発振器のパラメータ
            2. 6.11.3.4.7.2 水晶振動子の等価直列抵抗 (ESR) 要件
            3. 6.11.3.4.7.3 水晶発振器の電気的特性
        5. 6.11.3.5 内部発振器
          1. 6.11.3.5.1 INTOSC の特性
          2. 6.11.3.5.2 外部高精度抵抗 (ExtR) を使用した場合の INTOSC2
      4. 6.11.4  フラッシュ・パラメータ
        1. 6.11.4.1 フラッシュ・パラメータ 
      5. 6.11.5  RAM の仕様
      6. 6.11.6  ROM の仕様
      7. 6.11.7  エミュレーション / JTAG
        1. 6.11.7.1 JTAG の電気的データおよびタイミング
          1. 6.11.7.1.1 JTAG のタイミング要件
          2. 6.11.7.1.2 JTAG のスイッチング特性
          3. 6.11.7.1.3 JTAG のタイミング図
        2. 6.11.7.2 cJTAG の電気的データおよびタイミング
          1. 6.11.7.2.1 cJTAG のタイミング要件
          2. 6.11.7.2.2 cJTAG のスイッチング特性
          3. 6.11.7.2.3 cJTAG のタイミング図
      8. 6.11.8  GPIO の電気的データおよびタイミング
        1. 6.11.8.1 GPIO - 出力タイミング
          1. 6.11.8.1.1 汎用出力のスイッチング特性
          2. 6.11.8.1.2 汎用出力のタイミング図
        2. 6.11.8.2 GPIO - 入力タイミング
          1. 6.11.8.2.1 汎用入力のタイミング要件
          2. 6.11.8.2.2 サンプリング・モード
        3. 6.11.8.3 入力信号のサンプリング・ウィンドウ幅
      9. 6.11.9  割り込み
        1. 6.11.9.1 外部割り込み (XINT) の電気的データおよびタイミング
          1. 6.11.9.1.1 外部割り込みのタイミング要件
          2. 6.11.9.1.2 外部割り込みのスイッチング特性
          3. 6.11.9.1.3 外部割り込みのタイミング
      10. 6.11.10 低消費電力モード
        1. 6.11.10.1 クロック・ゲーティング低消費電力モード
        2. 6.11.10.2 低消費電力モードのウェークアップ・タイミング
          1. 6.11.10.2.1 IDLE モードのタイミング要件
          2. 6.11.10.2.2 IDLE モードのスイッチング特性
          3. 6.11.10.2.3 IDLE 開始および終了タイミング図
          4. 6.11.10.2.4 STANDBY モードのタイミング要件
          5. 6.11.10.2.5 STANDBY モードのスイッチング特性
          6. 6.11.10.2.6 STANDBY の開始 / 終了タイミング図
          7. 6.11.10.2.7 HALT モードのタイミング要件
          8. 6.11.10.2.8 HALT モードのスイッチング特性
          9. 6.11.10.2.9 HALT 開始および終了タイミング図
    12. 6.12 アナログ・ペリフェラル
      1. 6.12.1 アナログ・ピンと内部接続
      2. 6.12.2 アナログ信号の説明
      3. 6.12.3 A/D コンバータ (ADC)
        1. 6.12.3.1 ADC の構成可能性
          1. 6.12.3.1.1 信号モード
        2. 6.12.3.2 ADC の電気的データおよびタイミング
          1. 6.12.3.2.1 ADC の動作条件
          2. 6.12.3.2.2 ADC 特性
          3. 6.12.3.2.3 ピンごとの ADC 性能
          4. 6.12.3.2.4 ADC 入力モデル
          5. 6.12.3.2.5 ADC のタイミング図
      4. 6.12.4 温度センサ
        1. 6.12.4.1 温度センサの電気的データおよびタイミング
          1. 6.12.4.1.1 温度センサの特性
      5. 6.12.5 コンパレータ・サブシステム (CMPSS)
        1. 6.12.5.1 CMPSS モジュールのバリエーション
        2. 6.12.5.2 CMPx_DACL
        3. 6.12.5.3 CMPSS 接続図
        4. 6.12.5.4 ブロック図
        5. 6.12.5.5 CMPSS の電気的データおよびタイミング
          1. 6.12.5.5.1 CMPSS コンパレータの電気的特性
          2. 6.12.5.5.2 CMPSS_LITE コンパレータの電気的特性
          3.        CMPSS コンパレータの入力換算オフセットとヒステリシス
          4. 6.12.5.5.3 CMPSS DAC の静的電気特性
          5. 6.12.5.5.4 CMPSS_LITE DAC の静的電気特性
          6. 6.12.5.5.5 CMPSS の説明用グラフ
          7. 6.12.5.5.6 CMPSS DAC の動的誤差
          8. 6.12.5.5.7 CMPx_DACL のバッファ付き出力の動作条件
          9. 6.12.5.5.8 CMPx_DACL のバッファ付き出力の電気的特性
    13. 6.13 制御ペリフェラル
      1. 6.13.1 拡張パルス幅変調器 (ePWM)
        1. 6.13.1.1 制御ペリフェラルの同期
        2. 6.13.1.2 ePWM の電気的データおよびタイミング
          1. 6.13.1.2.1 ePWM のタイミング要件
          2. 6.13.1.2.2 ePWM のスイッチング特性
          3. 6.13.1.2.3 トリップ・ゾーン入力のタイミング
            1. 6.13.1.2.3.1 トリップ・ゾーン入力のタイミング要件
            2. 6.13.1.2.3.2 PWM ハイ・インピーダンス特性のタイミング図
      2. 6.13.2 高分解能パルス幅変調器 (HRPWM)
        1. 6.13.2.1 HRPWM の電気的データおよびタイミング
          1. 6.13.2.1.1 高分解能 PWM の特性
      3. 6.13.3 外部 ADC 変換開始の電気的データおよびタイミング
        1. 6.13.3.1 外部 ADC 変換開始のスイッチング特性
        2. 6.13.3.2 ADCSOCAO または ADCSOCBO のタイミング図
      4. 6.13.4 拡張キャプチャ (eCAP)
        1. 6.13.4.1 eCAP のブロック図
        2. 6.13.4.2 eCAP の同期
        3. 6.13.4.3 eCAP の電気的データおよびタイミング
          1. 6.13.4.3.1 eCAP のタイミング要件
          2. 6.13.4.3.2 eCAP のスイッチング特性
      5. 6.13.5 拡張直交エンコーダ・パルス (eQEP)
        1. 6.13.5.1 eQEP の電気的データおよびタイミング
          1. 6.13.5.1.1 eQEP のタイミング要件
          2. 6.13.5.1.2 eQEP のスイッチング特性
    14. 6.14 通信ペリフェラル
      1. 6.14.1 CAN (Controller Area Network)
      2. 6.14.2 I2C (Inter-Integrated Circuit)
        1. 6.14.2.1 I2C の電気的データおよびタイミング
          1. 6.14.2.1.1 I2C のタイミング要件
          2. 6.14.2.1.2 I2C のスイッチング特性
          3. 6.14.2.1.3 I2C のタイミング図
      3. 6.14.3 シリアル通信インターフェイス (SCI)
      4. 6.14.4 シリアル・ペリフェラル・インターフェイス (SPI)
        1. 6.14.4.1 SPI マスタ・モードのタイミング
          1. 6.14.4.1.1 SPI マスタ・モードのタイミング要件
          2. 6.14.4.1.2 SPI マスタ・モードのスイッチング特性 - クロック位相 0
          3. 6.14.4.1.3 SPI マスタ・モードのスイッチング特性 - クロック位相 1
          4. 6.14.4.1.4 SPI マスタ・モードのタイミング図
        2. 6.14.4.2 SPI スレーブ・モードのタイミング
          1. 6.14.4.2.1 SPI スレーブ・モードのタイミング要件
          2. 6.14.4.2.2 SPI スレーブ・モードのスイッチング特性
          3. 6.14.4.2.3 SPI スレーブ・モードのタイミング図
  8. 7 詳細説明
    1. 7.1  概要
    2. 7.2  機能ブロック図
    3. 7.3  メモリ
      1. 7.3.1 メモリ・マップ
        1. 7.3.1.1 専用 RAM (Mx RAM)
        2. 7.3.1.2 ローカル共有 RAM (LSx RAM)
      2. 7.3.2 フラッシュ・メモリ・マップ
      3. 7.3.3 ペリフェラル・レジスタのメモリ・マップ
    4. 7.4  識別
    5. 7.5  C28x プロセッサ
      1. 7.5.1 浮動小数点演算ユニット (FPU)
      2. 7.5.2 三角関数演算ユニット (TMU)
    6. 7.6  デバイス・ブート・モード
      1. 7.6.1 デバイス・ブートの構成
        1. 7.6.1.1 ブート・モード・ピンの構成
        2. 7.6.1.2 ブート・モード・テーブル・オプションの設定
      2. 7.6.2 GPIO の割り当て
    7. 7.7  セキュリティ
      1. 7.7.1 チップの境界の保護
        1. 7.7.1.1 JTAGLOCK
        2. 7.7.1.2 ゼロピン・ブート
      2. 7.7.2 デュアル ゾーン セキュリティ
      3. 7.7.3 免責事項
    8. 7.8  ウォッチドッグ
    9. 7.9  C28x タイマ
    10. 7.10 デュアル・クロック・コンパレータ (DCC)
      1. 7.10.1 特長
      2. 7.10.2 DCCx クロック・ソース入力のマッピング
  9. 8 アプリケーション、実装、およびレイアウト
    1. 8.1 アプリケーションと実装
    2. 8.2 デバイスの主な特長
    3. 8.3 アプリケーション情報
      1. 8.3.1 代表的なアプリケーション
        1. 8.3.1.1 エアコン室外機
          1. 8.3.1.1.1 システム・ブロック図
          2. 8.3.1.1.2 エアコン室外機のリソース
        2. 8.3.1.2 洗濯機 / 乾燥機
          1. 8.3.1.2.1 システム・ブロック図
          2. 8.3.1.2.2 洗濯機 / 乾燥機のリソース
        3. 8.3.1.3 ロボット芝刈り機
          1. 8.3.1.3.1 システム・ブロック図
          2. 8.3.1.3.2 ロボット芝刈り機のリソース
        4. 8.3.1.4 商用テレコム整流器
          1. 8.3.1.4.1 システム・ブロック図
          2. 8.3.1.4.2 商用テレコム整流器のリソース
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 使い始めと次の手順
    2. 9.2 デバイス命名規則
    3. 9.3 マーキング
    4. 9.4 ツールとソフトウェア
    5. 9.5 ドキュメントのサポート
    6. 9.6 サポート・リソース
    7. 9.7 商標
    8. 9.8 静電気放電に関する注意事項
    9. 9.9 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • RHB|32
  • RGZ|48
  • PT|48
サーマルパッド・メカニカル・データ
発注情報

5.2 ピン属性

表 5-1 ピン属性
信号名 多重化位置 64 VPM 64 PM 48 RGZ 48 PT 32 RHB ピンの種類 説明
アナログ
A0 15 15 11 11 7 I ADC-A 入力 0
C15 I ADC-C 入力 15
CMP1_DACL I CMPSS-1 低 DAC 出力
CMP3_HP2 I CMPSS-3 ハイ・コンパレータ正入力 2
CMP3_LP2 I CMPSS-3 ロー・コンパレータ正入力 2
AIO231 0、4、8、12 I デジタル入力 231 に使用されるアナログ・ピン
A1 14 14 10 10 7 I ADC-A 入力 1
CMP1_HP4 I CMPSS-1 ハイ・コンパレータ正入力 4
CMP1_LP4 I CMPSS-1 ロー・コンパレータ正入力 4
AIO232 0、4、8、12 I デジタル入力 232 に使用されるアナログ・ピン
A2 9 9 6 6 4 I ADC-A 入力 2
C9 I ADC-C 入力 9
CMP1_HP0 I CMPSS-1 ハイ・コンパレータ正入力 0
CMP1_LP0 I CMPSS-1 ロー・コンパレータ正入力 0
GPIO224 I/O 汎用入出力 224。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A3 8 8 5 5 3 I ADC-A 入力 3
C5 I ADC-C 入力 5
CMP3_HN0 I CMPSS-3 ハイ・コンパレータ負入力 0
CMP3_HP3 I CMPSS-3 ハイ・コンパレータ正入力 3
CMP3_LN0 I CMPSS-3 ロー・コンパレータ負入力 0
CMP3_LP3 I CMPSS-3 ロー・コンパレータ正入力 3
GPIO242 I/O 汎用入出力 242。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A4 23 23 19 19 12 I ADC-A 入力 4
C14 I ADC-C 入力 14
CMP2_HP0 I CMPSS-2 ハイ・コンパレータ正入力 0
CMP2_LP0 I CMPSS-2 ロー・コンパレータ正入力 0
CMP4_HN0 I CMPSS-4 ハイ・コンパレータ負入力 0
CMP4_HP3 I CMPSS-4 ハイ・コンパレータ正入力 3
CMP4_LN0 I CMPSS-4 ロー・コンパレータ負入力 0
CMP4_LP3 I CMPSS-4 ロー・コンパレータ正入力 3
AIO225 0、4、8、12 I デジタル入力 225 に使用されるアナログ・ピン
A5 13 13 9 9 6 I ADC-A 入力 5
C2 I ADC-C 入力 2
CMP3_HN1 I CMPSS-3 ハイ・コンパレータ負入力 1
CMP3_HP1 I CMPSS-3 ハイ・コンパレータ正入力 1
CMP3_LN1 I CMPSS-3 ロー・コンパレータ負入力 1
CMP3_LP1 I CMPSS-3 ロー・コンパレータ正入力 1
AIO244 0、4、8、12 I デジタル入力 244 に使用されるアナログ・ピン
A6 6 6 4 4 2 I ADC-A 入力 6
CMP1_HP2 I CMPSS-1 ハイ・コンパレータ正入力 2
CMP1_LP2 I CMPSS-1 ロー・コンパレータ正入力 2
GPIO228 I/O 汎用入出力 228。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A7 19 19 15 15 8 I ADC-A 入力 7
C3 I ADC-C 入力 3
CMP4_HN1 I CMPSS-4 ハイ・コンパレータ負入力 1
CMP4_HP1 I CMPSS-4 ハイ・コンパレータ正入力 1
CMP4_LN1 I CMPSS-4 ロー・コンパレータ負入力 1
CMP4_LP1 I CMPSS-4 ロー・コンパレータ正入力 1
AIO245 0、4、8、12 I デジタル入力 245 に使用されるアナログ・ピン
A8 20 20 16 16 9 I ADC-A 入力 8
C11 I ADC-C 入力 11
CMP2_HP4 I CMPSS-2 ハイ・コンパレータ正入力 4
CMP2_LP4 I CMPSS-2 ロー・コンパレータ正入力 4
CMP4_HP4 I CMPSS-4 ハイ・コンパレータ正入力 4
CMP4_LP4 I CMPSS-4 ロー・コンパレータ正入力 4
AIO241 0、4、8、12 I デジタル入力 241 に使用されるアナログ・ピン
A10 25 25 21 21 13 I ADC-A 入力 10
C10 I ADC-C 入力 10
CMP2_HN0 I CMPSS-2 ハイ・コンパレータ負入力 0
CMP2_HP3 I CMPSS-2 ハイ・コンパレータ正入力 3
CMP2_LN0 I CMPSS-2 ロー・コンパレータ負入力 0
CMP2_LP3 I CMPSS-2 ロー・コンパレータ正入力 3
GPIO230 I/O 汎用入出力 230。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A11 12 12 8 8 6 I ADC-A 入力 11
C0 I ADC-C 入力 0
CMP1_HN1 I CMPSS-1 ハイ・コンパレータ負入力 1
CMP1_HP1 I CMPSS-1 ハイ・コンパレータ正入力 1
CMP1_LN1 I CMPSS-1 ロー・コンパレータ負入力 1
CMP1_LP1 I CMPSS-1 ロー・コンパレータ正入力 1
AIO237 0、4、8、12 I デジタル入力 237 に使用されるアナログ・ピン
A12 18 18 14 14 8 I ADC-A 入力 12
C1 I ADC-C 入力 1
CMP2_HN1 I CMPSS-2 ハイ・コンパレータ負入力 1
CMP2_HP1 I CMPSS-2 ハイ・コンパレータ正入力 1
CMP2_LN1 I CMPSS-2 ロー・コンパレータ負入力 1
CMP2_LP1 I CMPSS-2 ロー・コンパレータ正入力 1
CMP4_HP2 I CMPSS-4 ハイ・コンパレータ正入力 2
CMP4_LP2 I CMPSS-4 ロー・コンパレータ正入力 2
AIO238 0、4、8、12 I デジタル入力 238 に使用されるアナログ・ピン
A15 10 10 7 7 5 I ADC-A 入力 15
C7 I ADC-C 入力 7
CMP1_HN0 I CMPSS-1 ハイ・コンパレータ負入力 0
CMP1_HP3 I CMPSS-1 ハイ・コンパレータ正入力 3
CMP1_LN0 I CMPSS-1 ロー・コンパレータ負入力 0
CMP1_LP3 I CMPSS-1 ロー・コンパレータ正入力 3
AIO233 0、4、8、12 I デジタル入力 233 に使用されるアナログ・ピン
A16 2 2 2 2 32 I ADC-A 入力 16
C16 I ADC-C 入力 16
GPIO28 I/O 汎用入出力 28。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A17 27 27 I ADC-A 入力 17
C17 I ADC-C 入力 17
GPIO20 I/O 汎用入出力 20。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A18 28 28 I ADC-A 入力 18
C18 I ADC-C 入力 18
GPIO21 I/O 汎用入出力 21。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A19 29 29 22 23 I ADC-A 入力 19
C19 I ADC-C 入力 19
GPIO13 I/O 汎用入出力 13。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A20 30 30 23 24 I ADC-A 入力 20
C20 I ADC-C 入力 20
GPIO12 I/O 汎用入出力 12。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A14 11 11 7 7 5 I ADC-A 入力 14
C4 I ADC-C 入力 4
CMP3_HP4 I CMPSS-3 ハイ・コンパレータ正入力 4
CMP3_LP4 I CMPSS-3 ロー・コンパレータ正入力 4
AIO239 0、4、8、12 I デジタル入力 239 に使用されるアナログ・ピン
C6 7 7 4 4 2 I ADC-C 入力 6
CMP3_HP0 I CMPSS-3 ハイ・コンパレータ正入力 0
CMP3_LP0 I CMPSS-3 ロー・コンパレータ正入力 0
GPIO226 I/O 汎用入出力 226。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
A9 24 24 20 20 13 I ADC-A 入力 9
C8 I ADC-C 入力 8
CMP2_HP2 I CMPSS-2 ハイ・コンパレータ正入力 2
CMP2_LP2 I CMPSS-2 ロー・コンパレータ正入力 2
CMP4_HP0 I CMPSS-4 ハイ・コンパレータ正入力 0
CMP4_LP0 I CMPSS-4 ロー・コンパレータ正入力 0
GPIO227 I/O 汎用入出力 227。このピンには、この表の GPIO セクションに記載されているデジタル・マルチプレクサ機能もある。
VREFHI 16 16 12 12 I ADC の高いリファレンス電圧。外部リファレンス・モードでは、高い側のリファレンス電圧を外部からこのピンに印加する。内部リファレンス・モードでは、デバイスによってこのピンに電圧が駆動される。いずれのモードでも、2.2μF 以上のコンデンサをこのピンに配置する。このコンデンサは、VREFHI ピンと VREFLO ピンの間で、できるだけデバイスに近い場所に配置する必要がある。32 RHB パッケージでは、VREFHI は内部で VDDA に接続されている。
VREFLO 17 17 13 13 I ADC の低いリファレンス電圧
GPIO
GPIO0 0、4、8、12 52 52 41 42 28 I/O 汎用入出力 0
EPWM1_A 1 O ePWM-1 出力 A
CANA_RX 2 I CAN-A 受信
OUTPUTXBAR7 3 O 出力クロスバー出力 7
SCIA_RX 5 I SCI-A 受信データ
I2CA_SDA 6 I/OD I2C-A オープン・ドレイン双方向データ
SPIA_STE 7 I/O SPI-A スレーブ送信イネーブル (STE)
EQEP1_INDEX 13 I/O eQEP-1 インデックス
EPWM3_A 15 O ePWM-3 出力 A
GPIO1 0、4、8、12 51 51 40 41 27 I/O 汎用入出力 1
EPWM1_B 1 O ePWM-1 出力 B
SCIA_TX 5 O SCI-A 送信データ
I2CA_SCL 6 I/OD I2C-A オープン・ドレイン双方向クロック
SPIA_SOMI 7 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
EQEP1_STROBE 9 I/O eQEP-1 ストローブ
EPWM3_B 15 O ePWM-3 出力 B
GPIO2 0、4、8、12 50 50 39 40 I/O 汎用入出力 2
EPWM2_A 1 O ePWM-2 出力 A
OUTPUTXBAR1 5 O 出力クロスバー出力 1
SPIA_SIMO 7 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
SCIA_TX 9 O SCI-A 送信データ
I2CB_SDA 11 I/OD I2C-B オープン・ドレイン双方向データ
CANA_TX 14 O CAN-A 送信
EPWM4_A 15 O ePWM-4 出力 A
GPIO3 0、4、8、12 49 49 38 39 26 I/O 汎用入出力 3
EPWM2_B 1 O ePWM-2 出力 B
OUTPUTXBAR2 2、5 O 出力クロスバー出力 2
SPIA_CLK 7 I/O SPI-A クロック
SCIA_RX 9 I SCI-A 受信データ
I2CB_SCL 11 I/OD I2C-B オープン・ドレイン双方向クロック
CANA_RX 14 I CAN-A 受信
EPWM4_B 15 O ePWM-4 出力 B
GPIO4 0、4、8、12 48 48 37 38 25 I/O 汎用入出力 4
EPWM3_A 1 O ePWM-3 出力 A
I2CA_SCL 2 I/OD I2C-A オープン・ドレイン双方向クロック
OUTPUTXBAR3 5 O 出力クロスバー出力 3
CANA_TX 6 O CAN-A 送信
SPIA_SOMI 14 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
EPWM1_A 15 O ePWM-1 出力 A
GPIO5 0、4、8、12 61 61 46 47 30 I/O 汎用入出力 5
EPWM3_B 1 O ePWM-3 出力 B
I2CA_SDA 2 I/OD I2C-A オープン・ドレイン双方向データ
OUTPUTXBAR3 3 O 出力クロスバー出力 3
CANA_RX 6 I CAN-A 受信
SPIA_STE 7 I/O SPI-A スレーブ送信イネーブル (STE)
SCIA_RX 11 I SCI-A 受信データ
EPWM1_B 15 O ePWM-1 出力 B
GPIO6 0、4、8、12 64 64 48 48 I/O 汎用入出力 6
EPWM4_A 1 O ePWM-4 出力 A
OUTPUTXBAR4 2 O 出力クロスバー出力 4
SYNCOUT 3 O 外部 ePWM 同期パルス
EQEP1_A 5 I eQEP-1 入力 A
EPWM2_A 15 O ePWM-2 出力 A
GPIO7 0、4、8、12 57 57 43 43 29 I/O 汎用入出力 7
EPWM4_B 1 O ePWM-4 出力 B
EPWM2_A 2 O ePWM-2 出力 A
OUTPUTXBAR5 3 O 出力クロスバー出力 5
EQEP1_B 5 I eQEP-1 入力 B
SPIA_SIMO 7 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
SCIA_TX 11 O SCI-A 送信データ
CANA_TX 14 O CAN-A 送信
EPWM2_B 15 O ePWM-2 出力 B
GPIO8 0、4、8、12 47 47 36 I/O 汎用入出力 8
EPWM5_A 1 O ePWM-5 出力 A
ADCSOCAO 3 O 外部 ADC 用の ADC 変換開始 A
EQEP1_STROBE 5 I/O eQEP-1 ストローブ
SCIA_TX 6 O SCI-A 送信データ
SPIA_SIMO 7 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
I2CA_SCL 9 I/OD I2C-A オープン・ドレイン双方向クロック
GPIO9 0、4、8、12 62 62 47 I/O 汎用入出力 9
EPWM5_B 1 O ePWM-5 出力 B
SCIB_TX 2 O SCI-B 送信データ
OUTPUTXBAR6 3 O 出力クロスバー出力 6
EQEP1_INDEX 5 I/O eQEP-1 インデックス
SCIA_RX 6 I SCI-A 受信データ
SPIA_CLK 7 I/O SPI-A クロック
I2CB_SCL 14 I/OD I2C-B オープン・ドレイン双方向クロック
GPIO10 0、4、8、12 63 63 I/O 汎用入出力 10
EPWM6_A 1 O ePWM-6 出力 A
ADCSOCBO 3 O 外部 ADC 用の ADC 変換開始 B
EQEP1_A 5 I eQEP-1 入力 A
SCIB_TX 6 O SCI-B 送信データ
SPIA_SOMI 7 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
I2CA_SDA 9 I/OD I2C-A オープン・ドレイン双方向データ
GPIO11 0、4、8、12 31 31 14 I/O 汎用入出力 11
EPWM6_B 1 O ePWM-6 出力 B
CANA_RX 2 I CAN-A 受信
OUTPUTXBAR7 3 O 出力クロスバー出力 7
EQEP1_B 5 I eQEP-1 入力 B
SCIB_RX 6 I SCI-B 受信データ
SPIA_STE 7 I/O SPI-A スレーブ送信イネーブル (STE)
SPIA_SIMO 13 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
GPIO12 0、4、8、12 30 30 23 24 I/O 汎用入出力 12。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
EPWM7_A 1 O ePWM-7 出力 A
EQEP1_STROBE 5 I/O eQEP-1 ストローブ
SCIB_TX 6 O SCI-B 送信データ
SPIA_CLK 11 I/O SPI-A クロック
CANA_RX 13 I CAN-A 受信
GPIO13 0、4、8、12 29 29 22 23 I/O 汎用入出力 13。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
EPWM7_B 1 O ePWM-7 出力 B
EQEP1_INDEX 5 I/O eQEP-1 インデックス
SCIB_RX 6 I SCI-B 受信データ
SPIA_SOMI 11 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
CANA_TX 13 O CAN-A 送信
GPIO16 0、4、8、12 33 33 25 26 I/O 汎用入出力 16
SPIA_SIMO 1 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
OUTPUTXBAR7 3 O 出力クロスバー出力 7
EPWM5_A 5 O ePWM-5 出力 A
SCIA_TX 6 O SCI-A 送信データ
EQEP1_STROBE 9 I/O eQEP-1 ストローブ
XCLKOUT 11 O 外部クロック出力。このピンは、デバイス内のクロック信号の中から選択されたものを分周した信号を出力する。
GPIO17 0、4、8、12 34 34 I/O 汎用入出力 17
SPIA_SOMI 1 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
OUTPUTXBAR8 3 O 出力クロスバー出力 8
EPWM5_B 5 O ePWM-5 出力 B
SCIA_RX 6 I SCI-A 受信データ
EQEP1_INDEX 9 I/O eQEP-1 インデックス
CANA_TX 11 O CAN-A 送信
EPWM6_A 14 O ePWM-6 出力 A
GPIO18 0、4、8、12 41 41 32 33 21 I/O 汎用入出力 18
SPIA_CLK 1 I/O SPI-A クロック
SCIB_TX 2 O SCI-B 送信データ
CANA_RX 3 I CAN-A 受信
EPWM6_A 5 O ePWM-6 出力 A
I2CA_SCL 6 I/OD I2C-A オープン・ドレイン双方向クロック
XCLKOUT 11 O 外部クロック出力。このピンは、デバイス内のクロック信号の中から選択されたものを分周した信号を出力する。
X2 ALT I/O 水晶発振器出力。
GPIO19 0、4、8、12 42 42 33 34 22 I/O 汎用入出力 19
SPIA_STE 1 I/O SPI-A スレーブ送信イネーブル (STE)
SCIB_RX 2 I SCI-B 受信データ
CANA_TX 3 O CAN-A 送信
EPWM6_B 5 O ePWM-6 出力 B
I2CA_SDA 6 I/OD I2C-A オープン・ドレイン双方向データ
X1 ALT I/O 水晶発振器入力またはシングルエンド・クロック入力。水晶発振器をイネーブルにする前に、デバイス初期化ソフトウェアでこのピンを設定する必要がある。この発振器を使用するには、X1 と X2 の間に水晶振動子を接続する必要がある。このピンを使って、シングルエンドの 3.3V レベル・クロックを供給することもできる。
ExtR ALT2 I 内部発振器用の外部抵抗。クロック精度の向上に使用可能。
GPIO20 0、4、8、12 27 27 I/O 汎用入出力 20。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
EQEP1_A 1 I eQEP-1 入力 A
CANA_TX 3 O CAN-A 送信
SPIA_SIMO 6 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
I2CA_SCL 11 I/OD I2C-A オープン・ドレイン双方向クロック
SCIC_TX 15 O SCI-C 送信データ
GPIO21 0、4、8、12 28 28 I/O 汎用入出力 21。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
EQEP1_B 1 I eQEP-1 入力 B
CANA_RX 3 I CAN-A 受信
SPIA_SOMI 6 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
I2CA_SDA 11 I/OD I2C-A オープン・ドレイン双方向データ
SCIC_RX 15 I SCI-C 受信データ
GPIO22 0、4、8、12 56 56 I/O 汎用入出力 22
EQEP1_STROBE 1 I/O eQEP-1 ストローブ
SCIB_TX 3 O SCI-B 送信データ
SCIC_TX 9 O SCI-C 送信データ
EPWM4_A 14 O ePWM-4 出力 A
GPIO23 0、4、8、12 54 54 42 I/O 汎用入出力 23
EQEP1_INDEX 1 I/O eQEP-1 インデックス
SCIB_RX 3 I SCI-B 受信データ
SCIC_RX 9 I SCI-C 受信データ
EPWM4_B 14 O ePWM-4 出力 B
GPIO24 0、4、8、12 35 35 26 27 15 I/O 汎用入出力 24
OUTPUTXBAR1 1 O 出力クロスバー出力 1
SPIA_STE 3 I/O SPI-A スレーブ送信イネーブル (STE)
EPWM4_A 5 O ePWM-4 出力 A
SPIA_SIMO 6 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
SCIA_TX 11 O SCI-A 送信データ
ERRORSTS 13 O エラー・ステータス出力。外部プルダウンが必要。
GPIO28 0、4、8、12 2 2 2 2 32 I/O 汎用入出力 28。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
SCIA_RX 1 I SCI-A 受信データ
EPWM7_A 3 O ePWM-7 出力 A
OUTPUTXBAR5 5 O 出力クロスバー出力 5
EQEP1_A 6 I eQEP-1 入力 A
SCIC_TX 10 O SCI-C 送信データ
SPIA_CLK 11 I/O SPI-A クロック
ERRORSTS 13 O エラー・ステータス出力。外部プルダウンが必要。
I2CB_SDA 14 I/OD I2C-B オープン・ドレイン双方向データ
GPIO29 0、4、8、12 1 1 1 1 31 I/O 汎用入出力 29
SCIA_TX 1 O SCI-A 送信データ
EPWM7_B 3 O ePWM-7 出力 B
OUTPUTXBAR6 5 O 出力クロスバー出力 6
EQEP1_B 6 I eQEP-1 入力 B
SCIC_RX 10 I SCI-C 受信データ
SPIA_STE 11 I/O SPI-A スレーブ送信イネーブル (STE)
ERRORSTS 13 O エラー・ステータス出力。外部プルダウンが必要。
I2CB_SCL 14 I/OD I2C-B オープン・ドレイン双方向クロック
GPIO32 0、4、8、12 40 40 31 32 20 I/O 汎用入出力 32
I2CA_SDA 1 I/OD I2C-A オープン・ドレイン双方向データ
EQEP1_INDEX 2 I/O eQEP-1 インデックス
SPIA_CLK 3 I/O SPI-A クロック
EPWM4_B 5 O ePWM-4 出力 B
SCIC_TX 6 O SCI-C 送信データ
CANA_TX 10 O CAN-A 送信
ADCSOCBO 13 O 外部 ADC 用の ADC 変換開始 B
GPIO33 0、4、8、12 32 32 24 25 I/O 汎用入出力 33
I2CA_SCL 1 I/OD I2C-A オープン・ドレイン双方向クロック
OUTPUTXBAR4 5 O 出力クロスバー出力 4
SCIC_RX 6 I SCI-C 受信データ
CANA_RX 10 I CAN-A 受信
ADCSOCAO 13 O 外部 ADC 用の ADC 変換開始 A
GPIO35 0、4、8、12 39 39 30 31 19 I/O 汎用入出力 35
SCIA_RX 1 I SCI-A 受信データ
SPIA_SOMI 2 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
I2CA_SDA 3 I/OD I2C-A オープン・ドレイン双方向データ
CANA_RX 5 I CAN-A 受信
SCIC_RX 7 I SCI-C 受信データ
EQEP1_A 9 I eQEP-1 入力 A
EPWM5_B 11 O ePWM-5 出力 B
TDI 15 I JTAG テスト・データ入力 (TDI) - TDI は、このピンのデフォルトの多重化選択になっている。内部プルアップは、デフォルトでディセーブルになっている。このピンを JTAG TDI として使用する場合は、入力がフローティング入力にならないように、内部プルアップをイネーブルにするか、ボードに外部プルアップを追加する必要がある。
GPIO37 0、4、8、12 37 37 28 29 17 I/O 汎用入出力 37
OUTPUTXBAR2 1 O 出力クロスバー出力 2
SPIA_STE 2 I/O SPI-A スレーブ送信イネーブル (STE)
I2CA_SCL 3 I/OD I2C-A オープン・ドレイン双方向クロック
SCIA_TX 5 O SCI-A 送信データ
CANA_TX 6 O CAN-A 送信
SCIC_TX 7 O SCI-C 送信データ
EQEP1_B 9 I eQEP-1 入力 B
EPWM5_A 11 O ePWM-5 出力 A
TDO 15 O JTAG テスト・データ出力 (TDO) - TDO は、このピンのデフォルトの多重化選択になっている。内部プルアップは、デフォルトでディセーブルになっている。JTAG アクティビティがない場合、TDO 機能はトライステート状態になり、このピンはフローティング状態のままになる。GPIO 入力がフローティングにならないように、内部プルアップをイネーブルにするか、または外部プルアップをボードに追加する必要がある。
GPIO39 0、4、8、12 46 I/O 汎用入出力 39
SYNCOUT 13 O 外部 ePWM 同期パルス
EQEP1_INDEX 14 I/O eQEP-1 インデックス
GPIO40 0、4、8、12 53 53 I/O 汎用入出力 40
EPWM2_B 5 O ePWM-2 出力 B
SCIB_TX 9 O SCI-B 送信データ
EQEP1_A 10 I eQEP-1 入力 A
GPIO41 0、4、8、12 55 55 I/O 汎用入出力 41
EPWM7_A 1 O ePWM-7 出力 A
EPWM2_A 5 O ePWM-2 出力 A
SCIB_RX 9 I SCI-B 受信データ
EQEP1_B 10 I eQEP-1 入力 B
GPIO224 0、4、8、12 9 9 6 6 4 I/O 汎用入出力 224。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
OUTPUTXBAR3 5 O 出力クロスバー出力 3
SPIA_SIMO 6 I/O SPI-A スレーブ入力、マスタ出力 (SIMO)
EPWM1_A 9 O ePWM-1 出力 A
CANA_TX 10 O CAN-A 送信
EQEP1_A 11 I eQEP-1 入力 A
SCIC_TX 14 O SCI-C 送信データ
GPIO226 0、4、8、12 7 7 4 4 2 I/O 汎用入出力 226。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
EPWM6_A 5 O ePWM-6 出力 A
SPIA_CLK 6 I/O SPI-A クロック
EPWM1_B 9 O ePWM-1 出力 B
EQEP1_STROBE 11 I/O eQEP-1 ストローブ
SCIC_RX 14 I SCI-C 受信データ
GPIO227 0、4、8、12 24 24 20 20 13 I/O 汎用入出力 227。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
I2CB_SCL 1 I/OD I2C-B オープン・ドレイン双方向クロック
EPWM3_A 3 O ePWM-3 出力 A
OUTPUTXBAR1 5 O 出力クロスバー出力 1
EPWM2_B 6 O ePWM-2 出力 B
GPIO228 0、4、8、12 6 6 4 4 2 I/O 汎用入出力 228。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
ADCSOCAO 3 O 外部 ADC 用の ADC 変換開始 A
CANA_TX 5 O CAN-A 送信
SPIA_SOMI 6 I/O SPI-A スレーブ出力、マスタ入力 (SOMI)
EPWM2_B 9 O ePWM-2 出力 B
EQEP1_B 11 I eQEP-1 入力 B
GPIO230 0、4、8、12 25 25 21 21 13 I/O 汎用入出力 230。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
I2CB_SDA 1 I/OD I2C-B オープン・ドレイン双方向データ
EPWM3_B 3 O ePWM-3 出力 B
CANA_RX 5 I CAN-A 受信
EPWM2_A 6 O ePWM-2 出力 A
I2CA_SDA 7 I/OD I2C-A オープン・ドレイン双方向データ
GPIO242 0、4、8、12 8 8 5 5 3 I/O 汎用入出力 242。このピンには、この表の ANALOG セクションに記載されているアナログ機能もある。
OUTPUTXBAR2 5 O 出力クロスバー出力 2
SPIA_STE 6 I/O SPI-A スレーブ送信イネーブル (STE)
EPWM4_A 9 O ePWM-4 出力 A
CANA_RX 10 I CAN-A 受信
EQEP1_INDEX 11 I/O eQEP-1 インデックス
テスト、JTAG、リセット
TCK 36 36 27 28 16 I 内部プルアップ付き JTAG テスト・クロック。
TMS 38 38 29 30 18 I/O 内部プルアップ付き JTAG テスト・モード選択 (TMS)。このシリアル制御入力は、TCK の立ち上がりエッジで、TAP コントローラにシフトインされる。このデバイスには TRSTn ピンがない。通常動作時に JTAG をリセット状態に維持するために、基板上で TMS ピンと VDDIO の間に外部プルアップ抵抗 (推奨 2.2kΩ) を配置する必要がある。
XRSn 3 3 3 3 1 I/OD デバイス・リセット (IN) およびウォッチドッグ・リセット (OUT)。電源投入時、このピンはデバイスによって Low に駆動される。また、外部回路がこのピンを駆動して、デバイス・リセットをアサートすることもできる。ウォッチドッグ・リセットが発生した場合、MCU もこのピンを Low に駆動する。ウォッチドッグ・リセット時には、512 OSCCLK サイクルのウォッチドッグ・リセット期間にわたって、XRSn ピンが Low に駆動される。XRSn と VDDIO の間に 2.2kΩ～10kΩ の抵抗を配置する必要がある。ノイズ・フィルタリングのために XRS と VSS の間にコンデンサを配置する場合、容量は 100nF 以下にする必要がある。これらの値は、ウォッチドッグ・リセットがアサートされたときに、ウォッチドッグが 512 OSCCLK サイクル以内に XRSn ピンを VOL に正しく駆動できるように決められている。このピンは内部プルアップ付きのオープン・ドレイン出力。このピンが外部デバイスによって駆動される場合は、オープン・ドレイン・デバイスを使用して駆動する必要がある。
電源およびグランド
VDD 4、44、59 4、44、59 35、44 36、45 24 1.2V デジタル・ロジック電源ピン。各 VDD ピンの近くにデカップリング コンデンサを配置することを推奨。この合計容量は約 10µF になるようにする。
VDDA 22 22 18 18 11 3.3V アナログ電源ピン。各ピンに、最小 2.2μF のデカップリング・コンデンサを配置。32 RHB パッケージでは、VREFHI は内部で VDDA に接続されている。
VDDIO 43、60 43、60 34、45 35、46 23 3.3V デジタル I/O 電源ピン。各ピンに、最小 0.1μF のデカップリング・コンデンサを配置。
VREGENZ 46 I 内部プルダウン付きの内部電圧レギュレータ・イネーブル。VSS (Low) に接続すると、内部 VREG がイネーブルになる。VDDIO (High) に接続すると、外部電源を使用。
VSS 5、26、45、58 5、26、45、58 PAD 22、37、44 PAD デジタル GND。QFN パッケージの場合、パッケージの底面にあるグランド・パッドを PCB のグランド・プレーンに半田付けする必要がある。
VSSA 21 21 17 17 10 アナログ GND