JAJSV34E August   1995  – February 2025 SN54ACT11 , SN74ACT11

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 概要
  4. 3 ピン構成および機能
  5. 4 仕様
    1. 4.1 絶対最大定格
    2. 4.2 推奨動作条件
    3. 4.3 熱に関する情報
    4. 4.4 電気的特性
    5. 4.5 スイッチング特性
    6. 4.6 動作特性
  6. 5 パラメータ測定情報
  7. 6 詳細説明
    1. 6.1 機能ブロック図
    2. 6.2 デバイスの機能モード
  8. 7 アプリケーションと実装
    1. 7.1 アプリケーション情報
    2. 7.2 代表的なアプリケーション
      1. 7.2.1 設計要件
        1. 7.2.1.1 電源に関する考慮事項
        2. 7.2.1.2 入力に関する考慮事項
        3. 7.2.1.3 出力に関する考慮事項
      2. 7.2.2 詳細な設計手順
      3. 7.2.3 アプリケーション曲線
    3. 7.3 電源に関する推奨事項
    4. 7.4 レイアウト
      1. 7.4.1 レイアウトのガイドライン
  9. 8 デバイスおよびドキュメントのサポート
    1. 8.1 ドキュメントのサポート (アナログ)
      1. 8.1.1 関連リンク
    2. 8.2 ドキュメントの更新通知を受け取る方法
    3. 8.3 サポート・リソース
    4. 8.4 商標
    5. 8.5 静電気放電に関する注意事項
    6. 8.6 用語集
  10. 9 改訂履歴
  11. 10メカニカル、パッケージ、および注文情報

7.2.2 詳細な設計手順

  1. VCC と GND の間にデカップリング コンデンサを追加します。このコンデンサは、物理的にデバイスの近く、かつ VCC ピンと GND ピンの両方に電気的に近づけて配置する必要があります。レイアウトにレイアウトの例を示します。
  2. 出力の容量性負荷が 70pF 以下であることを確認します。これは厳密な制限ではありませんが、性能が最適化されます。これは、SN74HC11 から受信デバイスへのパターンを短い適切なサイズにすることで実現できます。
  3. 出力の抵抗性負荷を (VCC/IO(max))Ω より大きくします。これにより、絶対最大定格の出力電流の最大値を上回らないようにします。ほとんどの CMOS 入力は、MΩ 単位で測定される抵抗性負荷を備えています。これは、上記で計算される最小値よりはるかに大きい値です。
  4. 熱の問題がロジック ゲートで懸念されることはほとんどありませんが、消費電力と熱の上昇はアプリケーション レポート『CMOS の消費電力と Cpd の計算』の手順を使用して計算できます