The increasing demand on wireless networks to provide faster data links to customers has driven transceiver hardware to increasingly demanding performance with enough bandwidth to support the largest standardized multi-carrier frequency bands (with band aggregation in some cases) and enough receiver sensitivity and dynamic range to function in the presence of the strong blocking signals common in busy environments. This reference design describes a radio frequency (RF) receiver reference design with 16-bit sampler that achieves more than 100 MHz of bandwidth including a down-converting mixer, digital variable gain amplifier (DVGA), high speed pipelined analog-to-digital converter (ADC), local oscillator (LO) RF synthesizer and jitter-cleaning clock generator.
Se desarrolló una placa completamente integrada únicamente para pruebas y validación de rendimiento y no está disponible para la venta.
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Descripción general del diseño de referencia y datos de las pruebas de rendimiento verificadas
Descripción detallada del diseño para la instalación de componentes
Descripción detallada del diseño para la instalación de componentes
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Fichero de diseño que contiene información sobre la capa física de la PCB de diseño
Archivo de trazado de capas de PCB para generar el trazado del diseño de PCB
Diagrama esquemático detallado del diseño y los componentes
Incluye productos de TI en el diseño y posibles alternativas.
| Tipo | Título | Descargar la versión más reciente en inglés | Fecha | ||
|---|---|---|---|---|---|
| * | Guía de diseño | 700–2700-MHz Dual-Channel Receiver With 16-Bit ADC and 100 MHz of IF Bandwidth | 6/02/2015 | ||
| Artículo técnico | How to select a power-efficient narrowband receiver for active antenna-array syste | PDF | HTML | 12/04/2016 | ||
| Guía del usuario | TIDA-00360 Performance Summary | 17/03/2015 |
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