Este diseño de referencia muestra una arquitectura de costo optimizado que mejora la resolución de un módulo de entrada binaria. Se comparte una unidad de microcontrolador (MCU) entre dos canales de entrada (aislamiento de grupo) para minimizar el costo por canal. El amplio rango de entrada se cubre mediante un amplificador con ganancia y un convertidor analógico a digital (ADC) de 10 bits integrado en el microcontrolador (MCU) para medir con una precisión de ±3 %. Esta arquitectura elimina la necesidad de varias versiones de hardware en función del rango de tensión de entrada, como es el caso con una topología basada en optoacoplador. Para comunicar el código de convertidor analógico a digital (ADC) o la estimación cuadrática media de la entrada al procesador host, se usa un aislador digital. El diseño se ha probado para descargas electrostáticas (ESD), transferencia electrónica de fondos (EFT) y sobretensiones de acuerdo con la norma IEC61000-4 de nivel 4.
Se desarrolló una placa completamente integrada únicamente para pruebas y validación de rendimiento y no está disponible para la venta.
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Descripción general del diseño de referencia y datos de las pruebas de rendimiento verificadas
Descripción detallada del diseño para la instalación de componentes
Lista completa de componentes de diseño, designadores de referencia y números de fabricantes/piezas
Archivos para modelos 3D o dibujos 2D de componentes de IC
Fichero de diseño que contiene información sobre la capa física de la PCB de diseño
Archivo de trazado de capas de PCB para generar el trazado del diseño de PCB
Diagrama esquemático detallado del diseño y los componentes
Incluye productos de TI en el diseño y posibles alternativas.
| Tipo | Título | Descargar la versión más reciente en inglés | Fecha | ||
|---|---|---|---|---|---|
| * | Guía de diseño | EMC Compliant 2-Channel Wide AC/DC Isolated Binary Input Module Design Guide (Rev. A) | 7/10/2016 |
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