ADS54J54EVM
ADS54J54 クワッドチャネル、14 ビット、500MSPS、A/D コンバータの評価基板
ADS54J54EVM
概要
ADS54J54 評価基板 (EVM) は、JESD204B インターフェイス搭載、クワッド、500MSPS、14 ビット ADC の性能を実証します。この評価基板 (EVM) は ADS54J54 デバイスを搭載しており、LMK04828 が JESD204B 向けクロックを供給するほか、TI の各種電圧レギュレータが必要な電圧を供給します。ADC の各チャネルの入力はデフォルトで 1 個のトランス入力回路に接続されており、この回路は 50Ω のシングルエンド信号源に接続可能クロック・リファレンス入力はトランス入力から供給されており、この入力は 50Ω のシングルエンド・クロック・ソースに接続できます。オンボードの LMK04828 を使用して、必要な JESD204B クロックを生成できます。オンボード USB 接続と GUI を使用して、レジスタにアクセスできます。FMC コネクタで、業界標準の JESD204B ピン割り当てを採用した結果、TSW14J56 キャプチャ・カードや、市販のさまざまな FPGA 開発プラットフォームに直接接続できます。
特長
- フレキシブルな入力クロック・バッファは、1/2/4 分周器を搭載しており、クロック処理の簡素化に貢献
- オンチップ・ディザリング機能は SFDR (スプリアス・フリー・ダイナミック・レンジ) の拡大に寄与
- JESD204B のデータ・インターフェイスを採用し、デジタル・インターフェイスを簡素化するほか、最大 5.0Gbps のレーン・レートをサポート
- 同期と互換性の目的で、JESD204B/C サブクラス 1 をサポート
- 混在モードで使用する場合、チャネル A とチャネル B を、チャネル C やチャネル D と別に構成することが可能
- オプションの e2x デシメーション・フィルタは、サンプル・データを ½ のサンプル・レートで出力し、SNR を改善
高速 ADC(≧10 MSPS)
開始する
- 評価ボード ADS54J54EVM を購入します
- FPGA キャプチャ・カード TSW14J50EVM を購入します (必要な場合)
- evaluation board user's guide (英語) を読みます
- 両方のボードに対応する電源があることを確認し、ない場合は必要なものを購入します
- 評価ボード向けの GUI をダウンロードしてインストールします
- TSW14J50EVM キャプチャ・カード向けの HSDCPro ソフトウェアをダウンロードしてインストールします
購入と開発の開始
評価ボード
ADS54J54EVM — ADS54J54 クワッドチャネル、14 ビット、500MSPS、A/D コンバータの評価基板
TI.com で取り扱いなし
評価基板 (EVM) 向けの GUI
SLAC624 — ADS54J54 EVM SPI GUI Installer v1.1
SLAC624 — ADS54J54 EVM SPI GUI Installer v1.1
バージョン: 01.00.00.0A
リリース日: 18 2 2015
製品
高速 ADC(≧10 MSPS)
ハードウェア開発
評価ボード
リリース情報
The design resource accessed as www.ti.com/lit/zip/slac624 or www.ti.com/lit/xx/slac624a/slac624a.zip has been migrated to a new user experience at www.ti.com/tool/jp/download/SLAC624. Please update any bookmarks accordingly.
技術資料
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すべて表示 4
種類 | タイトル | 英語版のダウンロード | 日付 | |||
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証明書 | ADS54J54EVM EU Declaration of Conformity (DoC) | 2019年 1月 2日 | ||||
EVM ユーザー ガイド (英語) | ADS54J54 EVM Users Guide (Rev. A) | 2016年 1月 8日 | ||||
ユーザー・ガイド | Pipeline ADC Code Error Rate Analysis and Measurement | 2015年 11月 3日 | ||||
設計ガイド | ADS58J89, ADS54J54EVM Design Package (Rev. A) | 2015年 7月 10日 |