ADC12D040

アクティブ

デュアル・チャネル、12 ビット、40MSPS AD コンバータ(ADC)

製品詳細

Sample rate (max) (Msps) 40 Resolution (Bits) 12 Number of input channels 2 Interface type Parallel CMOS, TTL Analog input BW (MHz) 100 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 4 Power consumption (typ) (mW) 600 Architecture Pipeline SNR (dB) 84 ENOB (bit) 11.1 SFDR (dB) 80 Operating temperature range (°C) -40 to 85 Input buffer No
Sample rate (max) (Msps) 40 Resolution (Bits) 12 Number of input channels 2 Interface type Parallel CMOS, TTL Analog input BW (MHz) 100 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 4 Power consumption (typ) (mW) 600 Architecture Pipeline SNR (dB) 84 ENOB (bit) 11.1 SFDR (dB) 80 Operating temperature range (°C) -40 to 85 Input buffer No
TQFP (PAG) 64 144 mm² 12 x 12
  • Binary or 2's complement output format
  • Single supply operation
  • Internal sample-and-hold
  • Outputs 2.4V to 5V compatible
  • Power down mode
  • Pin-compatible with ADC12DL066
  • Internal/External Reference

Key Specifications

SNR (fIN = 10 MHz)

68 dB (typ)

ENOB (fIN = 10 MHz)

10.9 bits (typ)

SFDR (fIN = 10 MHz)

80 dB (typ)

Data Latency

6 Clock Cycles

Supply Voltage

+5V ±5%

Power Consumption, Operating

 
  • Operating

    600 mW (typ)

    Power Down Mode

    75 mW (typ)


  • Binary or 2's complement output format
  • Single supply operation
  • Internal sample-and-hold
  • Outputs 2.4V to 5V compatible
  • Power down mode
  • Pin-compatible with ADC12DL066
  • Internal/External Reference

Key Specifications

SNR (fIN = 10 MHz)

68 dB (typ)

ENOB (fIN = 10 MHz)

10.9 bits (typ)

SFDR (fIN = 10 MHz)

80 dB (typ)

Data Latency

6 Clock Cycles

Supply Voltage

+5V ±5%

Power Consumption, Operating

 
  • Operating

    600 mW (typ)

    Power Down Mode

    75 mW (typ)


The ADC12D040 is a dual, low power monolithic CMOS analog-to-digital converter capable of converting analog input signals into 12-bit digital words at 40 Megasamples per second (Msps), minimum. This converter uses a differential, pipeline architecture with digital error correction and an on-chip sample-and-hold circuit to minimize die size and power consumption while providing excellent dynamic performance. Operating on a single 5V power supply, the ADC12D040 achieves 10.9 effective bits at 10 MHz input and consumes just 600 mW at 40 Msps, including the reference current. The Power Down feature reduces power consumption to 75 mW.

The differential inputs provide a full scale differential input swing equal to 2VREF with the possibility of a single-ended input. Full use of the differential input is recommended for optimum performance. The digital outputs for the two ADCs are available on separate 12-bit buses with an output data format choice of offset binary or 2's complement.

For ease of interface, the digital output driver power pins of the ADC12D040 can be connected to a separate supply voltage in the range of 2.4V to the digital supply voltage, making the outputs compatible with low voltage systems. The ADC12D040's speed, resolution and single supply operation make it well suited for a variety of applications.

This device is available in the 64-lead TQFP package and will operate over the industrial temperature range of -40°C to +85°C. An evaluation board is available to facilitate the product evaluation process


The ADC12D040 is a dual, low power monolithic CMOS analog-to-digital converter capable of converting analog input signals into 12-bit digital words at 40 Megasamples per second (Msps), minimum. This converter uses a differential, pipeline architecture with digital error correction and an on-chip sample-and-hold circuit to minimize die size and power consumption while providing excellent dynamic performance. Operating on a single 5V power supply, the ADC12D040 achieves 10.9 effective bits at 10 MHz input and consumes just 600 mW at 40 Msps, including the reference current. The Power Down feature reduces power consumption to 75 mW.

The differential inputs provide a full scale differential input swing equal to 2VREF with the possibility of a single-ended input. Full use of the differential input is recommended for optimum performance. The digital outputs for the two ADCs are available on separate 12-bit buses with an output data format choice of offset binary or 2's complement.

For ease of interface, the digital output driver power pins of the ADC12D040 can be connected to a separate supply voltage in the range of 2.4V to the digital supply voltage, making the outputs compatible with low voltage systems. The ADC12D040's speed, resolution and single supply operation make it well suited for a variety of applications.

This device is available in the 64-lead TQFP package and will operate over the industrial temperature range of -40°C to +85°C. An evaluation board is available to facilitate the product evaluation process


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技術資料

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* データシート ADC12D040 Dual 12-Bit, 40 MSPS, 600 mW A/D Converter w/ Internal/Extrnal Re(jp) データシート (Rev. D 翻訳版) 最新英語版 (Rev.E) PDF | HTML 2005年 12月 9日
EVM ユーザー ガイド (英語) Evaluation Board User's Guide A/D Converters with Internal Ref and Sample & Hold (Rev. A) 2014年 8月 11日

設計と開発

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シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
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購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

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