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최대 DDR4-2400의 RDIMM 및 LRDIMM 작동을 위한 DDR4RCD01 JEDEC 호환 DDR4 레지스터

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제품 상세 정보

Function Memory interface Output frequency (max) (MHz) 1200 Number of outputs 68 Output supply voltage (V) 1.2 Core supply voltage (V) 1.2 Features DDR2 register Operating temperature range (°C) -40 to 95 Rating Catalog Output type CMOS Input type CMOS
Function Memory interface Output frequency (max) (MHz) 1200 Number of outputs 68 Output supply voltage (V) 1.2 Core supply voltage (V) 1.2 Features DDR2 register Operating temperature range (°C) -40 to 95 Rating Catalog Output type CMOS Input type CMOS
NFBGA (ZNR) 253 108 mm² 13.5 x 8
  • DDR4RCD01 JEDEC Compliant
  • DDR4 RDIMM and LRDIMM up to
    DDR4-2400
  • 32 Bits 1-to-2 Register Outputs
  • 1-to-4 Differential Clock Buffer
  • 1.2V Operation
  • PLL with Internal Feedback
  • Configurable Driver Strength
  • Scalable Weak Driver
  • Programmable Latency
  • Output Driver Calibration
  • Address Mirroring and Inversion
  • DDR4 Full-Parity Operation
  • On-Chip Programmable VREF Generation
  • CA Bus Training Mode
  • I2C Interface Support
  • Up to 16-Logical Ranks Support
    for 3DS RDIMMs
    and LRDIMMs
  • Up to 4 Physical Ranks Support
    for RDIMMs and
    LRDIMMs

All trademarks are the property of their respective owners.
  • DDR4RCD01 JEDEC Compliant
  • DDR4 RDIMM and LRDIMM up to
    DDR4-2400
  • 32 Bits 1-to-2 Register Outputs
  • 1-to-4 Differential Clock Buffer
  • 1.2V Operation
  • PLL with Internal Feedback
  • Configurable Driver Strength
  • Scalable Weak Driver
  • Programmable Latency
  • Output Driver Calibration
  • Address Mirroring and Inversion
  • DDR4 Full-Parity Operation
  • On-Chip Programmable VREF Generation
  • CA Bus Training Mode
  • I2C Interface Support
  • Up to 16-Logical Ranks Support
    for 3DS RDIMMs
    and LRDIMMs
  • Up to 4 Physical Ranks Support
    for RDIMMs and
    LRDIMMs

All trademarks are the property of their respective owners.

The CAB4 is 32-bit 1:2 Command/Address/Control Buffer and 1:4 differential Clock Buffer designed for operation on DDR4 registered DIMMs with a 1.2 V VDD mode.

All inputs are pseudo-differential using external or internal voltage reference. All outputs are full swing CMOS drivers optimized to drive 15 to 50 Ω effective terminated traces in DDR4 RDIMM, LRDIMM and 3D-Stacked DIMM applications. The clock outputs, command/address outputs, control outputs, data buffer control outputs can be enabled in groups, and independently driven with different strengths to compensate for different DIMM net topologies. The DDR4 Register operates from a differential clock (CK_t and CK_c). Inputs are registered at the crossing of CK_t going HIGH, and CK_c going LOW. The input signals could be either re-driven to the outputs if one of the input signals DCS[n:0]_n is driven LOW or it could be used to access device internal control registers when certain input conditions are met.

The device is characterized in the operating temperature range from –40°C to 95°C.

The CAB4 is 32-bit 1:2 Command/Address/Control Buffer and 1:4 differential Clock Buffer designed for operation on DDR4 registered DIMMs with a 1.2 V VDD mode.

All inputs are pseudo-differential using external or internal voltage reference. All outputs are full swing CMOS drivers optimized to drive 15 to 50 Ω effective terminated traces in DDR4 RDIMM, LRDIMM and 3D-Stacked DIMM applications. The clock outputs, command/address outputs, control outputs, data buffer control outputs can be enabled in groups, and independently driven with different strengths to compensate for different DIMM net topologies. The DDR4 Register operates from a differential clock (CK_t and CK_c). Inputs are registered at the crossing of CK_t going HIGH, and CK_c going LOW. The input signals could be either re-driven to the outputs if one of the input signals DCS[n:0]_n is driven LOW or it could be used to access device internal control registers when certain input conditions are met.

The device is characterized in the operating temperature range from –40°C to 95°C.
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* Data sheet CAB4A Registering Clock Driver with Parity for DDR4/DDR4L RDIMM & LRDIMM Applica datasheet (Rev. B) 2013/10/11

설계 및 개발

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시뮬레이션 툴

PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®

TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.

TI 설계 및 시뮬레이션 환경용 PSpice는 기본 제공 라이브러리를 이용해 복잡한 혼합 신호 설계를 시뮬레이션할 수 있습니다. 레이아웃 및 제작에 (...)
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포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

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