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LMK00804B-Q1

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오토모티브, 1.5V~3.3V, 1~4 고성능 LVCMOS 팬아웃 버퍼 및 레벨 변환기

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제품 상세 정보

Function Level translator, Single-ended Additive RMS jitter (typ) (fs) 40 Output frequency (max) (MHz) 350 Number of outputs 4 Output supply voltage (V) 1.5, 1.8, 2.5, 3.3 Core supply voltage (V) 3.3 Output skew (ps) 35 Features Glitch-free output clock, Level translation Operating temperature range (°C) -40 to 125 Rating Automotive Output type LVCMOS, LVTTL Input type HCSL, LVCMOS, LVDS, LVPECL, LVTTL
Function Level translator, Single-ended Additive RMS jitter (typ) (fs) 40 Output frequency (max) (MHz) 350 Number of outputs 4 Output supply voltage (V) 1.5, 1.8, 2.5, 3.3 Core supply voltage (V) 3.3 Output skew (ps) 35 Features Glitch-free output clock, Level translation Operating temperature range (°C) -40 to 125 Rating Automotive Output type LVCMOS, LVTTL Input type HCSL, LVCMOS, LVDS, LVPECL, LVTTL
VQFN (RGT) 16 9 mm² 3 x 3
  • AEC-Q100 qualified with the following results:
    • Device temperature grade 1: –40°C to +125°C, TA
  • Four LVCMOS/LVTTL outputs supporting 1.5-V to 3.3-V levels
    • Additive jitter: 0.1-ps RMS (typical) at 40 MHz
    • Noise floor: –168 dBc/Hz (typical) at 40 MHz
    • Output frequency: 350 MHz (maximum)
    • Output skew: 35 ps (maximum)
    • Part-to-part skew: 550 ps (maximum)
  • Two selectable inputs
    • CLK_P, CLK_N pair accepts LVPECL, LVDS, HCSL, SSTL, LVHSTL, or LVCMOS/LVTTL
    • LVCMOS_CLK accepts LVCMOS/LVTTL
  • Synchronous clock enable
  • Core/output power supplies:
    • 3.3 V/3.3 V
    • 3.3 V/2.5 V
    • 3.3 V/1.8 V
    • 3.3 V/1.5 V
  • Package: 16-pin VQFN
  • AEC-Q100 qualified with the following results:
    • Device temperature grade 1: –40°C to +125°C, TA
  • Four LVCMOS/LVTTL outputs supporting 1.5-V to 3.3-V levels
    • Additive jitter: 0.1-ps RMS (typical) at 40 MHz
    • Noise floor: –168 dBc/Hz (typical) at 40 MHz
    • Output frequency: 350 MHz (maximum)
    • Output skew: 35 ps (maximum)
    • Part-to-part skew: 550 ps (maximum)
  • Two selectable inputs
    • CLK_P, CLK_N pair accepts LVPECL, LVDS, HCSL, SSTL, LVHSTL, or LVCMOS/LVTTL
    • LVCMOS_CLK accepts LVCMOS/LVTTL
  • Synchronous clock enable
  • Core/output power supplies:
    • 3.3 V/3.3 V
    • 3.3 V/2.5 V
    • 3.3 V/1.8 V
    • 3.3 V/1.5 V
  • Package: 16-pin VQFN

The LMK00804B-Q1 is a high-performance clock fan-out buffer and level translator that can distribute up to four LVCMOS/LVTTL outputs (3.3-V, 2.5-V, 1.8-V, or 1.5-V levels) from one of two selectable inputs that can accept differential or single-ended inputs. The clock enable input is synchronized internally to eliminate runt or glitch pulses on the outputs when the clock enable terminal is asserted or deasserted. The outputs are held in logic low state when the clock is disabled. The LMK00804B-Q1 can also distribute a low-jitter clock across four transceivers and can improve the overall target detection and resolution in a cascaded mmWave radar system.

The LMK00804B-Q1 is a high-performance clock fan-out buffer and level translator that can distribute up to four LVCMOS/LVTTL outputs (3.3-V, 2.5-V, 1.8-V, or 1.5-V levels) from one of two selectable inputs that can accept differential or single-ended inputs. The clock enable input is synchronized internally to eliminate runt or glitch pulses on the outputs when the clock enable terminal is asserted or deasserted. The outputs are held in logic low state when the clock is disabled. The LMK00804B-Q1 can also distribute a low-jitter clock across four transceivers and can improve the overall target detection and resolution in a cascaded mmWave radar system.
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유형 직함 날짜
* Data sheet LMK00804B-Q1 1.5-V to 3.3-V, 1-to-4 High-Performance LVCMOS Fan-Out Buffer and Level Translator datasheet (Rev. B) PDF | HTML 2019/08/26
Functional safety information LMK00804B-Q1 Functional Safety, FIT Rate, Failure Mode Distribution and Pin FMA PDF | HTML 2021/12/01
EVM User's guide LMK00804B-Q1EVM User’s guide (Rev. A) 2019/08/26

설계 및 개발

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평가 보드

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시뮬레이션 모델

LMK00804B-Q1 IBIS Model

SNAM230.ZIP (55 KB) - IBIS Model
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설계 툴

CLOCK-TREE-ARCHITECT — 클록 트리 아키텍트 프로그래밍 소프트웨어

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The cascade development kit has two main use cases:
  1. To use the MMWCAS-DSP-EVM as a capture card to fully evaluate the AWR2243 four-chip cascade performance by using the mmWave studio tool, please read the TIDEP-01012 design guide.
  2. To use the MMWCAS-DSP-EVM to develop radar real time SW application, (...)
Design guide: PDF
회로도: PDF
패키지 핀 다운로드
VQFN (RGT) 16 옵션 보기
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

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지원 및 교육

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