LMK60E2-156M
- Low Noise, High Performance
- Jitter: 150 fs RMS Typical Fout > 100 MHz
- PSRR: –60 dBc, Robust Supply Noise Immunity
- Supported Output Format
- LVPECL, LVDS and HCSL up to 400 MHz
- Total Frequency Tolerance of ±50 ppm (LMK60X2) and ±25 ppm (LMK60X0)
- 3.3-V Operating Voltage
- Industrial Temperature Range (–40ºC to +85ºC)
- 7-mm × 5-mm 6-pin Package That is Pin-Compatible With Industry Standard 7050 XO Package
The LMK60EX is a family of low jitter oscillators that generate a commonly used reference clock. The device is pre-programmed in factory to support any reference clock frequency; supported output formats are LVPECL, LVDS, and HCSL up to 400 MHz. Internal power conditioning provide excellent power supply ripple rejection (PSRR), reducing the cost and complexity of the power delivery network. The device operates from a single 3.3-V ±5% supply.
기술 문서
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모두 보기2 | 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | LMK60XX High Performance Low Jitter Oscillator datasheet (Rev. C) | PDF | HTML | 2017/11/30 |
| EVM User's guide | LMK60XXEVM, LMK62XXEVM User's Guide (Rev. A) | 2017/02/09 |
설계 및 개발
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평가 보드
LMK60E2-156M25EVM — LMK60xx 저지터 단일 출력 고정 주파수 오실레이터 평가 모듈
This Evaluation Module is for the LMK60xx which outputs a clock at a predesignated frequency (156.25 MHz) and with a pre-determined output configuration (LVPECL). No user adjustments are allowed or possible.
사용 설명서: PDF
설계 툴
CLOCK-TREE-ARCHITECT — 클록 트리 아키텍트 프로그래밍 소프트웨어
Clock tree architect is a clock tree synthesis tool that streamlines your design process by generating clock tree solutions based on your system requirements. The tool pulls data from an extensive database of clocking products to generate a system-level multi-chip clocking solution.
시뮬레이션 툴
PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®
TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.
TI 설계 및 시뮬레이션 환경용 PSpice는 기본 제공 라이브러리를 이용해 복잡한 혼합 신호 설계를 시뮬레이션할 수 있습니다. 레이아웃 및 제작에 (...)
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| 패키지 | 핀 | 다운로드 |
|---|---|---|
| QFM (SIA) | 6 | 옵션 보기 |
주문 및 품질
포함된 정보:
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
포함된 정보:
- 팹 위치
- 조립 위치