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SN74GTL3004

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SN74GTL3004

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제품 상세 정보

Technology family GTL Applications GTL Rating Catalog Operating temperature range (°C) -40 to 85
Technology family GTL Applications GTL Rating Catalog Operating temperature range (°C) -40 to 85
SOT-SC70 (DCK) 6 4.2 mm² 2 x 2.1
  • VDD Range: 3.0 V to 3.6 V
  • VTT Range: 1 V to 1.3 V
  • Provides Selectable GTL VREF
    • 0.615 × VTT
    • 0.63 × VTT
    • 0.65 × VTT
    • 0.67 × VTT
  • ±1% Resistor Ratio Tolerance
  • Ambient Temperature Range: -40°C to 85°C
  • ESD Protection Exceeds the Following Levels Tests (Tested Per JESD-22):
    • 2500-V Human-Body Model
      (A114-B, Class II)
    • 250-V Machine Model (A115-A)
    • 1500-V Charged-Device Model (C101)
  • VDD Range: 3.0 V to 3.6 V
  • VTT Range: 1 V to 1.3 V
  • Provides Selectable GTL VREF
    • 0.615 × VTT
    • 0.63 × VTT
    • 0.65 × VTT
    • 0.67 × VTT
  • ±1% Resistor Ratio Tolerance
  • Ambient Temperature Range: -40°C to 85°C
  • ESD Protection Exceeds the Following Levels Tests (Tested Per JESD-22):
    • 2500-V Human-Body Model
      (A114-B, Class II)
    • 250-V Machine Model (A115-A)
    • 1500-V Charged-Device Model (C101)

The SN74GTL3004 provides for a selectable GTL Voltage Reference (GTL VREF). The value of the GTL VREF can be adjusted using S0 and S1 select pins.

The S0 and S1 pins contain glitch-suppression circuitry for excellent noise immunity. When left floating, the S0 and S1 control input pins have 100-kµ pullups that set the GTL VREF default value to the 0.67 × VTT ratio
(S0 = 1 and S1 =1).

The SN74GTL3004 provides for a selectable GTL Voltage Reference (GTL VREF). The value of the GTL VREF can be adjusted using S0 and S1 select pins.

The S0 and S1 pins contain glitch-suppression circuitry for excellent noise immunity. When left floating, the S0 and S1 control input pins have 100-kµ pullups that set the GTL VREF default value to the 0.67 × VTT ratio
(S0 = 1 and S1 =1).
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기술 문서

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유형 직함 날짜
* Data sheet Selectable GTL Voltage Reference datasheet (Rev. A) 2008/04/01
Application note Implications of Slow or Floating CMOS Inputs (Rev. E) 2021/07/26
Selection guide Voltage Translation Buying Guide (Rev. A) 2021/04/15
Selection guide Logic Guide (Rev. AB) 2017/06/12
Application note Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015/12/02
User guide LOGIC Pocket Data Book (Rev. B) 2007/01/16
Application note Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004/07/08
Application note TI IBIS File Creation, Validation, and Distribution Processes 2002/08/29
Application note Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices 2002/05/10
User guide GTLP/GTL Logic High-Performance Backplane Drivers Data Book (Rev. A) 2001/09/15
Selection guide Advanced Bus Interface Logic Selection Guide 2001/01/09
Application note GTL/BTL: A Low-Swing Solution for High-Speed Digital Logic (Rev. A) 1997/03/01
Application note Understanding Advanced Bus-Interface Products Design Guide 1996/05/01

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

5-8-LOGIC-EVM — 5핀~8핀 DCK, DCT, DCU, DRL 및 DBV 패키지용 일반 논리 평가 모듈

5~8핀 수의 DCK, DCT, DCU, DRL 또는 DBV 패키지가 있는 모든 디바이스를 지원하도록 설계된 유연한 EVM.
사용 설명서: PDF
TI.com에서 구매할 수 없습니다
시뮬레이션 모델

HSPICE Model for SN74GTL3004

SCBJ169.ZIP (92 KB) - HSpice Model
다운로드
패키지 핀 다운로드
SOT-SC70 (DCK) 6 옵션 보기
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
포함된 정보:
  • 팹 위치
  • 조립 위치

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

포럼 주제 모두 보기(영문)

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