JAJSQ84D May   2023  – March 2024 SN74AC244-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 ピン構成および機能
  6. 5 仕様
    1. 5.1  絶対最大定格
    2. 5.2  ESD 定格
    3. 5.3  推奨動作条件
    4. 5.4  熱に関する情報
    5. 5.5  電気的特性
    6. 5.6  スイッチング特性：1.5V VCC
    7. 5.7  スイッチング特性：1.8V VCC
    8. 5.8  スイッチング特性：2.5V VCC
    9. 5.9  スイッチング特性：3.3V VCC
    10. 5.10 スイッチング特性：5V VCC
    11. 5.11 ノイズ特性
    12. 5.12 代表的特性
  7. 6 パラメータ測定情報
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 平衡化された CMOS 3 ステート出力
      2. 7.3.2 標準 CMOS 入力
      3. 7.3.3 クランプ ダイオード構造
      4. 7.3.4 ウェッタブル フランク
    4. 7.4 デバイスの機能モード
  9. 8 アプリケーション情報に関する免責事項
    1. 8.1 アプリケーション情報
    2. 8.2 代表的なアプリケーション
      1. 8.2.1 設計要件
        1. 8.2.1.1 電源に関する考慮事項
        2. 8.2.1.2 入力に関する考慮事項
        3. 8.2.1.3 出力に関する考慮事項
      2. 8.2.2 詳細な設計手順
      3. 8.2.3 アプリケーション曲線
    3. 8.3 電源に関する推奨事項
    4. 8.4 レイアウト
      1. 8.4.1 レイアウトのガイドライン
      2. 8.4.2 レイアウト例
  10. 9 デバイスおよびドキュメントのサポート
    1. 9.1 ドキュメントの更新通知を受け取る方法
    2. 9.2 サポート・リソース
    3. 9.3 商標
    4. 9.4 静電気放電に関する注意事項
    5. 9.5 用語集
  11. 10改訂履歴
  12. 11メカニカル、パッケージ、および注文情報

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • RKS|20
  • PW|20
  • DGS|20
サーマルパッド・メカニカル・データ
発注情報

7.1 概要

SN74AC244-Q1 は、シュミット トリガ入力と 3 ステート出力を備えた 8 つの独立した高速 CMOS バッファを内蔵しています。

各バッファは、ブール論理関数 xYn = xAn を実行します。x はバンク番号、n はチャネル番号です。

各出力イネーブル (xOE) は 4 つのバッファを制御します。xOE ピンが Low 状態のとき、バンク x のすべてのバッファの出力がイネーブルになります。xOE ピンが High 状態のとき、バンク x のすべてのバッファの出力がディセーブルになります。ディセーブルされた出力はすべて高インピーダンス状態になります。

電源オンまたは電源オフ時にデバイスを高インピーダンス状態にするには、両方の OE ピンをプルアップ抵抗経由で VCC に接続します。この抵抗の最小値は、「電気的特性」表に定義されているドライバの電流シンク能力とピンのリーク電流によって決定されます。