JAJSJ34G April   1997  – July 2022 UC1842 , UC1843 , UC1844 , UC1845 , UC2842 , UC2843 , UC2844 , UC2845 , UC3842 , UC3843 , UC3844 , UC3845

PRODUCTION DATA  

  1. 特長
  2. アプリケーション
  3. 概要
  4. 改訂履歴
  5. デバイス比較表
  6. ピン構成および機能
  7. 仕様
    1. 7.1 絶対最大定格
    2. 7.2 ESD 定格
    3. 7.3 推奨動作条件
    4. 7.4 熱に関する情報
    5. 7.5 電気的特性
    6. 7.6 標準的特性
  8. 詳細説明
    1. 8.1 概要
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1  ピンの詳細説明
        1. 8.3.1.1 COMP
        2. 8.3.1.2 VFB
        3. 8.3.1.3 ISENSE
        4. 8.3.1.4 RT/CT
        5. 8.3.1.5 GROUND
        6. 8.3.1.6 OUTPUT
        7. 8.3.1.7 VCC
        8. 8.3.1.8 VREF
      2. 8.3.2  パルス単位の電流制限
      3. 8.3.3  電流検出
      4. 8.3.4  出力抵抗の低いエラー・アンプ
      5. 8.3.5  低電圧誤動作防止
      6. 8.3.6  発振器
      7. 8.3.7  同期
      8. 8.3.8  シャットダウン技法
      9. 8.3.9  勾配補償
      10. 8.3.10 ソフト・スタート
      11. 8.3.11 電圧モード
    4. 8.4 デバイスの機能モード
      1. 8.4.1 通常動作
      2. 8.4.2 UVLO モード
  9. アプリケーションと実装
    1. 9.1 アプリケーション情報
      1. 9.1.1 開ループのテスト装置
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 設計要件
      2. 9.2.2 詳細な設計手順
        1. 9.2.2.1  入力バルク容量と最小バルク電圧
        2. 9.2.2.2  トランスの巻線比と最大デューティ・サイクル
        3. 9.2.2.3  トランスのインダクタンスとピーク電流
        4. 9.2.2.4  出力コンデンサ
        5. 9.2.2.5  電流検出ネットワーク
        6. 9.2.2.6  ゲート駆動抵抗
        7. 9.2.2.7  VREF コンデンサ
        8. 9.2.2.8  RT/CT
        9. 9.2.2.9  スタートアップ回路
        10. 9.2.2.10 電圧帰還補償
          1. 9.2.2.10.1 電力段の極とゼロ
          2. 9.2.2.10.2 勾配補償
          3. 9.2.2.10.3 開ループ・ゲイン
          4. 9.2.2.10.4 補償ループ
      3. 9.2.3 アプリケーション曲線
  10. 10電源に関する推奨事項
  11. 11レイアウト
    1. 11.1 レイアウトのガイドライン
      1. 11.1.1 フィードバック配線
      2. 11.1.2 バイパス・コンデンサ
      3. 11.1.3 補償部品
      4. 11.1.4 トレースとグランド・プレーン
    2. 11.2 レイアウト例
  12. 12デバイスおよびドキュメントのサポート
    1. 12.1 Receiving Notification of Documentation Updates
    2. 12.2 サポート・リソース
    3. 12.3 商標
    4. 12.4 Electrostatic Discharge Caution
    5. 12.5 Glossary
  13. 13メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報
勾配補償

勾配補償は、デューティ・サイクルが 50% を超える場合に発生の可能性のある、大信号の分数調波不安定性です。この場合、1 次側インダクタの立ち上がり電流勾配が、2 次側の立ち下がり電流勾配と一致しない可能性があります。分数調波の発振によって出力電圧リップルが増加し、コンバータの電力処理能力が制限される可能性もあります。

勾配補償の目標は、理想的な品質係数 QP を、スイッチング周波数の半分において 1 に等しくすることです。QPEquation37 で計算されます。

Equation37. GUID-B7CD0A9F-AA81-40A2-9556-D9D1743F3FDD-low.gif

Equation37 で、D は 1 次側スイッチのデューティ・サイクル、MC はスロープ補償係数で、Equation38 によって定義されます。

Equation38. GUID-F24D8F87-A178-445E-9730-E5EA6EED832F-low.gif

Equation38 で、Se は補償ランプの勾配、Sn はインダクタの立ち上がり勾配です。勾配補償の最適な目標は、QP を 1 にすることです。Equation38 を再編成すると、勾配補償の理想的な値が決定されます。

Equation39. GUID-694E4759-B1D6-4689-9892-8C9F8F3DEE64-low.gif

この設計で十分な勾配補償を行うには、D が最大値の 0.627 に達したとき、MC を 2.193 にする必要があります。

ISENSE ピンでのインダクタの立ち上がり勾配 Sn は、Equation40 で計算されます。

Equation40. GUID-C84D26B5-7F7D-41FA-BCAB-43B3660B09B9-low.gif

補償スロープ Se は、Equation41 で計算されます。

Equation41. GUID-961C83BE-84AB-4AB7-AC03-0E62E3297532-low.gif

補償スロープは、RRAMP と RCSF によってシステムに追加されます。CRAMP AC カップリング・コンデンサで、電流検出にオフセットを追加することなく、発振器の電圧ランプを使用できます。高周波短絡を近似するため、開始点として 10nF などの値を選択し、必要に応じて調整を加えます。抵抗 RRAMP および RCSF は、発振器の充電勾配から分割電圧を形成し、この比例ランプを ISENSE ピンに注入して勾配補償を追加します。RRAMP の値を、RRT 抵抗よりも大幅に大きくすると、内部発振器の負荷がダウンして周波数シフトが起きることを避けられます。発振器の充電勾配は、Equation43 に示すように、RT/CT のこぎり波のピーク・ツー・ピーク電圧 VOSCpp である 1.7V と、最小オン時間を使用して計算されます。

Equation42. GUID-97F3910C-F534-4739-A24D-4AF63893EF34-low.gif
Equation43. GUID-864EB5AC-7CBC-455C-ADC5-FD0933AFAC9F-low.gif

44.74mV/μs の補償勾配を実現するため、Equation44 で抵抗 RCSF を計算します。この設計では、Rramp に 24.9kΩ、RCSF に 4.2kΩ の抵抗が選択されています。

Equation44. GUID-4762B6E0-84B1-46C6-807D-8F4736BCBFBC-low.gif