JAJSVK8A November   2024  – October 2025 LP5899

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 説明
  5. 4 デバイス比較表
  6. 5 ピン構成および機能
  7. 6 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 熱に関する情報
    4. 6.4 推奨動作条件
    5. 6.5 電気的特性
    6. 6.6 タイミング要件
    7. 6.7 スイッチング特性
    8. 6.8 タイミング図
    9. 6.9 代表的特性
  8. 7 詳細説明
    1. 7.1 概要
    2. 7.2 機能ブロック図
    3. 7.3 機能説明
      1. 7.3.1 内部発振器およびクロック
        1. 7.3.1.1 システム クロック
        2. 7.3.1.2 連続クロック シリアル インターフェイス (CCSI) クロック
      2. 7.3.2 連続クロック シリアル インターフェイス (CCSI)
        1. 7.3.2.1 コマンド フォーマット
        2. 7.3.2.2 コマンドの認識および同期化
        3. 7.3.2.3 CCSI コマンド キュー
        4. 7.3.2.4 CCSI のスタート ビットと検査ビットの挿入と除去
      3. 7.3.3 FIFO
        1. 7.3.3.1 FIFO レベルおよびデータ レディ (DRDY) 割り込み
        2. 7.3.3.2 FIFO クリアランス
      4. 7.3.4 診断
        1. 7.3.4.1  低電圧誤動作防止
        2. 7.3.4.2  発振器フォルト診断
        3. 7.3.4.3  SPI 通信喪失
        4. 7.3.4.4  SPI 通信エラー
          1. 7.3.4.4.1 リセット タイマー
          2. 7.3.4.4.2 チップ セレクト (CS) リセット
          3. 7.3.4.4.3 CRC 誤差
          4. 7.3.4.4.4 レジスタ書き込みエラー
        5. 7.3.4.5  CCSI 通信喪失
          1. 7.3.4.5.1 SIN 固着診断
        6. 7.3.4.6  CCSI 通信エラー
          1. 7.3.4.6.1 CHECK ビット エラー
          2. 7.3.4.6.2 データ整合性診断
          3. 7.3.4.6.3 CCSI コマンド キュー オーバーフロー
        7. 7.3.4.7  FIFO 診断
          1. 7.3.4.7.1 TXFIFO オーバーフロー
          2. 7.3.4.7.2 TXFIFO アンダーフロー
          3. 7.3.4.7.3 TXFIFO シングル エラー検出 (SED)
          4. 7.3.4.7.4 RXFIFO オーバーフロー
          5. 7.3.4.7.5 RXFIFO アンダーフロー
          6. 7.3.4.7.6 RXFIFO シングル エラー検出 (SED)
        8. 7.3.4.8  OTP CRC エラー
        9. 7.3.4.9  フォルト マスク
        10. 7.3.4.10 診断表
    4. 7.4 デバイスの機能モード
      1. 7.4.1 電源なし
      2. 7.4.2 初期化状態
      3. 7.4.3 NORMAL 状態
      4. 7.4.4 FAILSAFE 状態
    5. 7.5 プログラミング
      1. 7.5.1 SPI データの有効性
      2. 7.5.2 チップ セレクト (CS) および SPI リセット制御
      3. 7.5.3 SPI コマンド フォーマット
      4. 7.5.4 SPI コマンドの詳細
  9. 8 デバイスのレジスタ
  10. 9 アプリケーションと実装
    1. 9.1 アプリケーション情報
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 設計要件
      2. 9.2.2 詳細な設計手順
        1. 9.2.2.1 プログラミング手順
      3. 9.2.3 アプリケーション曲線
    3. 9.3 電源に関する推奨事項
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 ドキュメントの更新通知を受け取る方法
    2. 10.2 サポート・リソース
    3. 10.3 商標
    4. 10.4 静電気放電に関する注意事項
    5. 10.5 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報
    1. 12.1 テープおよびリール情報
    2. 12.2 メカニカル データ

3 説明

LP5899 SPI 互換接続機能を使うと、標準 SPI コントローラを使用して、LP589x デバイス ファミリを制御できます。本デバイスには、LP589x デバイス ファミリが必要とする連続クロックを生成するための内部発振器が備わっています。EMI 耐性を強化するため、連続クロックにジッタを付加できます。送信データは、CCSI インターフェイスのタイミング要件を維持するため、連続クロックに合わせて調整されます。

LP5899 には、LP589x のデイジーチェーンと LP5899 内部の両方のフォルトの報告機能が内蔵されています。レジスタと VSYNC コマンドの、LP589xデイジーチェーンへのデータ転送は、LP5899 によって CRC 保護されます。また、データ ラインは固着障害に対して LP5899 によって保護されます。

パッケージ情報
部品番号 パッケージ (1) パッケージ サイズ(2)
LP5899 DYY (SOT-23-THN、14) 4.2mm × 3.26mm
DRR (WSON, 12) 3mm × 3mm
(1) 詳細については、セクション 12 を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
LP5899 代表的なアプリケーションの図代表的なアプリケーションの図