JAJSOV2R April   1998  – March 2023 SN74LV165A

PRODMIX  

  1. 1 特長
  2. 2 アプリケーション
  3. 3 説明
  4. 4 Revision History
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1  Absolute Maximum Ratings
    2. 6.2  ESD Ratings
    3. 6.3  Recommended Operating Conditions
    4. 6.4  Thermal Information
    5. 6.5  Electrical Characteristics
    6. 6.6  Timing Requirements, VCC = 2.5 V ± 0.2 V
    7. 6.7  Timing Requirements, VCC = 3.3 V ± 0.3 V
    8. 6.8  Timing Requirements, VCC = 5 V ± 0.5 V
    9. 6.9  Switching Characteristics, VCC = 2.5 V ± 0.2 V
    10. 6.10 Switching Characteristics, VCC = 3.3 V ± 0.3 V
    11. 6.11 Switching Characteristics,VCC = 5 V ± 0.5 V
    12. 6.12 Timing Diagrams
    13. 6.13 Operating Characteristics
    14. 6.14 Typical Characteristics
  7. 7 Parameter Measurement Information
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 Balanced CMOS Push-Pull Outputs
      2. 8.3.2 Latching Logic
      3. 8.3.3 Partial Power Down (Ioff)
      4. 8.3.4 Clamp Diode Structure
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Power Considerations
      2. 9.2.2 Input Considerations
      3. 9.2.3 Output Considerations
      4. 9.2.4 Detailed Design Procedure
      5. 9.2.5 Application Curve
    3. 9.3 Power Supply Recommendations
    4. 9.4 Layout
      1. 9.4.1 Layout Guidelines
      2. 9.4.2 Layout Example
  10. 10Device and Documentation Support
    1. 10.1 Documentation Support
      1. 10.1.1 Related Documentation
    2. 10.2 Receiving Notification of Documentation Updates
    3. 10.3 サポート・リソース
    4. 10.4 Trademarks
    5. 10.5 静電気放電に関する注意事項
    6. 10.6 用語集
  11. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 説明

SN74LV165A デバイス は、2V～5.5V の VCCで動作するように設計された、パラレル・ロード (並列読み込み) 8 ビット・シフト・レジスタです。

デバイスにクロックが供給されると、データはシリアル出力 Q H にシフトされます。各段のパラレル入力へのアクセスは、8 つの個別の直接データ入力によって提供されます。これらのデータ入力は、シフト / ロード (SH/LD) 入力が Low レベルのときイネーブルになります。LV165A デバイス は、クロック禁止機能と、反転したシリアル出力 QH を備えています。

このデバイスは、Ioff を使った部分的パワーダウン・アプリケーション用の動作が完全に規定されています。Ioff 回路が出力をディスエーブルにするので、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。

パッケージ情報(1)
部品番号 パッケージ 本体サイズ (公称)
SN74LV165A D (SOIC、16) 9.90mm × 3.90mm
DB (SSOP、16) 6.20mm × 5.30mm
NS (SO、16) 10.20mm × 5.30mm
PW (TSSOP、16) 5.00mm × 4.40mm
DGV (TVSOP、16) 3.60mm × 4.40mm
RGY (VQFN、16) 4.00mm × 3.50mm
BQB (WQFN、16) 3.60mm × 2.60mm
(1) 利用可能なすべてのパッケージについては、このデータシートの末尾にある注文情報を参照してください。
GUID-20210218-CA0I-X1MX-NFLV-2M5MCVCRVZZD-low.gif論理図 (正論理)