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CD4504B

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Sensor de nivel de tensión hexadecimal CMOS para funcionamiento TTL a CMOS o CMOS a CMOS

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CD4504B

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Detalles del producto

Bits (#) 6 Data rate (max) (Mbps) 24 Direction control (typ) Fixed-direction Vin (min) (V) 5 Vin (max) (V) 18 Vout (min) (V) 5 Vout (max) (V) 18 Applications GPIO Features High-voltage Prop delay (ns) 280 Technology family CD4000 Supply current (max) (mA) 5 Rating Catalog Operating temperature range (°C) -55 to 125
Bits (#) 6 Data rate (max) (Mbps) 24 Direction control (typ) Fixed-direction Vin (min) (V) 5 Vin (max) (V) 18 Vout (min) (V) 5 Vout (max) (V) 18 Applications GPIO Features High-voltage Prop delay (ns) 280 Technology family CD4000 Supply current (max) (mA) 5 Rating Catalog Operating temperature range (°C) -55 to 125
SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) TSSOP (PW) 16 32 mm² (5 mm × 6.4 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm)
  • Independence of power-supply sequence considerations - VCC can exceed VDD; input signals can exceed both VCC and VDD
  • Up and down level-shifting capability
  • Shiftable input threshold for either CMOS or TTL compatibility
  • Standardized symmetrical output characteristics
  • 100% tested for quiescent current @ 20 V
  • Maximum input current of 1 µA at 18 V over full package-temperature range; 100 nA at 18 V and 25°C
  • 5V, 10 V, and 15 V parametric ratings
  • Meets all requirements of JEDEC Standard No. 13B, "Standard Specifications for Description of ’B’ Series CMOS Devices"

Data sheet acquired from Harris Semiconductor.
  • Independence of power-supply sequence considerations - VCC can exceed VDD; input signals can exceed both VCC and VDD
  • Up and down level-shifting capability
  • Shiftable input threshold for either CMOS or TTL compatibility
  • Standardized symmetrical output characteristics
  • 100% tested for quiescent current @ 20 V
  • Maximum input current of 1 µA at 18 V over full package-temperature range; 100 nA at 18 V and 25°C
  • 5V, 10 V, and 15 V parametric ratings
  • Meets all requirements of JEDEC Standard No. 13B, "Standard Specifications for Description of ’B’ Series CMOS Devices"

Data sheet acquired from Harris Semiconductor.

CD4504B hex voltage level-shifter consists of six circuits which shift input signals from the VCC logic level to the VDD logic level. To shift TTL signals to CMOS logic levels, the SELECT input is at the VCC HIGH logic state. When the SELECT input is a LOW logic state, each circuit translates signals from one CMOS level to another.

The CD4504B types are supplied in 16-lead hermetic dual-in-line ceramic packages (F3A suffix), 16-lead dual-in-line plastic packages (E suffix), 16-lead small-outline packages (M, M96, and MT suffixes), and 16-lead thin shrink small-outline packages (PW and PWR suffixes).

CD4504B hex voltage level-shifter consists of six circuits which shift input signals from the VCC logic level to the VDD logic level. To shift TTL signals to CMOS logic levels, the SELECT input is at the VCC HIGH logic state. When the SELECT input is a LOW logic state, each circuit translates signals from one CMOS level to another.

The CD4504B types are supplied in 16-lead hermetic dual-in-line ceramic packages (F3A suffix), 16-lead dual-in-line plastic packages (E suffix), 16-lead small-outline packages (M, M96, and MT suffixes), and 16-lead thin shrink small-outline packages (PW and PWR suffixes).
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Documentación técnica

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* Hoja de datos CD4504B TYPES datasheet (Rev. D) 9/11/2004
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14-24-LOGIC-EVM — Módulo de evaluación genérico de productos lógicos para encapsulados D, DB, DGV, DW, DYY, NS y PW de

El módulo de evaluación (EVM) 14-24-LOGIC-EVM está diseñado para admitir cualquier dispositivo lógico que se encuentre en un encapsulado D, DW, DB, NS, PW, DYY o DGV de 14 a 24 pines.

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Límite:
??asset.out-of-stock-ti_es_MX??
No disponible
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TSSOP (PW) 16 Ultra Librarian
PDIP (N) 16 Ultra Librarian
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