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CD74AC174

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Biestables tipo D hexagonales con Reset

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CD74AC174

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Detalles del producto

Number of channels 6 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 95 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 6 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 95 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) WQFN (BQB) 16 8.75 mm² (3.5 mm × 2.5 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm) TSSOP (PW) 16 32 mm² (5 mm × 6.4 mm)
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Contains six flip-flops with single-rail outputs
  • Buffered inputs
  • Speed of Bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current
    • Fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Contains six flip-flops with single-rail outputs
  • Buffered inputs
  • Speed of Bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current
    • Fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design

The CD74AC174 is a positive-edge-triggered D-type flip-flop with a direct clear (CLR) input and is designed for 1.5V to 5.5V VCC operation.

The CD74AC174 is a positive-edge-triggered D-type flip-flop with a direct clear (CLR) input and is designed for 1.5V to 5.5V VCC operation.
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Documentación técnica

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* Hoja de datos CD74AC174 Hex D-type Flip-Flop with Clear datasheet (Rev. C) PDF | HTML 1/10/2024
Nota sobre la aplicación Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 15/12/2022

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

14-24-LOGIC-EVM — Módulo de evaluación genérico de productos lógicos para encapsulados D, DB, DGV, DW, DYY, NS y PW de

El módulo de evaluación (EVM) 14-24-LOGIC-EVM está diseñado para admitir cualquier dispositivo lógico que se encuentre en un encapsulado D, DW, DB, NS, PW, DYY o DGV de 14 a 24 pines.

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Productos y hardware compatibles
En inventario
Límite:
??asset.out-of-stock-ti_es_MX??
No disponible
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
SOIC (D) 16 Ultra Librarian
WQFN (BQB) 16 Ultra Librarian
PDIP (N) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
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