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Latches tipo D

SN54HC373-DIE

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Bloqueo octal transparente de tipo D con salidas de 3 estados

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SN54HC373-DIE

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Detalles del producto

Number of channels 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Operating temperature range (°C) 25 to 25 Rating Space
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DIESALE (TD) — See data sheet
  • Wide Operating Voltage Range
  • High-Current 3-State True Outputs Can
    Drive Up To 15 LSTTL Loads
  • Low Power Consumption
  • Typical tpd = 13 ns
  • Low Input Current
  • Full Parallel Access for Loading
  • Wide Operating Voltage Range
  • High-Current 3-State True Outputs Can
    Drive Up To 15 LSTTL Loads
  • Low Power Consumption
  • Typical tpd = 13 ns
  • Low Input Current
  • Full Parallel Access for Loading

This 8-bit latch features 3-state outputs designed specifically for driving highly capacitive or relatively low-impedance loads. It is particularly suitable for implementing buffer registers, I/O ports, bidirectional bus drivers, and working registers.

The eight latches of the SN54HC373-DIE are transparent D-type latches. While the latch-enable (LE) input is high, the Q outputs follow the data (D) inputs. When LE is taken low, the Q outputs are latched at the levels that were set up at the D inputs.

This 8-bit latch features 3-state outputs designed specifically for driving highly capacitive or relatively low-impedance loads. It is particularly suitable for implementing buffer registers, I/O ports, bidirectional bus drivers, and working registers.

The eight latches of the SN54HC373-DIE are transparent D-type latches. While the latch-enable (LE) input is high, the Q outputs follow the data (D) inputs. When LE is taken low, the Q outputs are latched at the levels that were set up at the D inputs.
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Documentación técnica

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Tipo Título Fecha
* Data sheet Octal Transparent D-Type Latch With 3-State Outputs, SN54HC373-DIE datasheet 10 may 2013
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Application note Designing With Logic (Rev. C) 01 jun 1997
Application note Input and Output Characteristics of Digital Integrated Circuits 01 oct 1996
Application note Live Insertion 01 oct 1996
Application note SN54/74HCT CMOS Logic Family Applications and Restrictions 01 may 1996
Application note Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 01 abr 1996

Diseño y desarrollo

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DIESALE (TD) —
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Soporte y capacitación

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