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SN74HC175

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Biestables de tipo D cuádruples con opción de eliminación

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SN74HC175

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Detalles del producto

Number of channels 4 Technology family HC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 28 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 80 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -40 to 85 Rating Catalog
Number of channels 4 Technology family HC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 28 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 80 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -40 to 85 Rating Catalog
PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm) TSSOP (PW) 16 32 mm² (5 mm × 6.4 mm) SSOP (DB) 16 48.36 mm² (6.2 mm × 7.8 mm) SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) SOP (NS) 16 79.56 mm² (10.2 mm × 7.8 mm)
  • Wide operating voltage range of 2 V to 6 V
  • Outputs can drive up to 10 LSTTL Loads
  • Low power consumption, 80-µA max ICC
  • Contain four flip-flops with double-rail outputs
  • Typical tpd = 13 ns
  • ±4-mA output drive at 5 V
  • Low input current of 1 µA max
  • Wide operating voltage range of 2 V to 6 V
  • Outputs can drive up to 10 LSTTL Loads
  • Low power consumption, 80-µA max ICC
  • Contain four flip-flops with double-rail outputs
  • Typical tpd = 13 ns
  • ±4-mA output drive at 5 V
  • Low input current of 1 µA max

These positive-edge-triggered D-type flip-flops have a direct clear (CLR) input. The ’HC175 devices feature complementary outputs from each flip-flop.

These positive-edge-triggered D-type flip-flops have a direct clear (CLR) input. The ’HC175 devices feature complementary outputs from each flip-flop.
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Documentación técnica

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Documentación principal Tipo Título Opciones de formato Descargar la versión más reciente en inglés Fecha
* Hoja de datos SNx4HC175 Quadruple D-Type Flip-Flops With Clear datasheet (Rev. F) PDF | HTML 24/06/2022
Application brief Using Linear Interpolation to Estimate Specification Values PDF | HTML 13/04/2026
Nota sobre la aplicación Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 15/12/2022

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

14-24-LOGIC-EVM — Módulo de evaluación genérico de productos lógicos para encapsulados D, DB, DGV, DW, DYY, NS y PW de

El módulo de evaluación (EVM) 14-24-LOGIC-EVM está diseñado para admitir cualquier dispositivo lógico que se encuentre en un encapsulado D, DW, DB, NS, PW, DYY o DGV de 14 a 24 pines.

Guía del usuario: PDF | HTML
Productos y hardware compatibles
En inventario
Límite:
??asset.out-of-stock-ti_es_MX??
No disponible
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
PDIP (N) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
SSOP (DB) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian
SOP (NS) 16 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

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