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CD74HC147

現行

高速 CMOS 邏輯 10 至 4 線優先級編碼器

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產品規格表

CD74HC147

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產品詳細資料

Technology family HC Function Encoder Configuration 10:4 Number of channels 1 Operating temperature range (°C) -55 to 125 Rating Catalog
Technology family HC Function Encoder Configuration 10:4 Number of channels 1 Operating temperature range (°C) -55 to 125 Rating Catalog
PDIP (N) 16 181.42 mm² 19.3 x 9.4 SOIC (D) 16 59.4 mm² 9.9 x 6 TSSOP (PW) 16 32 mm² 5 x 6.4
  • Buffered inputs and outputs
  • Typical propagation delay: 13ns at VCC = 5V, CL = 15pF, TA = 25oC
  • Fanout (over temperature range)
    • Bus driver outputs: 15 LSTTL loads
  • Wide operating temperature range: -55oC to 125oC
  • Balanced propagation delay and transition times
  • Significant power reduction compared to LSTTL logic ICs
  • HC types
    • 2V to 6V Operation
    • High noise immunity: NIL = 30%, NIH = 30% of VCC at VCC = 5V
  • HCT types
    • 4.5V to 5.5V Operation
    • Direct LSTTL input logic compatibility, VIL= 0.8V (Max), VIH = 2V (Min)
    • CMOS input compatibility, Il ≤ 1µA at VOL, VOH
  • Buffered inputs and outputs
  • Typical propagation delay: 13ns at VCC = 5V, CL = 15pF, TA = 25oC
  • Fanout (over temperature range)
    • Bus driver outputs: 15 LSTTL loads
  • Wide operating temperature range: -55oC to 125oC
  • Balanced propagation delay and transition times
  • Significant power reduction compared to LSTTL logic ICs
  • HC types
    • 2V to 6V Operation
    • High noise immunity: NIL = 30%, NIH = 30% of VCC at VCC = 5V
  • HCT types
    • 4.5V to 5.5V Operation
    • Direct LSTTL input logic compatibility, VIL= 0.8V (Max), VIH = 2V (Min)
    • CMOS input compatibility, Il ≤ 1µA at VOL, VOH

The CDx4HC147 and CD74HCT147 are 9-input priority encoders. These devices provide the 10-line to 4-line priority encoding function by use of the implied decimal “zero.”

The CDx4HC147 and CD74HCT147 are 9-input priority encoders. These devices provide the 10-line to 4-line priority encoding function by use of the implied decimal “zero.”
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類型 標題 日期
* Data sheet CDx4HC147, CD74HCT147 High-Speed CMOS Logic 10- to 4-Line Priority Encoder datasheet (Rev. G) PDF | HTML 2025年 1月 13日
Application note Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
Selection guide Logic Guide (Rev. AB) 2017年 6月 12日
Application note Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
User guide LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
Application note Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
User guide Signal Switch Data Book (Rev. A) 2003年 11月 14日
Application note TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
Application note CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
Application note Designing With Logic (Rev. C) 1997年 6月 1日
Application note Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
Application note Live Insertion 1996年 10月 1日
Application note SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
Application note Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計與開發

如需其他條款或必要資源，請按一下下方的任何標題以檢視詳細頁面 (如有)。

開發板

14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組

14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。

使用指南: PDF | HTML
TI.com 無法提供
封裝 針腳 CAD 符號、佔位空間與 3D 模型
PDIP (N) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

內含資訊：
  • RoHS
  • REACH
  • 產品標記
  • 鉛塗層/球物料
  • MSL 等級/回焊峰值
  • MTBF/FIT 估算值
  • 材料內容
  • 認證摘要
  • 進行中持續性的可靠性監測
內含資訊：
  • 晶圓廠位置
  • 組裝地點

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

以英文檢視所有論壇主題

內容係由 TI 和社群貢獻者依「現狀」提供，且不構成 TI 規範。檢視使用條款。

若有關於品質、封裝或訂購 TI 產品的問題，請參閱 TI 支援。​​​​​​​​​​​​​​

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