TIDA-01050

18비트 SAR 데이터 컨버터를 위해 최적화된 아날로그 프론트 엔드 DAQ 시스템 레퍼런스 디자인

TIDA-01050

설계 파일

개요

TIDA-01050 레퍼런스 설계는 일반적으로 자동 테스트 장비와 관련된 통합, 전력 소비, 성능 및 클로킹 문제를 개선하는 것을 목표로 합니다. 이 설계는 모든 ATE 시스템에 적용되지만 대부분 많은 수의 입력 채널이 필요한 시스템에 적용됩니다.

특징
  • 음극 레일 입력(NRI), RRO(레일 투 레일 출력)
  • 넓은 출력 공통 모드 제어 범위
  • 낮은 소비 전력
  • 높은 THD, SNR 및 ENOB
  • 시스템 성능을 극대화하는 AFE의 이중 전원 공급 장치
다운로드 스크립트와 함께 비디오 보기 비디오

완조립 보드는 테스팅과 성능 검증을 위해서만 개발되었으며 판매를 위한 것이 아닙니다.

설계 파일 및 제품

설계 파일

바로 사용 가능한 시스템 파일을 다운로드하여 설계 프로세스에 속도를 높여 보십시오.

TIDUCF5A.PDF (5892 KB)

레퍼런스 디자인 개요 및 검증된 성능 테스트 데이터

TIDRP97.PDF (3863 KB)

구성 요소 배치를 위한 설계 레이아웃의 세부 개요

TIDRP96.PDF (248 KB)

설계 구성요소, 참조 지정자 및 제조업체/부품 번호의 전체 목록

TIDRP99.ZIP (2442 KB)

IC 부품의 3D 모델 또는 2D 도면에 사용되는 파일

TIDCD14.ZIP (1181 KB)

설계 PCB의 물리적 보드 계층에 대한 정보를 포함하는 설계 파일

TIDRP98.PDF (7144 KB)

PCB 설계 레이아웃 생성에 사용되는 PCB 레이어 플롯 파일

TIDRP95.PDF (2572 KB)

설계 레이아웃 및 구성 요소에 대한 회로도 다이어그램

제품

TI 제품을 설계 및 잠재적 대안에 포함합니다.

벅 모듈(통합 인덕터)

LMZ14202SIMPLE SWITCHER® 6V~42V, 2A 전원 모듈(리드형 SMT-TO 패키지)

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벅 모듈(통합 인덕터)

LMZ14203리드 표면 실장 TO 패키지의 SIMPLE SWITCHER® 6V~42V, 3A 전원 모듈

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AC/DC 및 DC/DC 컨버터(통합 FET)

LM7705저잡음 음극 바이어스 생성기

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D형 플립플롭

SN74AUP1G80저전력 단일 양극 에지 트리거 D형 플립플롭

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정밀 연산 증폭기(Vos<1mV)

OPA376정밀(0.025mV), 저잡음(7.5nV/rtHz), 낮은 정동작 전류(760uA) 연산 증폭기

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정밀 연산 증폭기(Vos<1mV)

OPA827저잡음, 고정밀, JFET 입력 연산 증폭기

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선형 및 저손실(LDO) 레귤레이터

TPS7A3001-EP향상된 제품, 네거티브 VIN, 200mA, 초저잡음, 높은 PSRR, LDO 레귤레이터

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오실레이터

LMK61E2의료 영상, 테스트 및 측정용 초저 지터, EEPROM 프로그래머블 오실레이터

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고속 연산 증폭기(GBW ≥ 50MHz)

OPA625전력 스케일링을 지원하는 고대역폭, 고정밀, 저잡음 및 저왜곡 증폭기 SAR ADC 드라이버

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완전 차동 증폭기

THS4551저잡음, 정밀, 150MHz, 완전 차동 증폭기

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인버팅 버퍼 및 드라이버

SN74AHC1G04단일 2V~5.5V 인버터

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벅 모듈(통합 인덕터)

LMZ14201리드 표면 실장 TO 패키지의 SIMPLE SWITCHER® 6V~42V, 1A 전원 모듈

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정밀 ADC

ADS8910B내부 VREF 버퍼, 내부 LDO 및 향상된 SPI 인터페이스를 갖춘 18비트, 1MSPS, 1채널 SAR ADC

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클록 버퍼

LMK00804B낮은 스큐, 1~4 멀티플렉스 차동/LVCMOS-LVCMOS/TTL 팬아웃 버퍼

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AC/DC 및 DC/DC 컨버터(통합 FET)

LM557475V, 0.5A 스텝다운 스위칭 레귤레이터

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직렬 전압 레퍼런스

REF6041통합 버퍼 및 활성화 핀을 갖춘 4.096V, 5ppm/°C 고정밀 전압 레퍼런스

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선형 및 저손실(LDO) 레귤레이터

TPS7A47활성화를 지원하는 1A, 36V, 저잡음, 높은 PSRR, 저손실 전압 레귤레이터

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기술 자료

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1개 모두 보기
유형 직함 최신 영어 버전 다운로드 날짜
* 설계 가이드 Optimized Analog Front-End DAQ System Ref Design for 18-Bit SAR Data Converters (Rev. A) 2016. 3. 17

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지원 및 교육

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포럼 주제 모두 보기(영문)

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