JAJSNZ0D May 2023 – August 2024 UCC21550-Q1
PRODUCTION DATA
デバイスごとのパッケージ図は、PDF版データシートをご参照ください。
UCC21550-Q1 の入力ピン (INA、INB、DIS) は、TTL および CMOS 互換の入力スレッショルド ロジックに基づいており、VDD 電源電圧から完全に絶縁されています。UCC21550-Q1 は、標準の High スレッシュルド (VINAH) が 2.0V、標準の Low スレッショルドが 1V で、ロジック レベルの制御信号 (3.3V マイコンからの信号など) で入力ピンを簡単に駆動できます。1V という広いヒステリシス (VINA_HYS) は良好なノイズ耐性と安定動作に役立ちます。いずれの入力をオープンのままにしても、内部プルダウン抵抗がピンを Low に強制します。これらの抵抗の標準値は 90kΩ です (セクション 7.2 を参照)。ただし、入力を使用しない場合はグランドに接続することをお勧めします。
UCC21550-Q1 の入力側は出力ドライバから分離されているため、選択されたゲートに対して最も効率のよい VDD を選択できます。INA または INB に印加される信号の振幅は、VCCI の電圧を上回ってはいけません。