TPD2E1B06
- Provides System Level ESD Protection for Low
Voltage IO Interface - IEC 61000-4-2 Level 4 ESD Rating
- Low IO Capacitance: 0.85 pF (Typical)
- DC Breakdown Voltage: 7 V (Minimum)
- Ultra-Low Leakage Current: 10 nA (Maximum)
- Low ESD Clamping Voltage
- Temperature Range: –40°C to 125°C
- Small Easy-to-Route DRL package
The TPD2E1B06 device is a dual-channel, ultra-low capacitance ESD protection device. It offers ±10-KV IEC contact ESD protection. Its 1-pF line capacitance makes it suitable for a wide range of applications. Typical application interfaces are USB 2.0, LVDS, and I2C. The TPD2E1B06 device has two common layout methods, and both are highlighted in Layout.
기술 문서
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모두 보기11 | 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | TPD2E1B06 Dual-Channel High-Speed ESD Protection Device datasheet (Rev. D) | PDF | HTML | 2016/04/27 |
| Application note | ESD and Surge Protection for USB Interfaces (Rev. B) | PDF | HTML | 2024/01/11 | |
| User guide | Reading and Understanding an ESD Protection Data Sheet (Rev. A) | PDF | HTML | 2023/09/19 | |
| Application note | Capacitance Requirements for High Speed Signals (Rev. A) | PDF | HTML | 2023/08/21 | |
| Selection guide | System-Level ESD Protection Guide (Rev. D) | 2022/09/07 | ||
| Application note | ESD Packaging and Layout Guide (Rev. B) | PDF | HTML | 2022/08/18 | |
| Application note | ESD Protection Layout Guide (Rev. A) | PDF | HTML | 2022/04/07 | |
| User guide | Generic ESD Evaluation Module User's Guide (Rev. A) | PDF | HTML | 2021/09/27 | |
| White paper | Designing USB for short-to-battery tolerance in automotive environments | 2016/02/10 | ||
| EVM User's guide | HVL054 User's Guide | 2013/08/12 | ||
| Analog Design Journal | Design Considerations for System-Level ESD Circuit Protection | 2012/09/25 |
설계 및 개발
추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.
평가 보드
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<p>The electrostatic-sensitive device (ESD) evaluation module (EVM) is a development platform for most of our ESD portfolio. The board comes with all traditional ESD footprints in order to test any number of devices. Devices can be soldered onto their respect footprint and then tested.</p>
(...)
시뮬레이션 툴
PSPICE-FOR-TI — TI 설계 및 시뮬레이션 툴용 PSpice®
TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.
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| 패키지 | 핀 | 다운로드 |
|---|---|---|
| SOT-5X3 (DRL) | 6 | 옵션 보기 |
주문 및 품질
포함된 정보:
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
포함된 정보:
- 팹 위치
- 조립 위치
권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.