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SN74LV6T07-EP

Name: SN74LV6T07-EP
Brand: TI
SKU: SN74LV6T07-EP
Price: 2.25 USD

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Enhanced-product six-bit open-drain fixed-direction level translator

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document-pdfAcrobat SN74LV6T07-EP Hex Open-Drain Buffers with Integrated Translation datasheet (Englisch) PDF | HTML

SN74LV6T07-EP

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Produktdetails

Technology family

LVxT

High input voltage (min) (V)

High input voltage (max) (V)

5.5

Vout (min) (V)

1.65

Vout (max) (V)

5.5

IOH (max) (mA)

-8

IOL (max) (mA)

Features

Over-voltage tolerant inputs, Single supply

Input type

Standard CMOS, TTL-Compatible CMOS

Output type

Balanced CMOS, Open drain

Rating

HiRel Enhanced Product

Operating temperature range (°C)

-55 to 125

Technology family

LVxT

High input voltage (min) (V)

High input voltage (max) (V)

5.5

Vout (min) (V)

1.65

Vout (max) (V)

5.5

IOH (max) (mA)

-8

IOL (max) (mA)

Features

Over-voltage tolerant inputs, Single supply

Input type

Standard CMOS, TTL-Compatible CMOS

Output type

Balanced CMOS, Open drain

Rating

HiRel Enhanced Product

Operating temperature range (°C)

-55 to 125

TSSOP (PW)

32 mm² 5 x 6.4

Wide operating range of 1.65V to 5.5V
5.5V tolerant input pins
LVxT enhanced inputs combined with open-drain outputs provide maximum voltage translation flexibility:
- Over 6.67Mbps operation, (RPU = 1kΩ,CL = 30pF)
- Up translation from 1.2V to 5V with 1.8V supply
- Down translation from 5V to 0.8V or even less with any valid supply
Supports standard function pinout
Latch-up performance exceeds 250mAper JESD 17

Wide operating range of 1.65V to 5.5V
5.5V tolerant input pins
LVxT enhanced inputs combined with open-drain outputs provide maximum voltage translation flexibility:
- Over 6.67Mbps operation, (RPU = 1kΩ,CL = 30pF)
- Up translation from 1.2V to 5V with 1.8V supply
- Down translation from 5V to 0.8V or even less with any valid supply
Supports standard function pinout
Latch-up performance exceeds 250mAper JESD 17

The SN74LV6T07-EP device contains six independent buffers with open-drain outputs. Each buffer performs the Boolean function Y = A in positive logic.

The input is designed with a lower threshold circuit to support up translation for lower voltage CMOS inputs (for example, 1.2V input to 1.8V output or 1.8V input to 3.3V output). In addition, the 5-V tolerant input pins enable down translation (for example, 3.3V to 2.5V output).

The SN74LV6T07-EP device contains six independent buffers with open-drain outputs. Each buffer performs the Boolean function Y = A in positive logic.

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	Typ	Titel		Datum
*	Data sheet	SN74LV6T07-EP Hex Open-Drain Buffers with Integrated Translation datasheet	PDF \| HTML	22 Jan 2024
	Application note	Understanding Transient Drive Strength vs. DC Drive Strength in CMOS Output Buffers	PDF \| HTML	14 Mai 2024

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML