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SN74LV1T08

ACTIVO

Puerta AND POSITIVA de 2 entradas, con fuente de alimentación única y selector de nivel lógico

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SN74LV1T08

ACTIVO
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Detalles del producto

Technology family LV1T Number of channels 1 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) 8 Supply current (max) (µA) 10 Features Over-voltage tolerant inputs, Single supply, Voltage translation Input type TTL-Compatible CMOS Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 125
Technology family LV1T Number of channels 1 Vout (min) (V) 1.65 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) 8 Supply current (max) (µA) 10 Features Over-voltage tolerant inputs, Single supply, Voltage translation Input type TTL-Compatible CMOS Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 125
SOT-23 (DBV) 5 8.12 mm² (2.9 mm × 2.8 mm) SOT-SC70 (DCK) 5 4.2 mm² (2 mm × 2.1 mm)
  • Single-supply voltage translator at 5.0V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8mA Output Drive at 5V
    • 7mA Output Drive at 3.3V
    • 3mA Output Drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5V tolerance on input pins
  • –40°C to 125°C operating temperature range
  • Pb-free packages available: SC-70 (DCK)
    • 2 × 2.1 × 0.65mm (height 1.1mm)
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)Refer to the VIH/VIL and output drive for lower VCC condition.
  • Single-supply voltage translator at 5.0V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8mA Output Drive at 5V
    • 7mA Output Drive at 3.3V
    • 3mA Output Drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5V tolerance on input pins
  • –40°C to 125°C operating temperature range
  • Pb-free packages available: SC-70 (DCK)
    • 2 × 2.1 × 0.65mm (height 1.1mm)
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)Refer to the VIH/VIL and output drive for lower VCC condition.

The SN74LV1T08 is a single 2-input AND gate with reduced input thresholds to support voltage translation applications.

The SN74LV1T08 is a single 2-input AND gate with reduced input thresholds to support voltage translation applications.

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Documentación técnica

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* Hoja de datos SN74LV1T08 Single Power Supply 2-Input Positive AND Gate CMOS Logic Level Shifter datasheet (Rev. F) PDF | HTML 6/10/2025
Guía de selección Logic Guide (Rev. AC) PDF | HTML 13/11/2025
Nota sobre la aplicación LV1T Family of single supply translators (Rev. B) PDF | HTML 16/12/2022
Guía de selección Voltage Translation Buying Guide (Rev. A) 15/04/2021
Nota sobre la aplicación Voltage Translation Between 3.3-V, 2.5-V, 1.8-V, and 1.5-V Logic Standards (Rev. B) 30/04/2015
Nota sobre la aplicación Selecting the Right Level Translation Solution (Rev. A) 22/06/2004

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Placa de evaluación

5-8-LOGIC-EVM — Módulo de evaluación de lógico genérico para encapsulados DCK, DCT, DCU, DRL y DBV,de 5- a 8-pines

EVM flexible diseñado para admitir cualquier dispositivo que tenga un encapsulado DCK, DCT, DCU, DRL o DBV y entre 5 y 8 pines.
Guía del usuario: PDF
Productos y hardware compatibles
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??asset.out-of-stock-ti_es_MX??
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Modelo de simulación

SN74LV1T08 Behavioral SPICE Model

SCLM184.ZIP (7 KB) - Modelo PSpice
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Modelo de simulación

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