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SN74LVC1G80

ACTIVO

Biestable único de tipo D con activación de borde positivo

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SN74LVC1G80

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Detalles del producto

Number of channels 1 Technology family LVC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 150 IOL (max) (mA) 32 IOH (max) (mA) -32 Supply current (max) (µA) 10 Features Balanced outputs, Over-voltage tolerant inputs Operating temperature range (°C) -40 to 125 Rating Catalog
Number of channels 1 Technology family LVC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 150 IOL (max) (mA) 32 IOH (max) (mA) -32 Supply current (max) (µA) 10 Features Balanced outputs, Over-voltage tolerant inputs Operating temperature range (°C) -40 to 125 Rating Catalog
SOT-SC70 (DCK) 5 4.2 mm² (2 mm × 2.1 mm) DSBGA (YZP) 5 2.1875 mm² (— mm × — mm) SOT-23 (DBV) 5 8.12 mm² (2.9 mm × 2.8 mm)
  • Available in the Texas Instruments NanoFree™ package
  • Latch-up performance exceeds 100mA per JESD 78, Class II
  • Supports 5V VCC operation
  • Inputs accept voltages to 5.5V
  • Supports down translation to VCC
  • Maximum tpd of 4.2ns at 3.3V
  • Low power consumption, 10µA maximum ICC
  • ±24mA output drive at 3.3V
  • Ioff supports partial-power-down mode and back-drive protection
  • Latch-up performance exceeds 100mA per JESD 78, Class II
  • Available in the Texas Instruments NanoFree™ package
  • Latch-up performance exceeds 100mA per JESD 78, Class II
  • Supports 5V VCC operation
  • Inputs accept voltages to 5.5V
  • Supports down translation to VCC
  • Maximum tpd of 4.2ns at 3.3V
  • Low power consumption, 10µA maximum ICC
  • ±24mA output drive at 3.3V
  • Ioff supports partial-power-down mode and back-drive protection
  • Latch-up performance exceeds 100mA per JESD 78, Class II

The SN74LVC1G80 device is a single positive-edge-triggered D-type flip-flop that is designed for 1.65V to 5.5V VCC operation.

When data at the data (D) input meets the setup time requirement, the data is transferred to the Q output on the positive-going edge of the clock pulse. Clock triggering occurs at a voltage level and is not directly related to the rise time of the clock pulse. Following the hold-time interval, data at the D input can be changed without affecting the level at the output.

NanoFree™ package technology is a major breakthrough in IC packaging concepts, using the die as the package.

This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs when the device is powered down. This inhibits current backflow into the device which prevents damage to the device.

The SN74LVC1G80 device is a single positive-edge-triggered D-type flip-flop that is designed for 1.65V to 5.5V VCC operation.

When data at the data (D) input meets the setup time requirement, the data is transferred to the Q output on the positive-going edge of the clock pulse. Clock triggering occurs at a voltage level and is not directly related to the rise time of the clock pulse. Following the hold-time interval, data at the D input can be changed without affecting the level at the output.

NanoFree™ package technology is a major breakthrough in IC packaging concepts, using the die as the package.

This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs when the device is powered down. This inhibits current backflow into the device which prevents damage to the device.

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Documentación técnica

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* Hoja de datos SN74LVC1G80 Single Positive-Edge-Triggered D-Type Flip-Flop datasheet (Rev. T) PDF | HTML 13/08/2026
Nota sobre la aplicación Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 15/12/2022

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

5-8-LOGIC-EVM — Módulo de evaluación de lógico genérico para encapsulados DCK, DCT, DCU, DRL y DBV,de 5- a 8-pines

EVM flexible diseñado para admitir cualquier dispositivo que tenga un encapsulado DCK, DCT, DCU, DRL o DBV y entre 5 y 8 pines.
Guía del usuario: PDF
Productos y hardware compatibles
En inventario
Límite:
??asset.out-of-stock-ti_es_MX??
No disponible
Modelo de simulación

HSPICE MODEL OF SN74LVC1G80

SCEJ237.ZIP (86 KB) - Modelo HSpice
Productos y hardware compatibles
Modelo de simulación

SN74LVC1G80 Behavioral SPICE Model

SCEM782.ZIP (3 KB) - Modelo PSpice
Productos y hardware compatibles
Modelo de simulación

SN74LVC1G80 IBIS Model (Rev. B)

SCEM185A (244 KB) - Modelo IBIS
Productos y hardware compatibles
Diseño de referencia

TIDA-00602 — Diseño de referencia del controlador del cepillo dental eléctrico

This reference design uses our low-voltage H-Bridge motor driver with an integrated low dropout (LDO) voltage regulator and an ultra-low-power microcontroller (MCU) to demonstrate a full implementation of a battery-powered electric toothbrush.

Productos y hardware compatibles
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
SOT-SC70 (DCK) 5 Ultra Librarian
DSBGA (YZP) 5 Ultra Librarian
SOT-23 (DBV) 5 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

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