CD74HC42
- Buffered Inputs and Outputs
- Typical Propagation Delay: 12ns at VCC = 5V, CL = 15pF, TA = 25°C
- Fanout (Over Temperature Range)
- Standard Outputs . . . . . . . . . . . . . . . 10 LSTTL Loads
- Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads
- Wide Operating Temperature Range . . . -55°C to 125°C
- Balanced Propagation Delay and Transition Times
- Significant Power Reduction Compared to LSTTL Logic ICs
- HC Types
- 2V to 6V Operation
- High Noise Immunity: NIL = 30%, NIH = 30% of VCC at VCC = 5V
- HCT Types
- 4.5V to 5.5V Operation
- Direct LSTTL Input Logic Compatibility, VIL = 0.8V (Max), VIH = 2V (Min)
- CMOS Input Compatibility, Il 1µA at VOL, VOH
The HC42 and CD74HCT42 BCD-to-Decimal Decoders utilize silicon-gate CMOS technology to achieve operating speeds similar to LSTTL decoders with the low power consumption of standard CMOS integrated circuits. These devices have the capability of driving 10 LSTLL loads and are compatible with the standard LS logic family. One of ten outputs (low on select) is selected in accordance with the BCD input. Non-valid BCD inputs result in none of the outputs being selected (all outputs are high).
技術資料
設計と開発
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TMAG5110-5111EVM は、デュアル・ホール・ラッチを搭載したロータリー・エンコーディング・ボードです。これらのラッチは、直交型に対応する個別の回路 (TMAG5110)、または速度と方向に対応する個別の回路 (TMAG5111) という両方の実装を採用しています。2 個の異なる磁気素子と、2 箇所の磁気素子配置場所オプションを用意してあるので、極とピッチの独立性、および磁気素子の配置場所の独立性に関するデュアル・ラッチの能力に注目することができます。
パッケージ | ピン数 | ダウンロード |
---|---|---|
PDIP (N) | 16 | オプションの表示 |
SOIC (D) | 16 | オプションの表示 |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点