CD74HCT4094
- バッファ付き入力
- カスケード接続のため、正と負のクロック・エッジに同期する個別のシリアル出力
- ファンアウト (全温度範囲にわたって)
- 標準出力：10 個の LSTTL 負荷
- バス・ドライバ出力：15 個の LSTTL 負荷
- 広い動作電圧範囲：−55℃～125°C
- 平衡のとれた伝搬遅延と遷移時間
- LSTTL ロジック IC に比べて消費電力を大幅削減
- HC タイプ
- 2V～6V で動作
- 優れたノイズ耐性：VCCに対して NIL = 30%、NIH = 30% (VCC = 5V 時)
- HCT タイプ
- 4.5V～5.5V で動作
- LSTTL 入力ロジックと直接互換、 VIL = 0.8V (最大値)、VIH = 2V (最小値)
- CMOS 入力互換、VOL、VOH で II ≤ 1µA
CDx4HC4094 および CD74HCT4094 は、8 段のシリアル・シフト・レジスタで、シリアル入力からパラレル・バッファ付きトライステート出力へのストローブ・データ用として各段にストレージ・ラッチを備えています。パラレル出力は、共通のバス・ラインに直接接続できます。正のクロック遷移時にデータがシフトされます。シフト・レジスタの各ステージのデータは、ストローブ入力が HIGH のときにストレージ・レジスタへ転送されます。ストレージ・レジスタのデータは、出力イネーブル信号が HIGH のとき、常に出力に現れます。
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技術資料
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| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | CDx4HC4094、CD74HCT4094 高速 CMOS ロジック 8 段シフトおよびストア・バス・レジスタ、 3 ステート データシート (Rev. F 翻訳版) | PDF | HTML | 英語版 (Rev.F) | PDF | HTML | 2022/05/11 |
| アプリケーション・ノート | Power-Up Behavior of Clocked Devices (Rev. B) | PDF | HTML | 2022/12/15 |
設計と開発
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評価ボード
14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板
14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。
在庫あり
制限：
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入手不可
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| SOIC (D) | 16 | Ultra Librarian |
| PDIP (N) | 16 | Ultra Librarian |