データシート
SN74CBTLV3251
- 2 つのポート間を 5Ω スイッチで接続
- データI/Oポートのレール ツー レール スイッチング
- Ioff により部分的パワーダウン モード動作をサポート
- JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
SN74CBTLV3251 は、8 入力から 1 つを選択する高速 FET マルチプレクサ / デマルチプレクサです。スイッチの ON 状態の抵抗が低いため、最小の伝播遅延で接続が可能です。選択入力 (S0、S1、S2) によって、データの流れが制御されます。出力イネーブル (OE) 入力が High になると、FET マルチプレクサ / デマルチプレクサは無効化されます。このデバイスは、Ioff を使用する部分的パワーダウン アプリケーション用に完全に動作が規定されています。Ioff 機能は、デバイスの電源がオフになっているときに、損傷を引き起こす可能性のある電流がデバイスを通じて逆流しないように設計されています。デバイスは、電源オフ時は絶縁されています。電源投入または電源切断時に高インピーダンス状態を確保するため、OE はプルアップ抵抗経由で VCC に結線する必要があります。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。
技術資料
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| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | SN74CBLTV3251 低電圧 8 入力 1 選択 FET マルチプレクサ / デマルチプレクサ | PDF | HTML | PDF | HTML | 2026/07/23 | |
| アプリケーション・ノート | テキサス インスツルメンツの信号スイッチの選定 | PDF | HTML | PDF | HTML | 2026/06/29 | ||
| アプリケーション・ノート | Multiplexers and Signal Switches Glossary (Rev. B) | PDF | HTML | 2021/12/01 | |||
| アプリケーション概要 | Eliminate Power Sequencing with Powered-off Protection Signal Switches (Rev. C) | PDF | HTML | 2021/01/06 |
設計と開発
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インターフェイス・アダプタ
LEADED-ADAPTER1 — TI の 5、8、10、16、24 ピン リード付きパッケージの迅速なテスト向けの表面実装から DIP ヘッダへのアダプタ
EVM-LEADED1 ボードは、TI の一般的なリード付きパッケージによる迅速なテストとブレッド ボードへの対応を可能にします。 TI の D、DBQ、DCT、DCU、DDF、DGS、DGV、PW 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントを用意しています。
ユーザー ガイド:
PDF
在庫あり
制限：
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入手不可
インターフェイス・アダプタ
LEADLESS-ADAPTER1 — TI の 6、8、10、12、14、16、20 ピン リードレス パッケージのテスト向けの表面実装から DIP ヘッダへのアダプタ
EVM-LEADLESS1 ボードは、TI の一般的なリードレス パッケージによる迅速なテストとブレッド ボードへの対応を可能にします。 このボードには、TI の DRC、DTP、DQE、RBW、RGY、RSE、RSV、RSW RTE、RTJ、RUK、RUC、RUG、RUM、RUT、YZP 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントが用意されています。
ユーザー ガイド:
PDF
在庫あり
制限：
??asset.out-of-stock-ti_ja_JP??
入手不可
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RGY) | 16 | Ultra Librarian |
| TSSOP (PW) | 16 | Ultra Librarian |
| SOIC (D) | 16 | Ultra Librarian |
| TVSOP (DGV) | 16 | Ultra Librarian |
| SSOP (DBQ) | 16 | Ultra Librarian |
購入と品質
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。