製品詳細

Technology Family HC Supply voltage (Min) (V) 2 Supply voltage (Max) (V) 6 Number of channels (#) 4 Inputs per channel 2 IOL (Max) (mA) 5.2 IOH (Max) (mA) 0 Input type Standard CMOS Output type Open-Drain Features High speed (tpd 10- 50ns) Data rate (Max) (Mbps) 28 Rating Catalog
Technology Family HC Supply voltage (Min) (V) 2 Supply voltage (Max) (V) 6 Number of channels (#) 4 Inputs per channel 2 IOL (Max) (mA) 5.2 IOH (Max) (mA) 0 Input type Standard CMOS Output type Open-Drain Features High speed (tpd 10- 50ns) Data rate (Max) (Mbps) 28 Rating Catalog
PDIP (N) 14 181 mm² 19.3 x 9.4 SOIC (D) 14 52 mm² 8.65 x 6 SOP (NS) 14 80 mm² 10.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4
  • Wide Operating Voltage Range: 2 V to 6 V
  • Outputs Can Drive Up To 10 LSTTL Loads
  • Low Power Consumption, 20-µA Maximum ICC
  • Typical tpd = 8 ns at 5 V
  • ±4-mA Output Drive at 5 V
  • Low Input Current of 1 µA
  • Wide Operating Voltage Range: 2 V to 6 V
  • Outputs Can Drive Up To 10 LSTTL Loads
  • Low Power Consumption, 20-µA Maximum ICC
  • Typical tpd = 8 ns at 5 V
  • ±4-mA Output Drive at 5 V
  • Low Input Current of 1 µA

This device contains four independent 2-input NAND Gates with open-drain outputs. Each gate performs the Boolean function Y = A ● B in positive logic.

This device contains four independent 2-input NAND Gates with open-drain outputs. Each gate performs the Boolean function Y = A ● B in positive logic.

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SNx4HC03 Quadruple 2-Input NAND Gates with Open-Drain Outputs データシート (Rev. F) PDF | HTML 2021年 4月 30日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
セレクション・ガイド Logic Guide (Rev. AB) 2017年 6月 12日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新の英語版をダウンロード (Rev.AB) 2014年 11月 6日
ユーザー・ガイド LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
ユーザー・ガイド Signal Switch Data Book (Rev. A) 2003年 11月 14日
その他の技術資料 Logic Cross-Reference (Rev. A) 2003年 10月 7日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Designing With Logic (Rev. C) 1997年 6月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計および開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの PW、DB、D、DW、NS、DYY、DGV パッケージをサポートする汎用ロジックの評価基板 (EVM)

この評価基板 (EVM) は、ピン数が 14 ~ 24 の D、DW、DB、NS、PW、DYY、DGV の各パッケージをサポートする設計を採用しています。

ユーザー・ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

SN74HC03 Behavioral SPICE Model

SCLM233.ZIP (6 KB) - PSpice Model
リファレンス・デザイン

TIDM-SERVODRIVE — 工業用サーボ・ドライブおよびAC インバータ・ドライブ、リファレンス・デザイン

DesignDRIVE 開発キットは、3 相 ACI または PMSM モーターに直接接続する包括的な産業用ドライブ向けのリファレンス・デザインです。この単一のプラットフォームに採用されている制御、駆動、通信技術の組み合わせにより、多くのドライブ・トポロジーを作成できます。複数の位置センサ・インターフェイス、多様な電流センシング技術、ホットサイド・パーティションのオプション、安全性および産業用イーサネットに対応する拡張性などを特長としています。
設計ガイド: PDF
回路図: PDF
リファレンス・デザイン

TIDM-MINI-DC — インフラ・コストを削減する小型 AMI ネットワーク向けデータ・コンセントレータのリファレンス・デザイン

The TIDM-MINI-DC reference design implements a light-weight powerline communication (PLC) data concentrator (DC) solution integrated with an Ethernet repeater feature. A power grid network is static, which means that once end-nodes are installed the number of nodes to be supported by a DC is (...)
設計ガイド: PDF
回路図: PDF
パッケージ ピン数 ダウンロード
PDIP (N) 14 オプションの表示
SO (NS) 14 オプションの表示
SOIC (D) 14 オプションの表示
TSSOP (PW) 14 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating / リフローピーク温度
  • MTBF/FIT 推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

サポートとトレーニング

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