CD74HC564
- Buffered inputs
- Common three-state output-enable control
- Three-state outputs
- Bus line driving capability
- Typical propagation delay = 13 ns at VCC = 5 V, CL = 15 pF, TA = 25℃ (clock to output)
- Fanout (over temperature range)
- Standard outputs: 10 LSTTL loads
- Bus driver outputs: 15 LSTTL loads
- Wide operating temperature range: –55℃ to 125℃
- Balanced propagation delay and transition times
- Significant power reduction compared to LSTTL Logic ICs
- HC types
- 2 V to 6 V operation
- High noise immunity: NIL = 30%, NIH = 30% of VCC at VCC = 5 V
- HCT types
- 4.5 V to 5.5 V operation
- Direct LSTTL input logic compatibility, VIL = 0.8 V (max), VIH = 2 V (min)
- CMOS input compatibility, II ≤ 1 µA at VOL, VOH
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開發板
14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組
14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。
封裝 | 針腳 | CAD 符號、佔位空間與 3D 模型 |
---|---|---|
PDIP (N) | 20 | Ultra Librarian |
SOIC (DW) | 20 | Ultra Librarian |
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