SN74LV541A
- Operation of 2-V to 5.5-V V CC
- Max t pd of 6 ns at 5 V
- Typical V OLP (output ground bounce) < 0.8 V at V CC = 3.3 V, T A = 25°C
- Typical V OHV (output V OH undershoot) > 2.3 V at V CC = 3.3 V, T A = 25°C
- Support mixed-mode voltage operation on all ports
- I off supports partial-power-down mode operation
- Latch-up performance exceeds 250 mA per JESD 17
The SN74LV541A device is an octal buffer/driver designed for 2-V to 5.5-V V CC operation.
技術文件
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檢視所有 6 | 類型 | 標題 | 日期 | ||
|---|---|---|---|---|
| * | Data sheet | SN74LV541A Octal Buffers/Drivers With 3-State Outputs datasheet (Rev. N) | PDF | HTML | 2023年 8月 2日 |
| Test report | TI Power Reference Design for Xilinx(R) Virtex(R)-7 (VC709) (Rev. A) | 2014年 12月 16日 | ||
| User guide | TI Power Reference Design for Xilinx® Zynq 7000 (ZC702) (Rev. A) | 2014年 12月 16日 | ||
| Test report | PMP7977 Test Results (Rev. A) | 2014年 6月 11日 | ||
| Test report | TI Power Reference Design for Xilinx® Artix®-7 (AC701) | 2014年 5月 12日 | ||
| User guide | PMP7977 User's Guide | 2013年 9月 11日 |
設計與開發
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開發板
14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組
14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。
開發板
14-24-NL-LOGIC-EVM — 適用於 14 針腳至 24 針腳無引線封裝的邏輯產品通用評估模組
14-24-NL-LOGIC-EVM 是一款靈活的評估模組 (EVM)，設計用途可支援任何具有 14 針腳至 24 針腳 BQA、BQB、RGY、RSV、RJW 或 RHL 封裝的邏輯或轉換裝置。
參考設計
PMP7977 — 具有 PMBus 電源管理的 Xilinx Artix 7 FPGA 參考設計
The Artix 7 power management reference design board uses power modules, linear regulators, and a PMBus compliant system controller to supply all required core and auxiliary voltages needed by the FPGA, including DDR memory termination. A Digital Power graphical user interface is used to monitor the (...)
| 封裝 | 引腳 | 下載 |
|---|---|---|
| SOIC (DW) | 20 | 檢視選項 |
| SOP (NS) | 20 | 檢視選項 |
| SSOP (DB) | 20 | 檢視選項 |
| TSSOP (PW) | 20 | 檢視選項 |
| VQFN (RGY) | 20 | 檢視選項 |
| VQFN (RKS) | 20 | 檢視選項 |
| VSSOP (DGS) | 20 | 檢視選項 |
訂購與品質
內含資訊：
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- 鉛塗層/球物料
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