計算工具
TPS50601A-SP
- 5962-10221:
- Radiation hardened up to TID 100 krad(Si)
- ELDRS free 100 krad(Si) – 10 mrad(Si)/s
- Single lhup (SEL) Immune to
LET = 75 MeV-cm2/mg - SEB and SEGR immune to 75 MeV-cm2/mg, SOA Curve Available
- SET/SEFI Cross-section plot available
- peak efficiency: 96.6% (VO = 3.3 V)
- Integrated 58-mΩ/50-mΩ MOSFETs
- Power rail: 3 to 7 V on VIN
- 6-A Maximum output current
- Flexible switching frequency options:
- 100-kHz to 1-MHz Adjustable internal oscillator
- External sync capability: 100 kHz to 1 MHz
- Sync pin can be configured as a 500-kHz output for master/slave applications
- 0.804-V ±1.5% Voltage reference overtemperature, radiation, and line and load regulation
- Monotonic start-up into prebiased outputs
- Adjustable soft start through external capacitor
- Input enable and power-good output for power sequencing
- Power good output monitor for undervoltage and overvoltage
- Adjustable input undervoltage lockout (UVLO)
- 20-Pin Ultra-small, thermally-enhanced ceramic flatpack package (hkh) for space applications
The TPS50601A-SP is a radiation hardened, 7-V, 6-A synchronous step-down converter, which is optimized for small designs through high efficiency and integrating the high-side and low-side MOSFETs. Further space savings are achieved through current mode control, which reduces component count, and a high switching frequency, reducing the inductor’s footprint. The devices are offered in an ultra small, thermally enhanced 20-pin ceramic flatpack package.
The output voltage startup ramp is controlled by the SS/TR pin which allows operation as either a stand alone power supply or in tracking situations. Power sequencing is also possible by correctly configuring the enable and the open drain power good pins. In addition, the TPS50601A-SP can be configured in master-slave mode to provide up to 12-A of output current.
Cycle-by-cycle current limiting on the high-side FET protects the device in overload situations and is enhanced by a low-side sourcing current limit which prevents current runaway. There is also a low-side sinking current limit which turns off the low-side MOSFET to prevent excessive reverse current. Thermal shutdown disables the part when die temperature exceeds thermal shutdown temperature.
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開發板
ADC12DJ3200EVMCVAL — ADC12DJ3200QML-SP 評估模組
ADC12DJ3200 評估模組 (EVM) 專為評估 ADC12DJ3200QML-SP 高速類比轉數位轉換器 (ADC) 所設計。本 EVM 搭載 ADC12DJ3200QML-SP 晶片，該晶片為航太等級、具備 JESD204B 介面的 12 位元、雙通道 4GSPS 或單通道 8GSPS ADC。
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開發板
TPS50601ASPEVM-D — TPS50601A-SP 雙路運作評估模組
TPS50601A-SP 是一款抗輻射、7-V、6-A 同步降壓轉換器，具備高效率並整合高壓側與低壓側 MOSFET，最適合小型設計。 本裝置以超小型熱增強型 20 接腳陶瓷雙列直插扁平封裝，可提供最佳電氣與輻射性能。
此雙版本電路板可評估總輸出電流為 12A 之主-從配置裝置。
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開發板
TPS50601ASPEVM-S — TPS50601A-SP 單運作評估模組
TPS50601A-SP 是一款抗輻射、6.3V、6A 同步降壓轉換器，透過整合高低壓側 MOSFET 及高效率設計，使其成為小型設計的絕佳選擇。透過電流模式控制與高切換頻率設計，不僅降低元件數量，更能縮小電感器的體積，進一步節省空間。本裝置採用熱增強型 20 針腳陶瓷雙列直插扁平封裝。
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開發板
TSW12D1620EVM-CVAL — ADC12D1620QML-SP 評估模組，適用 300-krad、12 位元、雙 1.6-GSPS 或單 3.2-GSPS ADC
TSW12D1620EVM-CVAL 是 1.5 GHz 寬頻接收器評估模組 (EVM) ，其中包括放大器、類比轉數位轉換器 (ADC) 、時脈、溫度感測器、微控制器和電源解決方案的陶瓷工程模型。此電路板最適合將近 DC 的 IF/RF 頻率數位化至 1.5 GHz。
類比輸入路徑可選擇將 6.5 GHz LMH5401-SP 做為單端至差動增益區塊，或繞過放大器並以差動訊號驅動 ADC。該放大器後接 12 位元、雙 1.6-GSPS 或單 3.2-GSPS ADC12D1620QML-SP。這些高效能元件皆有必要的電源、微控制器和溫度感測器裝置支援。
TSW12D1620EVM-CVAL (...)
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開發套件
ALPHA-XILINX-KU060-SPACE — 附帶 TI 電源且適用於 Xilinx® Kintex® UltraScale™ XQRKU060 FPGA 的 Alpha Data® 主機板
This is a development kit for the Xilinx® XQRKU060 FPGA with industrial -1 speed grade. ADA-SDEV-KIT2 has a modular board design with a XRTC-compatible configuration module, two FMC connectors, DDR3 DRAM, system monitoring, and space-grade TI power management and temperature-sensing solutions.
Third-party accessory
STARD-3P-STAR-TIGER — 使用 TI 抗輻射電源和類比 IC 之 SpaceFiber 適用的 STAR-Dundee STAR-Tiger 電源供應器
STAR-Tiger 是一款高性能的 SpaceFiber 路由交換機，屬於歐盟高端專案的一部分，是歐洲太空論壇創新太空獎的得獎產品。STAR-Tiger 裝置中的電源供應電路板，爲用於運作路由交換機的 Xilinx KU060 FPGA 提供主要電源軌。STAR-Tiger 電源供應電路板使用德州儀器的輻射硬化電源供應裝置，展示用於太空船高性能運算和連網的穩健供電。
模擬型號
TPS50601A-SP TINA-TI Startup Transient Reference Design
SLVMCN2.TSC (855 KB) - TINA-TI Reference Design
模擬型號
TPS50601A-SP TINA-TI Steady State Transient Reference Design
SLVMCN1.TSC (855 KB) - TINA-TI Reference Design
模擬型號
TPS50601A-SP Worst Case Analysis Unencrypted PSpice Average Model
SLVMDC2.ZIP (43 KB) - PSpice Model
參考設計
TIDA-010191 — 航太級多通道 JESD204B 15-GHz 時脈參考設計
相位陣列天線和數位波束成形技術，是提高未來航太雷達成像和寬頻衛星通訊系統的性能的關鍵技術。數位波束成形與類比波束成形不同，通常每個天線元件需要一套資料轉換器。這些轉換器需要具有具體定義相位關係的時鐘。此參考設計展示如何透過已定義及可調整相位關係，產生低雜訊 MHz 至 GHz 時脈訊號。在發生單一事件後，甚至可能恢復時脈階段。透過操作兩個 ADC12DJ3200QML-SP 評估模組，及在 3.2 GHz 時其對應之 FPGA 架構擷取平台，以及 10-ps 板對板偏斜的情況，藉此來展示 JESD204B 支援。
Design guide: PDF
參考設計
TIDA-070001 — 具有 OCP 冗餘 eFuse 輸入的 3 至 7 VIN 航太級負載點 (POL) 參考設計
冗餘通常用於航太器應用中以增強可靠性，此參考設計展示了如何使用兩個 TPS7H2201-SP 輻射強化 eFuse 負載開關在負載點 (POL) 電源的輸入處進行冗餘實作。使用兩個負載開關可為輻射強化 POL 降壓式轉換器 TPS50601A-SP 提供一次側冗餘電壓，負載開關提供可調整過電流保護 (OCP) 限制以進行保護，同時電流感測輸出針腳可實現監控和保護功能，另外，負載開關還具有可調整過電壓保護 (OVP)。POL 轉換器還具有電流限制，可提供額外短路保護功能。
參考設計
TIDA-070005 — 3 至 7 VIN、24-A 輸出、0.95-VOUT、航太級電流共享負載點 (POL) 參考設計
這是一款 24-A DC/DC 航太級電源硬體參考設計。
隨著 FPGA 和 ASIC 技術的進步，核心電壓需求會降低，但電流需求會增加。最新航太級 FPGA 和 ASIC 需要低電壓和高電流來滿足其核心功耗要求。這些高電流需求推動了對航太級 DC/DC 功率轉換電路的需求。
| 封裝 | 針腳 | CAD 符號、佔位空間與 3D 模型 |
|---|---|---|
| CFP (HKH) | 20 | Ultra Librarian |
| DIESALE (KGD) | — |
訂購與品質
內含資訊：
- RoHS
- REACH
- 產品標記
- 鉛塗層/球物料
- MSL 等級/回焊峰值
- MTBF/FIT 估算值
- 材料內容
- 認證摘要
- 進行中持續性的可靠性監測
內含資訊：
- 晶圓廠位置
- 組裝地點
建議產品可能具有與此 TI 產品相關的參數、評估模組或參考設計。