Fester Schalter für Datenzentrum

Produkte und Referenzdesigns

Blockschaltbild

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Unsere integrierten Schaltkreise und Referenzdesigns unterstützen Sie bei der Entwicklung von Schaltern für Rechenzentren mit extrem hoher Bandbreite und geringem Stromverbrauch. Verwenden Sie das untenstehende interaktive Referenzdiagramm zum Entwickeln eines Hochgeschwindigkeits-Ethernet-Schalters mit den richtigen Schnittstellen-, PHY- (physischen Schnittstellenbaustein-) und Energiemanagement-Produkten, um die Konnektivitätsanforderungen moderner Ethernet-Schalterstrukturen zu erfüllen.

Designs für moderne Schalter im Datenzentrum erfordern:

Hocheffiziente Stromversorgungslösungen für FPGAs, ASICs und CPUs der neuesten Generation.
Klassenbeste Signalintegrität für ständig steigende Datenraten.
Reduzierte Systemausfallzeiten durch Erkennung und Vermeidung von schädlichen Zuständen.

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Typ	Titel		Datum
Anwendungshinweis	Optimizing Network Switch Designs with Common Logic Use Cases (Rev. A)	PDF \| HTML	01.04.2021
Technischer Artikel	Are you ready for BAW?	PDF \| HTML	27.02.2019
Anwendungshinweis	Understanding clocking needs for high-speed 56G PAM-4 serial links (Rev. A)		22.02.2019
Anwendungshinweis	Supported synchronization modes for TI network synchronizers (Rev. A)		22.02.2019
Anwendungshinweis	How to use the LMK05318 as a jitter cleaner		16.01.2019
Anwendungshinweis	DC/DC Point-of-load Power Solutions for Wired Networking Switch Systems		11.12.2018
Whitepaper	Internally compensated advanced current mode (ACM) (Rev. A)		07.12.2018
Anwendungshinweis	Optimizing Layout of the TPS54824 HotRod™ Package for Thermal Performance		16.11.2018
Analog Design Journal	Comparing internally-compensated advanced current mode (ACM) w/ D-CAP3™ control (Rev. A)		06.11.2018
Anwendungshinweis	Glitch free power sequencing with AXC level translators (Rev. A)		20.09.2018
Anwendungshinweis	An Overview of Bus-Hold Circuit and the Applications (Rev. B)		17.09.2018
Analog Design Journal	Understanding thermal-resistance specification of DC/DC convert. w/ MOSFETs		04.01.2018
Anwendungshinweis	Interfacing Between LVPECL, VML, CML and LVDS Levels		17.12.2002

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