Para los desarrolladores de sistemas de radar modernos que actualmente utilizan un FPGA o ASIC para conectarse a convertidores de datos de alta velocidad, que necesitan un tiempo de comercialización más rápido con un mayor rendimiento y una reducción significativa en el costo, la potencia y el tamaño, este diseño de referencia incluye el primer procesador ampliamente disponible que integra una interfaz JESD204B y procesamiento Digital Front End (DFE). La conexión al ADC14X250 y al DAC38J84 proporciona una solución eficiente para aplicaciones de aviónica y defensa, como radares, guerra electrónica, plataformas informáticas y transpondedores.
Se desarrolló una placa completamente integrada únicamente para pruebas y validación de rendimiento y no está disponible para la venta.
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Descripción general del diseño de referencia y datos de las pruebas de rendimiento verificadas
Lista completa de componentes de diseño, designadores de referencia y números de fabricantes/piezas
Archivos para modelos 3D o dibujos 2D de componentes de IC
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Diagrama esquemático detallado del diseño y los componentes
Incluye productos de TI en el diseño y posibles alternativas.
| Tipo | Título | Descargar la versión más reciente en inglés | Fecha | ||
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| * | Guía de diseño | Optimized Radar System Design Using a DSP+ARM SoC and ADC14X250 Design Guide | 8/12/2015 | ||
| Nota sobre la aplicación | 66AK2L06 JESD Attachment to ADC14X250/DAC38J84 (Rev. A) | 24/06/2016 | |||
| Informe | Optimizing Modern Radar Systems using Low- Latency, High-Performance FFT Coproce | 17/12/2015 | |||
| Product overview | 66AK2L06 SoC Product Bulletin | 15/04/2015 |
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