JAJSRD1B August   2014  – February 2024 THS4541

PRODUCTION DATA  

  1.   1
  2. 特長
  3. アプリケーション
  4. 概要
  5. デバイス比較表
  6. ピン構成および機能
  7. 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性:(Vs+) – Vs– = 5V
    6. 6.6 電気的特性:(Vs+) – Vs– = 3 V
    7. 6.7 代表的特性 (5V 単一電源)
    8. 6.8 代表的特性:3V 単一電源
    9. 6.9 代表的特性:電源電圧範囲:3V~5V
  8. パラメータ測定情報
    1. 7.1 特性評価回路の例
    2. 7.2 周波数応答の形状係数
    3. 7.3 I/O ヘッドルームに関する検討事項
    4. 7.4 出力 DC 誤差およびドリフトの計算値と、抵抗の不均衡の影響
    5. 7.5 ノイズ解析
    6. 7.6 高調波歪みに影響を与える要因
    7. 7.7 容量性負荷の駆動
    8. 7.8 熱解析
  9. 詳細説明
    1. 8.1 概要
      1. 8.1.1 用語とアプリケーションの前提条件
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1 差動 I/O
      2. 8.3.2 パワーダウン制御ピン (PD)
        1. 8.3.2.1 電源シャットダウン動作時の特長
      3. 8.3.3 入力オーバードライブ動作
    4. 8.4 デバイスの機能モード
      1. 8.4.1 シングルエンド ソースから差動出力への動作
        1. 8.4.1.1 シングルエンド入力から差動出力への変換における AC 結合信号パスの検討事項
        2. 8.4.1.2 シングルエンドから差動への変換における DC 結合入力信号パスの検討事項
        3. 8.4.1.3 FDA のシングルエンドから差動構成への変換を行うための抵抗設計式
        4. 8.4.1.4 シングルエンドから差動 FDA 構成における入力インピーダンス
      2. 8.4.2 差動入力から差動出力への動作
        1. 8.4.2.1 AC 結合された差動入力から差動出力への設計の問題
        2. 8.4.2.2 DC 結合された差動入力から差動出力への設計の問題
  10. アプリケーションと実装
    1. 9.1 アプリケーション情報
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 Designing Attenuators
        1. 9.2.1.1 設計要件
        2. 9.2.1.2 詳細な設計手順
        3. 9.2.1.3 アプリケーション曲線
      2. 9.2.2 高性能 ADC とのインターフェイス
        1. 9.2.2.1 設計要件
        2. 9.2.2.2 詳細な設計手順
        3. 9.2.2.3 アプリケーション曲線
    3. 9.3 電源に関する推奨事項
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 デバイスのサポート
      1. 10.1.1 開発サポート
        1. 10.1.1.1 TINA シミュレーション・モデルの機能
    2. 10.2 ドキュメントのサポート
      1. 10.2.1 関連資料
    3. 10.3 ドキュメントの更新通知を受け取る方法
    4. 10.4 サポート・リソース
    5. 10.5 商標
    6. 10.6 静電気放電に関する注意事項
    7. 10.7 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報

概要

THS4541 は、電圧帰還 (VFA) ベースの完全差動アンプ (FDA) で、トリムされた電源電流と入力オフセット電圧により、2V/V ゲインで 500MHz を超える小信号帯域幅を実現します。コアの差動アンプは、スルー レートが高く、高精度の入力段を備えた、わずかに非補償型の電圧帰還設計です。この設計により、特性曲線に示す 2V/V の小信号帯域幅の 500MHz ゲインが得られ、同じ回路構成で 1500V/µs のスルー レート、約 340MHz、2VPP、大信号帯域幅を実現しています。

出力はレール ツー レールに近い出力スイング (どちらの電源にも 0.2V のヘッドルーム) が得られ、デバイスの入力は正の電源に必要なヘッドルームが約 1.2V の負のレール入力となります。この負のレール入力は、DC 結合、単一電源設計で、グランド周辺のバイポーラ入力を直接サポートしています (図 7-3 を参照)。すべての FDA デバイスと同様に、出力平均電圧 (同相モード) は、別々の同相ループによって制御されます。この出力平均の目標は、Vocm の入力ピンにより設定されます。このピンはデフォルトの中間電圧付近でオープンにするか、目的の出力同相モード電圧に駆動します。THS4541 の単一 2.7V~5.4V の電源電圧範囲を使用する Vocm の範囲は、負電源よりも 0.91V 高い非常に低い値から、正電源よりも 1.1V 低い値まで拡張されており、最新の A/D コンバータ (ADC) の入力同相要件に対応しています。

パワーダウン ピン (PD) が搭載されています。PD ピンの電圧を負電源レベルにするとデバイスがオフになり、THS4541 は非常に低い無信号時電流状態になります。通常動作時は、PD ピンを High レベルにする必要があります。デバイスを無効化するときは、受動の外部抵抗を介する信号路が依然として存在することに注意してください。無効化した THS4541 に印加された入力信号は、すべての無効化した FDA デバイスと同様に、この受動抵抗パスを経由して、出力に一定のレベルで現れます。