JAJSRD1B August   2014  – February 2024 THS4541

PRODUCTION DATA  

  1.   1
  2. 特長
  3. アプリケーション
  4. 概要
  5. デバイス比較表
  6. ピン構成および機能
  7. 仕様
    1. 6.1 絶対最大定格
    2. 6.2 ESD 定格
    3. 6.3 推奨動作条件
    4. 6.4 熱に関する情報
    5. 6.5 電気的特性:(Vs+) – Vs– = 5V
    6. 6.6 電気的特性:(Vs+) – Vs– = 3 V
    7. 6.7 代表的特性 (5V 単一電源)
    8. 6.8 代表的特性:3V 単一電源
    9. 6.9 代表的特性:電源電圧範囲:3V~5V
  8. パラメータ測定情報
    1. 7.1 特性評価回路の例
    2. 7.2 周波数応答の形状係数
    3. 7.3 I/O ヘッドルームに関する検討事項
    4. 7.4 出力 DC 誤差およびドリフトの計算値と、抵抗の不均衡の影響
    5. 7.5 ノイズ解析
    6. 7.6 高調波歪みに影響を与える要因
    7. 7.7 容量性負荷の駆動
    8. 7.8 熱解析
  9. 詳細説明
    1. 8.1 概要
      1. 8.1.1 用語とアプリケーションの前提条件
    2. 8.2 機能ブロック図
    3. 8.3 機能説明
      1. 8.3.1 差動 I/O
      2. 8.3.2 パワーダウン制御ピン (PD)
        1. 8.3.2.1 電源シャットダウン動作時の特長
      3. 8.3.3 入力オーバードライブ動作
    4. 8.4 デバイスの機能モード
      1. 8.4.1 シングルエンド ソースから差動出力への動作
        1. 8.4.1.1 シングルエンド入力から差動出力への変換における AC 結合信号パスの検討事項
        2. 8.4.1.2 シングルエンドから差動への変換における DC 結合入力信号パスの検討事項
        3. 8.4.1.3 FDA のシングルエンドから差動構成への変換を行うための抵抗設計式
        4. 8.4.1.4 シングルエンドから差動 FDA 構成における入力インピーダンス
      2. 8.4.2 差動入力から差動出力への動作
        1. 8.4.2.1 AC 結合された差動入力から差動出力への設計の問題
        2. 8.4.2.2 DC 結合された差動入力から差動出力への設計の問題
  10. アプリケーションと実装
    1. 9.1 アプリケーション情報
    2. 9.2 代表的なアプリケーション
      1. 9.2.1 Designing Attenuators
        1. 9.2.1.1 設計要件
        2. 9.2.1.2 詳細な設計手順
        3. 9.2.1.3 アプリケーション曲線
      2. 9.2.2 高性能 ADC とのインターフェイス
        1. 9.2.2.1 設計要件
        2. 9.2.2.2 詳細な設計手順
        3. 9.2.2.3 アプリケーション曲線
    3. 9.3 電源に関する推奨事項
    4. 9.4 レイアウト
      1. 9.4.1 レイアウトのガイドライン
      2. 9.4.2 レイアウト例
  11. 10デバイスおよびドキュメントのサポート
    1. 10.1 デバイスのサポート
      1. 10.1.1 開発サポート
        1. 10.1.1.1 TINA シミュレーション・モデルの機能
    2. 10.2 ドキュメントのサポート
      1. 10.2.1 関連資料
    3. 10.3 ドキュメントの更新通知を受け取る方法
    4. 10.4 サポート・リソース
    5. 10.5 商標
    6. 10.6 静電気放電に関する注意事項
    7. 10.7 用語集
  12. 11改訂履歴
  13. 12メカニカル、パッケージ、および注文情報

パッケージ・オプション

メカニカル・データ(パッケージ|ピン)
サーマルパッド・メカニカル・データ
発注情報

高調波歪みに影響を与える要因

掃引周波数の高調波歪みプロットに示すように、THS4541 では低い周波数で超低歪が発生します。一般に、FDA の出力高調波歪みは、基本周波数においてループ・ゲインで補正される出力段の開ループ直線性に大きく関連します。 図 6-16および 図 6-34 に示すように、負荷インピーダンスの合計が減少するほど (負荷目的で並列に接続した帰還抵抗素子の影響を含む)、出力段、開ループ直線性は低下し、高調波歪みが増大します。図 6-14および 図 6-32 は、出力電圧のスイングが増大するにつれて、非常に細かいスケールで、開ループ、出力段の非線形性も増大し、高調波歪みも劣化することを示しています。反対に、目標の出力電圧スイングを減少させると、歪みの項は急速に低下します。高調波歪みテストでは、2VPP を公称スイングとして使用します。この値は標準的な ADC、フルスケールの差動入力範囲を表しているためです。

図 6-18図 6-36 に、ゲインを大きくしてループ・ゲインを小さくする方法を示します。その結果、高調波歪みの項は増加します。アッテネータ設計の容量補償の利点の 1 つは (セクション 9.2.1 の標準的なアプリケーション例に記載)、ノイズ・ゲインを周波数に合わせて縮小させ、より高い周波数で許容可能な位相マージンにおけるクロスオーバーを実現できることです。この補償により、ノイズ・ゲイン・ゼロより低い周波数でループ・ゲインが高く保たれ、この帯域の歪みが改善されます。

出力ピンの電圧スイングが電源電圧のクリッピングにほぼ等しくなると、高調波歪みは急速に劣化します。出力クリッピングは絶対差動スイング、またはスイングはコモン・モード制御により電源の近くに移動可能なスイングのいずれかによって発生します。 図 6-17 および 図 6-35 にこの影響を示します。

THS4541 は極めて低い高調波歪みにおける、シングルエンド入力から差動出力への変換時に優れた処理を行います。特性評価には、公差 1% の外部抵抗を使用することで優れた結果を得られます。フィードバック分圧比のバランスが不均衡でも、歪みは直接劣化しません。セクション 7.4 に記載されているゲインでの出力においては、フィードバック比が不均衡になると、コモン・モード入力は差動モードに変換されます。