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ADC08DJ3200

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Analog-zu-Digital-Wandler (ADC), 8 Bit, zweifach 3,2 GSPS oder einzeln 6,4 GSPS, HF-Abtastung

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Datenblatt

ADC08DJ3200

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Produktdetails

Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 8 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 2800 Architecture Folding Interpolating SNR (dB) 49.4 ENOB (bit) 7.8 SFDR (dB) 69 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 3200, 6400 Resolution (Bits) 8 Number of input channels 1, 2 Interface type JESD204B Analog input BW (MHz) 8000 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 2800 Architecture Folding Interpolating SNR (dB) 49.4 ENOB (bit) 7.8 SFDR (dB) 69 Operating temperature range (°C) -40 to 85 Input buffer Yes
FCCSP (AAV) 144 100 mm² 10 x 10
  • ADC core:
    • 8-bit resolution
    • Up to 6.4 GSPS in single-channel mode
    • Up to 3.2 GSPS in dual-channel mode
  • Performance specifications (fIN = 997 MHz):
    • ENOB: 7.8 bits
    • SFDR:
      • Dual-channel mode: 67 dBFS
      • Single-channel mode: 62 dBFS
  • Buffered analog inputs with VCMI of 0 V:
    • Analog input bandwidth (–3 dB): 8.0 GHz
    • Usable input frequency range: >10 GHz
    • Full-scale input voltage (VFS, default): 0.8 VPP
    • Analog input common-mode (VICM): 0 V
  • Noiseless aperture delay (TAD) adjustment:
    • Precise sampling control: 19-fs step
    • Simplifies synchronization and interleaving
    • Temperature and voltage invariant delays
  • Easy-to-use synchronization features:
    • Automatic SYSREF timing calibration
    • Timestamp for sample marking
  • JESD204B serial data interface:
    • Supports subclass 0 and 1
    • Maximum lane rate: 12.8 Gbps
    • Up to 16 lanes allows reduced lane rate
  • Power consumption: 2.8 W
  • Power supplies: 1.1 V, 1.9 V
  • ADC core:
    • 8-bit resolution
    • Up to 6.4 GSPS in single-channel mode
    • Up to 3.2 GSPS in dual-channel mode
  • Performance specifications (fIN = 997 MHz):
    • ENOB: 7.8 bits
    • SFDR:
      • Dual-channel mode: 67 dBFS
      • Single-channel mode: 62 dBFS
  • Buffered analog inputs with VCMI of 0 V:
    • Analog input bandwidth (–3 dB): 8.0 GHz
    • Usable input frequency range: >10 GHz
    • Full-scale input voltage (VFS, default): 0.8 VPP
    • Analog input common-mode (VICM): 0 V
  • Noiseless aperture delay (TAD) adjustment:
    • Precise sampling control: 19-fs step
    • Simplifies synchronization and interleaving
    • Temperature and voltage invariant delays
  • Easy-to-use synchronization features:
    • Automatic SYSREF timing calibration
    • Timestamp for sample marking
  • JESD204B serial data interface:
    • Supports subclass 0 and 1
    • Maximum lane rate: 12.8 Gbps
    • Up to 16 lanes allows reduced lane rate
  • Power consumption: 2.8 W
  • Power supplies: 1.1 V, 1.9 V

The ADC08DJ3200 device is an RF-sampling, giga-sample, analog-to-digital converter (ADC) that can directly sample input frequencies from DC to above 10 GHz. In dual-channel mode, the ADC08DJ3200 can sample up to 3200 MSPS and up to 6400 MSPS in single-channel mode. Programmable tradeoffs in channel count (dual-channel mode) and Nyquist bandwidth (single-channel mode) allow development of flexible hardware that meets the needs of both high channel count or wide instantaneous signal bandwidth applications. Full-power input bandwidth (–3 dB) of 8.0 GHz, with usable frequencies exceeding the –3-dB point in both dual- and single-channel modes, allows direct RF sampling of L-band, S-band, C-band, and X-band for frequency agile systems.

The ADC08DJ3200 uses a high-speed JESD204B output interface with up to 16 serialized lanes and subclass-1 compliance for deterministic latency and multi-device synchronization. The serial output lanes support up to 12.8 Gbps and can be configured to trade-off bit rate and number of lanes. At 5 GSPS, only four total lanes are required running at 12.5 Gbps or 16 lanes can be used to reduce the lane rate to 3.125 Gbps. Innovative synchronization features, including noiseless aperture delay (TAD) adjustment and SYSREF windowing, simplify system design for phased array radar and MIMO communications.

The ADC08DJ3200 device is an RF-sampling, giga-sample, analog-to-digital converter (ADC) that can directly sample input frequencies from DC to above 10 GHz. In dual-channel mode, the ADC08DJ3200 can sample up to 3200 MSPS and up to 6400 MSPS in single-channel mode. Programmable tradeoffs in channel count (dual-channel mode) and Nyquist bandwidth (single-channel mode) allow development of flexible hardware that meets the needs of both high channel count or wide instantaneous signal bandwidth applications. Full-power input bandwidth (–3 dB) of 8.0 GHz, with usable frequencies exceeding the –3-dB point in both dual- and single-channel modes, allows direct RF sampling of L-band, S-band, C-band, and X-band for frequency agile systems.

The ADC08DJ3200 uses a high-speed JESD204B output interface with up to 16 serialized lanes and subclass-1 compliance for deterministic latency and multi-device synchronization. The serial output lanes support up to 12.8 Gbps and can be configured to trade-off bit rate and number of lanes. At 5 GSPS, only four total lanes are required running at 12.5 Gbps or 16 lanes can be used to reduce the lane rate to 3.125 Gbps. Innovative synchronization features, including noiseless aperture delay (TAD) adjustment and SYSREF windowing, simplify system design for phased array radar and MIMO communications.
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Technische Dokumentation

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Typ Titel Datum
* Data sheet ADC08DJ3200 6.4-GSPS Single-Channel or 3.2-GSPS Dual-Channel, 8-bit, RF-Sampling Analog-to-Digital Converter (ADC) datasheet (Rev. A) PDF | HTML 21 Feb 2019
Application notes Intel Stratix 10 GX 16-Lane RX JESD204B-ADC12DJ3200 Interoperability Reference Design 30 Mai 2018
EVM User's guide ADCxxDJxx00 Evaluation Module User's Guide (Rev. A) 09 Jan 2018

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

ADC08DJ3200EVM — ADC08DJ3200 8 Bit, Dual-3,2-GSPS oder Einzel-6,4-GSPS, RF-Abtastungs-ADC – Evaluierungsmodul

Das ADC08DJ3200-Evaluierungsmodul (EVM) ermöglicht die Evaluierung des Bausteins ADC08DJ3200. Der ADC08DJ3200 ist ein energieeffizienter doppel- oder einkanaliger 8-Bit-Analog-Digital-Wandler (ADC) mit HF-Abtastung, mit entweder 3,2 GSPS oder 6,4 GSPS, gepuffertem Analogeingang, integriertem (...)

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GUI für Evaluierungsmodul (EVM)

SLAC745 — ADC12DJxx00 GUI

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Unterstützte Produkte und Hardware

Unterstützte Produkte und Hardware

Produkte
Highspeed-ADCs (≥ 10 MSPS)
ADC08DJ3200 — Analog-zu-Digital-Wandler (ADC), 8 Bit, zweifach 3,2 GSPS oder einzeln 6,4 GSPS, HF-Abtastung ADC12DJ3200 — 12-Bit-, duale 3,2-GSPS- oder einfache 6,4-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H
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Evaluierungsplatine
ADC08DJ3200EVM — ADC08DJ3200 8 Bit, Dual-3,2-GSPS oder Einzel-6,4-GSPS, RF-Abtastungs-ADC – Evaluierungsmodul ADC12DJ2700EVM — ADC12DJ2700 – ADC mit HF-Abtastung, 12 Bit, dual 2,7 GSPS oder einzeln 5,4 GSPS – Evaluierungsmodul ADC12DJ3200EVM — ADC12DJ3200 – ADC mit HF-Abtastung, 12 Bit, dual 3,2 GSPS oder einzeln 6,4 GSPS – Evaluierungsmodul
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Simulationsmodell

ADC12DJ3200 IBIS Model

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Simulationsmodell

ADC12DJ3200 IBIS-AMI Model

SLVMC55.ZIP (5569 KB) - IBIS-AMI Model
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Berechnungstool

FREQ-DDC-FILTER-CALC — RF-Sampling Frequency Planner, Analog Filter, and DDC Excel Calculator

This Excel calculator provides system designers a way to simplify the design and debugging of direct RF-sampling receivers. It offers three functions: frequency planning, analog filtering, and decimation filter spur location.

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Unterstützte Produkte und Hardware

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Produkte
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ADC32RF80 — Zweikanal-14-Bit-3-GSPS-Doppel-DDC/Kanal-Breitbandempfänger mit HF-Abtastung und Rückkopplungs-IC ADC32RF82 — Zweikanal-14-Bit-Telekommunikationsempfänger mit 2,45 GSPS, HF-Abtastung und Rückkopplungs-IC ADC32RF83 — Zweikanal-14-Bit/3-GSPS-Breitband-Empfänger und Rückkopplungs-IC mit einem DCC/Kanal und HF-Abtastun
Highspeed-ADCs (≥ 10 MSPS)
ADC08DJ3200 — Analog-zu-Digital-Wandler (ADC), 8 Bit, zweifach 3,2 GSPS oder einzeln 6,4 GSPS, HF-Abtastung ADC12DJ2700 — 12-Bit-, duale 2,7-GSPS- oder einfache 5,4-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H ADC12DJ3200 — 12-Bit-, duale 3,2-GSPS- oder einfache 6,4-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H ADC12DJ5200RF — 12-Bit-RF-Sampling-ADC mit 5,2-Zweikanal-GSPS oder 10,4-Zweikanal-GSPS ADC12J1600 — Analog-zu-Digital-Wandler (ADC), 12-Bit, 1.6 GSPS, mit HF-Abtastung ADC12J2700 — Analog-zu-Digital-Wandler (ADC), 12-Bit, 2.7 GSPS, mit HF-Abtastung ADC12J4000 — Analog-zu-Digital-Wandler (ADC), 12-Bit, 4.0 GSPS, mit HF-Abtastung ADC31RF80 — 14-Bit, 3-GSPS, HF-Abtast-Breitbandempfänger und Feedback-IC ADC32RF42 — Zweikanaliger Analog-Digital-Wandler (ADC), 14-Bit, 1,5 GSPS, HF-Abtastung ADC32RF44 — Zweikanaliger Analog-Digital-Wandler (ADC), 14-Bit, 2,6 GSPS, HF-Abtastung ADC32RF45 — Zweikanaliger, 14-Bit, 3 GSPS Analog-Digital-Wandler (ADC) mit RF-Abtastung
HF-Abtasttransceiver
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Design guide: PDF
Schaltplan: PDF
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