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ADC12D1800RF

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12-Bit-, duale 1,8-GSPS- oder einfache 3,6-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H

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Datenblatt

ADC12D1800RF

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Produktdetails

Sample rate (max) (Msps) 1800, 3600 Resolution (Bits) 12 Number of input channels 1, 2 Interface type Parallel LVDS Analog input BW (MHz) 2700 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 4400 Architecture Folding Interpolating SNR (dB) 58.6 ENOB (bit) 9.3 SFDR (dB) 71.7 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 1800, 3600 Resolution (Bits) 12 Number of input channels 1, 2 Interface type Parallel LVDS Analog input BW (MHz) 2700 Features Ultra High Speed Rating Catalog Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 4400 Architecture Folding Interpolating SNR (dB) 58.6 ENOB (bit) 9.3 SFDR (dB) 71.7 Operating temperature range (°C) -40 to 85 Input buffer Yes
PBGA (NXA) 292 729 mm² 27 x 27
  • Excellent Noise and Linearity Up to and Above fIN = 2.7 GHz
  • Configurable to Either 3.6 GSPS Interleaved or 1800 MSPS Dual ADC
  • New DESCLKIQ Mode for High Bandwidth, High Sampling Rate Apps
  • Pin-Compatible with ADC1xD1x00, ADC12Dx00RF
  • AutoSync Feature for Multi-Chip Synchronization
  • Internally Terminated, Buffered, Differential Analog Inputs
  • Interleaved Timing Automatic and Manual Skew Adjust
  • Test Patterns at Output for System Debug
  • Time Stamp Feature to Capture External Trigger
  • Programmable Gain, Offset, and tAD Adjust
  • 1:1 Non-Demuxed or 1:2 Demuxed LVDS Outputs
  • Key Specifications
    • Resolution: 12 Bits
    • Interleaved 3.6 GSPS ADC (all typical)
      • IMD3 (Fin = 2.7GHz at -13dBFS) –62 dBc
      • IMD3 (Fin = 2.7GHz at -16dBFS) –64 dBc
      • Noise Floor Density -155.0 dBm/Hz
      • Power 4.29 W
    • Dual 1800 MSPS ADC, Fin = 498 MHz
      • ENOB 9.3 Bits (typ)
      • SNR 58.1 dB (typ)
      • SFDR 71.7 dBc (typ)
      • Power per Channel 2.15 W (typ)
  • Excellent Noise and Linearity Up to and Above fIN = 2.7 GHz
  • Configurable to Either 3.6 GSPS Interleaved or 1800 MSPS Dual ADC
  • New DESCLKIQ Mode for High Bandwidth, High Sampling Rate Apps
  • Pin-Compatible with ADC1xD1x00, ADC12Dx00RF
  • AutoSync Feature for Multi-Chip Synchronization
  • Internally Terminated, Buffered, Differential Analog Inputs
  • Interleaved Timing Automatic and Manual Skew Adjust
  • Test Patterns at Output for System Debug
  • Time Stamp Feature to Capture External Trigger
  • Programmable Gain, Offset, and tAD Adjust
  • 1:1 Non-Demuxed or 1:2 Demuxed LVDS Outputs
  • Key Specifications
    • Resolution: 12 Bits
    • Interleaved 3.6 GSPS ADC (all typical)
      • IMD3 (Fin = 2.7GHz at -13dBFS) –62 dBc
      • IMD3 (Fin = 2.7GHz at -16dBFS) –64 dBc
      • Noise Floor Density -155.0 dBm/Hz
      • Power 4.29 W
    • Dual 1800 MSPS ADC, Fin = 498 MHz
      • ENOB 9.3 Bits (typ)
      • SNR 58.1 dB (typ)
      • SFDR 71.7 dBc (typ)
      • Power per Channel 2.15 W (typ)

The 12-bit 1.8 GSPS ADC12D1800RF is an RF-sampling GSPS ADC that can directly sample input frequencies up to and above 2.7 GHz. The ADC12D1800RF augments the very large Nyquist zone of TI’s GSPS ADCs with excellent noise and linearity performance at RF frequencies, extending its usable range beyond the 3rd Nyquist zone.

The ADC12D1800RF provides a flexible LVDS interface which has multiple SPI programmable options to facilitate board design and FPGA/ASIC data capture. The LVDS outputs are compatible with IEEE 1596.3-1996 and supports programmable common mode voltage. The product is packaged in a lead-free 292-ball thermally enhanced BGA package over the rated industrial temperature range of –40°C to +85°C.

The 12-bit 1.8 GSPS ADC12D1800RF is an RF-sampling GSPS ADC that can directly sample input frequencies up to and above 2.7 GHz. The ADC12D1800RF augments the very large Nyquist zone of TI’s GSPS ADCs with excellent noise and linearity performance at RF frequencies, extending its usable range beyond the 3rd Nyquist zone.

The ADC12D1800RF provides a flexible LVDS interface which has multiple SPI programmable options to facilitate board design and FPGA/ASIC data capture. The LVDS outputs are compatible with IEEE 1596.3-1996 and supports programmable common mode voltage. The product is packaged in a lead-free 292-ball thermally enhanced BGA package over the rated industrial temperature range of –40°C to +85°C.
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Technische Dokumentation

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Alle anzeigen 12
Typ Titel Datum
* Data sheet ADC12D1800RF 12-Bit, Single 3.6 GSPS RF Sampling ADC datasheet (Rev. J) PDF | HTML 11 Nov 2014
Application note AN-2132 Synchronizing Multiple GSPS ADCs in a System: The AutoSync Feature (Rev. G) 03 Feb 2017
Application note Wide Bandwidth Receiver Implementation by Interleaving Two Giga-Sampling ADCs 07 Dez 2015
Application note Signal Chain Noise Figure Analysis 29 Okt 2014
Application note Synchronizing the Giga-Sample ADCs Interfaced with Multiple FPGAs 06 Aug 2014
Application note Maximizing SFDR Performance in the GSPS ADC: Spur Sources and Methods of Mitigat 09 Dez 2013
Application note AN-2128 ADC1xD1x00 Pin Compatibility (Rev. C) 01 Mai 2013
User guide Schematic and Layout Recommendations for the GSPS ADC 29 Apr 2013
Application note AN-2177 Using the LMH6554 as a ADC Driver (Rev. A) 26 Apr 2013
Application note From Sample Instant to Data Output: Understanding Latency in the GSPS ADC 18 Dez 2012
Product overview ADC12Dxx00RF Direct RF-Sampling ADC Family 16 Mai 2012
User guide 12-Bit, Dual 1.6/1.8 GSPS or Single 3.2/3.6 GSPS A/D Converter Ref Bd User Guide 25 Jan 2012

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

ADC-LD-BB — Verzerrungsarme ADC-Balun-Platine

One ADC-LD-BB board is included in the hardware kit with the GSPS analog-to-digital converter (ADC) reference boards. Since the analog inputs to the ADC1xDxx00RB are differential and most signal sources are single ended, these balun boards are generally used to achieve (...)

Benutzerhandbuch: PDF
Nicht verfügbar auf TI.com
Support-Software

WAVEVISION5 — WaveVision 5 Software

WaveVision 5 software is part of the WaveVision evaluation system that also includes WaveVision 5 Data Capture Board. The WaveVision 5 system is an easy-to-use data acquisition and analysis tool, designed to help users evaluate Texas Instruments' Signal Path solutions.

While WaveVision 5 software (...)

Unterstützte Produkte und Hardware

Unterstützte Produkte und Hardware

Produkte
Highspeed-ADCs (≥ 10 MSPS)
ADC08D1020 — Analog-zu-Digital-Wandler (ADC), 8 Bit, zweifach 1,0 GSPS oder einzeln 2,0 GSPS ADC08D1520 — Analog-zu-Digital-Wandler (ADC), 8 Bit, zweifach 1,5 GSPS oder einzeln 3,0 GSPS ADC10D1000 — Analog-zu-Digital-Wandler (ADC), 10 Bit, zweifach 1,0 GSPS oder einzeln 2,0 GSPS ADC10D1500 — Analog-zu-Digital-Wandler (ADC), 10 Bit, zweifach 1,5 GSPS oder einzeln 3,0 GSPS ADC10DV200 — Zweikanaliger Analog-zu-Digital-Wandler (ADC), 10 Bit, 200 MSPS ADC12D1000 — Analog-zu-Digital-Wandler (ADC), 12 Bit, zweifach 1,0 GSPS oder einzeln 2,0 GSPS ADC12D1000RF — 12-Bit-, dualer 1,0-GSPS- oder einfacher 2,0-GSPS-Analog-zu-Digital-Wandler (ADC) mit HF-Abtastung ADC12D1600 — Analog-Digital-Wandler (ADC), 12 Bit, dual 1,6 GSPS oder einzeln 3,2 GSPS ADC12D1600RF — 12-Bit-, duale 1,6-GSPS- oder einfache 3,2-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H ADC12D1800 — Analog-Digital-Wandler (ADC), 12 Bit, dual 1,8 GSPS oder einzeln 3,6 GSPS ADC12D1800RF — 12-Bit-, duale 1,8-GSPS- oder einfache 3,6-GSPS-Analog-zu-Digital-Wandler (LVDS-Schnittstelle) mit H ADC12D500RF — 12-Bit-, dualer 500-MSPS- oder einfacher 1,0-GSPS-Analog-zu-Digital-Wandler (ADC) mit HF-Abtastung ADC12D800RF — 12-Bit-, dualer 800-MSPS- oder einfacher 1,6-GSPS-Analog-zu-Digital-Wandler (ADC) mit HF-Abtastung ADC14DC080 — Zweikanaliger Analog-zu-Digital-Wandler (ADC), 14 Bit, 80 MSPS, 1,0 GHz Eingangsbandbreite ADC16DV160 — Zweikanaliger Analog-zu-Digital-Wandler (ADC), 16 Bit, 160 MSPS ADC16V130 — Analog-Digital-Wandler (ADC), 16 Bit, 130 MSPS
Hardware-Entwicklung
Evaluierungsplatine
ADC08D1520RB — Der ADC08D1520RB: 8 Bit, Dual-1,5-GSPS- oder Einzel-3,0-GSPS-A/D-Wandler – Referenzplatine ADC12D1600RB — Referenzplatine für 12-Bit-, zwei 1,6-/1,8-GSPS- oder einzelne 3,2-/3,6-GSPS-ADC ADC16DV160HFEB — ADC16DV160HFEB-Evaluierungsplatine LM98640CVAL — 2-kanaliges Analog-Frontend mit LVDS-Ausgang, 14 Bit, 40 MSPS WAVEVSN-BRD-5.1 — WaveVision 5 Datenerfassungsboard – Version 5.1
Software
Anwendungssoftware und Frameworks
WAVEVISION5 — Software zur Datenerfassung und ‑analyse
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Simulationsmodell

ADC12D1000 IBIS Model

SNAM014.ZIP (41 KB) - IBIS Model
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Simulationstool

PSPICE-FOR-TI — PSpice® für TI Design-und Simulationstool

PSpice® für TI ist eine Design- und Simulationsumgebung, welche Sie dabei unterstützt, die Funktionalität analoger Schaltungen zu evaluieren. Diese voll ausgestattete Design- und Simulationssuite verwendet eine analoge Analyse-Engine von Cadence®. PSpice für TI ist kostenlos erhältlich und (...)
Anfordern
Referenzdesigns

TIDA-00113 — Ansteuerung von GSPS-A/D-Wandlern im Ein- oder Zweikanal-Modus für Anwendungen mit großer Bandbreite

This design is intended to help the system designer in understanding tradeoffs and optimizing implementation for driving the Giga-Sample-Per-Second ADC with balun configurations for wideband applications.  The tradeoffs considered include balun construction, insertion loss, dynamic (...)
Design guide: PDF
Schaltplan: PDF
Referenzdesigns

TIDA-00479 — Optimale Taktquellen für GSPS-ADCs – Referenzdesign

The ADC12D1600RFRB reference design provides a platform to demonstrate a high speed digitizer application which incorporates clocking, power management, and signal processing. The reference design utilizes the 1.6 GSPS ADC12D1600RF device, onboard FPGA Xilinx Virtex 4, and high performance clock (...)
Design guide: PDF
Schaltplan: PDF
Referenzdesigns

TIDA-00071 — Schaltplan und Layoutempfehlungen für den Giga Sample Per Second (GSPS)-A/D-Wandler

This reference design is a guide to the schematics and layout for the system designer using a GSPS ADC in their system. Use this reference design along with the datasheet — the datasheet is always the final authority. Also, the ADC1xDxxxx(RF)RB Reference Board provides a useful reference (...)
Benutzerhandbuch: PDF
Schaltplan: PDF
Gehäuse Pins Herunterladen
PBGA (NXA) 292 Optionen anzeigen
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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  • Bausteinkennzeichnung
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Beinhaltete Information:
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