LP8764-Q1
- AEC-Q100 Qualified with the following results:
- Input voltage: 2.8 V to 5.5 V
- Device temperature grade 1: –40°C to +125°C ambient operating temperature range
- Device HBM ESD classification Level 2
- Device CDM ESD classification Level C4B
- Functional Safety-Compliant
- Developed for functional safety applications
- Documentation available to aid ISO 26262 system design up to ASIL-D
- Documentation available to aid IEC 61508 system design up to SIL-3
- Systematic capability up to ASIL-D
- Hardware integrity up to ASIL-D
- Windowed voltage and over-current monitors
- Watchdog with selectable trigger / Q&A mode
- Level or PWM error signal monitoring (ESM)
- Thermal monitoring with high temperature warning and thermal shutdown
- Bit-integrity (CRC) error detection on configuration registers and non-volatile memory
- 4 high-efficiency step-down DC/DC converters:
- Output voltage: 0.3 V to 3.34 V (0.3 V to 1.9 V for multi-phase outputs)
- Maximum output current: 5 A per phase, up to 20 A with 4-phase configuration
- Programmable output voltage slew-rate: 0.5 mV/µs to 33 mV/µs
- Switching frequency: 2.2 MHz or 4.4 MHz
- 10 configurable general purpose I/O (GPIO)
- SPMI interface for multi-PMIC synchronization
- Input overvoltage monitor (OVP) and undervoltage lockout (UVLO)
.
.
The LP8764-Q1 device is designed to meet the power management requirements of the latest processors and platforms in various safety-relevant automotive and industrial applications. The device has four step-down DC/DC converter cores, that are configurable for five different phase configurations from one 4-phase output to four 1-phase outputs. The device settings can be changed by I2C-compatible serial interface or by a SPI serial interface.
The automatic PFM/PWM (AUTO mode) operation together with the automatic phase adding and phase shedding maximizes efficiency over a wide output-current range. The LP8764-Q1 device supports remote differential voltage sensing for multiphase outputs to compensate IR drop between the regulator output and the point-of-load (POL) that improves the accuracy of the output voltage. The switching clock can be forced to PWM mode and the phases are interleaved. The switching can be synchronized to an external clock and spread-spectrum mode can be enabled to minimize the disturbances.
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기술 문서
| 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | LP8764-Q1 Four-Phase, 20-A Buck Converter With Integrated Switches datasheet | PDF | HTML | 2022/03/08 |
| * | Errata | LP8764-Q1 Silicon Revision 2.0 Errata | PDF | HTML | 2022/02/24 |
| Application note | Scalable PMIC NVM Update Guide (Rev. A) | PDF | HTML | 2023/04/28 | |
| User guide | Powering DRA821 with TPS6594-Q1 and LP8764-Q1 (Rev. A) | PDF | HTML | 2022/09/12 | |
| User guide | TPS65941120-Q1, TPS65941421Q1 and LP876411B5Q1 PMIC User Guide for J7AEP PDN0A | PDF | HTML | 2022/08/18 | |
| User guide | Scalable PMIC's GUI User’s Guide (Rev. B) | PDF | HTML | 2022/06/27 | |
| Certificate | LP8764Q1EVM-SKT EU RoHS Declaration of Conformity (DoC) | 2022/06/06 | ||
| EVM User's guide | LP8764x-Q1 Evaluation Module User's Guide (Rev. A) | PDF | HTML | 2022/02/03 | |
| User guide | TPS65941213-Q1 and LP876411B4-Q1 PMIC User Guide for J721E, PDN-1A | PDF | HTML | 2022/02/02 | |
| White paper | 오토모티브 설계 시 Jacinto™ 7 프로세서의 기능적 안전성 활용하기 | 2020/03/01 |
설계 및 개발
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| 패키지 | 핀 | 다운로드 |
|---|---|---|
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