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SN74LV08A

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Highspeed-AND-Gatter (7 ns), 4 Kanal, 2 Eingänge, 2 V bis 5,5 V

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SN74LV08A

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Produktdetails

Technology family LV-A Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 12 IOH (max) (mA) -12 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV-A Supply voltage (min) (V) 2 Supply voltage (max) (V) 5.5 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 12 IOH (max) (mA) -12 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8 SSOP (DB) 14 48.36 mm² 6.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4 TVSOP (DGV) 14 23.04 mm² 3.6 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5
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Technische Dokumentation

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Typ Titel Datum
* Data sheet SN74LV08A Quadruple 2-Input Positive-AND Gates datasheet (Rev. N) PDF | HTML 03 Sep 2025

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

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Benutzerhandbuch: PDF | HTML
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Benutzerhandbuch: PDF | HTML
Nicht verfügbar auf TI.com
Simulationsmodell

SN74LV08A Behavioral SPICE Model

SCLM190.ZIP (7 KB) - PSpice Model
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Simulationsmodell

SN74LV08A IBIS Model

SCEM122.ZIP (16 KB) - IBIS Model
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Simulationsmodell

SN74LV08A PSPICE MODEL

SCEM568.ZIP (1 KB) - PSpice Model
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Referenzdesigns

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Das Referenzdesign für einen bidirektionalen RS-485-Fanout-Hub (TIDA-01365) dokumentiert und testet ein RS-485-Fanout-Hub-Design, bei dem 1:N- und N:1-RS-485-Signale in und aus jeder Bustopologie aggregiert werden. Dieses Design verfügt auch über eine automatische Richtungssteuerung für eine (...)
Design guide: PDF
Schaltplan: PDF
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
VQFN (RGY) 14 Ultra Librarian
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Beinhaltete Information:
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