The LMX2571 is a low-power, high-performance, wideband PLLatinum RF synthesizer that integrates a delta-sigma fractional N PLL, multiple core voltage-controlled oscillator (VCO), programmable output dividers and two output buffers. The VCO cores work up to 5.376 GHz resulting in continuous output frequency range of 10 MHz to 1344 MHz.
This synthesizer can also be used with an external VCO. To that end, a dedicated 5-V charge pump and an output divider are available for this configuration.
A unique programmable multiplier is also incorporated to help improve spurs, allowing the system to use every channel even if it falls on an integer boundary.
The output has an integrated SPDT switch that can be used as a transmit/receive switch in FDD radio application. Both outputs can also be turned on to provide 2 outputs at the same time.
The LMX2571 supports direct digital FSK modulation through programming or pins. Discrete level FSK, pulse shaping FSK, and analog FM modulation are supported.
A new FastLock technique can be used allowing the user to step from one frequency to the next in less than 1.5 ms even when an external VCO is used with a narrow band loop filter.
| Documentación principal | Tipo | Título | Opciones de formato | Descargar la versión más reciente en inglés | Fecha |
|---|---|---|---|---|---|
| * | Hoja de datos | LMX2571 Low-Power, High-Performance PLLatinum RF Synthesizer with FSK Modulation datasheet (Rev. A) | PDF | HTML | 1/06/2016 | |
| Nota sobre la aplicación | Practical Clocking Considerations That Give Your Next High-Speed Converter Design an Edge (Rev. A) | PDF | HTML | 11/04/2025 | ||
| Application brief | Compilation of RF Synthesizer Resources | PDF | HTML | 22/10/2024 | ||
| Artículo técnico | How to implement FM modulation | PDF | HTML | 3/08/2017 | ||
| Nota sobre la aplicación | Frequency Shift Keying with LMX2571 | 30/05/2017 | |||
| Nota sobre la aplicación | LMX2571 Using a Programmable Input Multiplier to Minimize Integer Boundary Spurs | PDF | HTML | 12/01/2016 | ||
| Artículo técnico | Timing is Everything: Improving integer boundary spurs in fractional PLL synthesiz | PDF | HTML | 5/08/2015 |
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