ADC14X250

アクティブ

14 ビット、250MSPS AD コンバータ(ADC)

製品詳細

Sample rate (max) (Msps) 250 Resolution (Bits) 14 Number of input channels 1 Interface type JESD204B Analog input BW (MHz) 800 Features High Performance Rating Catalog Peak-to-peak input voltage range (V) 1.7 Power consumption (typ) (mW) 584 Architecture Pipeline SNR (dB) 71.1 ENOB (Bits) 11.5 SFDR (dB) 93 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 250 Resolution (Bits) 14 Number of input channels 1 Interface type JESD204B Analog input BW (MHz) 800 Features High Performance Rating Catalog Peak-to-peak input voltage range (V) 1.7 Power consumption (typ) (mW) 584 Architecture Pipeline SNR (dB) 71.1 ENOB (Bits) 11.5 SFDR (dB) 93 Operating temperature range (°C) -40 to 85 Input buffer Yes
VQFN (RHB) 32 25 mm² (5 mm × 5 mm)
  • Resolution: 14-Bit
  • Conversion Rate: 250 MSPS
  • Performance:
    • Input: 240 MHz, –3 dBFS
      • SNR: 70.1 dBFS
      • Noise Spectral Density: –151.1 dBFS/Hz
      • SFDR: 87 dBFS
      • Non-HD2 and Non-HD3 SPUR: –92 dBFS
    • No Input SNR: 71.1 dBFS
  • Power Dissipation: 584 mW
  • Performance Rated up to 105°C (at thermal pad)
  • JESD204B Subclass 1 Single Lane Serial Data Interface With Lane Rate Up To 5 Gb/s
  • Buffered Analog Inputs
  • Differential Input Phase and Amplitude Correction
  • Input Sampling Clock Divider (Divide-by-1,2,4,8)
  • 4-Wire Serial Peripheral Interface (SPI)
  • 32-Pin WQFN Package (5×5 mm, 0.5-mm Pitch)
  • Resolution: 14-Bit
  • Conversion Rate: 250 MSPS
  • Performance:
    • Input: 240 MHz, –3 dBFS
      • SNR: 70.1 dBFS
      • Noise Spectral Density: –151.1 dBFS/Hz
      • SFDR: 87 dBFS
      • Non-HD2 and Non-HD3 SPUR: –92 dBFS
    • No Input SNR: 71.1 dBFS
  • Power Dissipation: 584 mW
  • Performance Rated up to 105°C (at thermal pad)
  • JESD204B Subclass 1 Single Lane Serial Data Interface With Lane Rate Up To 5 Gb/s
  • Buffered Analog Inputs
  • Differential Input Phase and Amplitude Correction
  • Input Sampling Clock Divider (Divide-by-1,2,4,8)
  • 4-Wire Serial Peripheral Interface (SPI)
  • 32-Pin WQFN Package (5×5 mm, 0.5-mm Pitch)

The ADC14X250 device is a monolithic single-channel high performance analog-to-digital converter capable of converting analog input signals into 14-bit digital words with a sampling rate of 250 MSPS. This converter uses a differential pipelined architecture with integrated input buffer to provide excellent dynamic performance and low power consumption across an extended temperature range from –40°C to 105°C as measured at the device’s PCB footprint thermal pad.

The integrated input buffer eliminates charge kickback noise coming from the internal switched capacitor sampling circuits and eases the system-level design of the driving amplifier, anti-aliasing filter, and impedance matching. The buffer can be also be adjusted to correct for phase and amplitude imbalance of the differential input signal path to improve even order harmonic distortion. An input sampling clock divider provides integer divide ratios to simplify system clocking. An integrated low-noise voltage reference eases board level design without requiring external decoupling capacitors. The output digital data is provided through a JESD204B subclass 1 single lane interface from a 32-pin, 5-mm × 5-mm WQFN package. The ADC14X250 operates on 1.2 V, 1.8 V and 3.0 V power supplies. A SPI is available to configure the device that is compatible with 1.2-V to 3-V logic.

The ADC14X250 device is a monolithic single-channel high performance analog-to-digital converter capable of converting analog input signals into 14-bit digital words with a sampling rate of 250 MSPS. This converter uses a differential pipelined architecture with integrated input buffer to provide excellent dynamic performance and low power consumption across an extended temperature range from –40°C to 105°C as measured at the device’s PCB footprint thermal pad.

The integrated input buffer eliminates charge kickback noise coming from the internal switched capacitor sampling circuits and eases the system-level design of the driving amplifier, anti-aliasing filter, and impedance matching. The buffer can be also be adjusted to correct for phase and amplitude imbalance of the differential input signal path to improve even order harmonic distortion. An input sampling clock divider provides integer divide ratios to simplify system clocking. An integrated low-noise voltage reference eases board level design without requiring external decoupling capacitors. The output digital data is provided through a JESD204B subclass 1 single lane interface from a 32-pin, 5-mm × 5-mm WQFN package. The ADC14X250 operates on 1.2 V, 1.8 V and 3.0 V power supplies. A SPI is available to configure the device that is compatible with 1.2-V to 3-V logic.

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技術資料

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* データシート ADC14X250 14-Bit 250 MSPS Single Channel ADC With 5 Gb/s JESD204B Output データシート (Rev. B) PDF | HTML 2017/04/19

設計と開発

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評価ボード

ADC14X250EVM — ADC14X250 評価基板

ADC14X250EVM は、TI の ADC14X250 A/D コンバータ (ADC) の評価に使用できる評価ボードです。ADC14X250 は、最大 250MSPS (毎秒メガ サンプル) のサンプリング レート動作に対応したシングル チャネルの 14 ビット ADC で、標準的な JESD204B 高速シリアル インターフェイス出力を採用しています。ADC14X250EVM は、TI の JESD204B データ キャプチャ カードである TSW14J56EVM、および高速データ コンバータ評価用の High Speed Data Converter (...)

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在庫あり
制限:
??asset.out-of-stock-ti_ja_JP??
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TI204C-IP — Request for JESD204 rapid design IP

JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように、設計者の皆様を支援します。

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評価基板 (EVM) 向けの GUI

DATACONVERTERPRO-SW — 高速データ コンバータ向け Pro GUI インストーラー、v5.31

この高速データ コンバータ Pro GUIは、PC (Windows® XP/7/10 対応) 向けプログラムであり、TI の大半の高速データ コンバータである A/D コンバータ (ADC) や D/A コンバータ (DAC) と、アナログ フロント エンド (AFE) の各プラットフォームの評価を支援するために設計されました。DATACONVERTERPRO-SW は、データ キャプチャとパターン ジェネレータのカードである TSW14xxx シリーズ全体をサポートする設計を採用しており、時間ドメインと周波数ドメインの両方でデータ (...)

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シミュレーション・モデル

ADC14X250 IBIS Model

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リファレンス・デザイン

TIDEP0060 — DSP+ARM SoC を使用した最適化されたレーダー システムのリファレンス デザイン

このリファレンス デザインは、高速データコンバータへの接続に FPGA や ASIC を使用している最新のレーダー システム デベロッパーを対象にしており、性能の向上、コスト、消費電力、サイズの大幅低減により、開発期間の短縮が可能になり、JESD204B インターフェイスとデジタル フロント エンド (DFE) 処理機能を統合した広範囲で利用できる初のプロセッサを搭載しています。ADC14X250 と DAC38J84 を接続すると、レーダー、電子戦、コンピューティング プラットフォーム、トランスポンダなど、航空と防衛の各アプリケーションに適した効率的なソリューションを実現できます。
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
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サポートとトレーニング

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