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ADC3669

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LVDS インターフェイスと最大 32,768 倍のデシメーション機能搭載、16 ビット、2 チャネル、500MSPS ADC

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製品詳細

Sample rate (max) (Msps) 500 Resolution (Bits) 16 Number of input channels 2 Interface type DDR LVDS Analog input BW (MHz) 1400 Features Decimating Filter, Differential Inputs, High Dynamic Range, High Performance, Input buffer, Low latency, Low power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 640 Architecture Pipeline SNR (dB) 75.2 ENOB (Bits) 12.3 SFDR (dB) 80 Operating temperature range (°C) -40 to 85 Input buffer Yes
Sample rate (max) (Msps) 500 Resolution (Bits) 16 Number of input channels 2 Interface type DDR LVDS Analog input BW (MHz) 1400 Features Decimating Filter, Differential Inputs, High Dynamic Range, High Performance, Input buffer, Low latency, Low power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 640 Architecture Pipeline SNR (dB) 75.2 ENOB (Bits) 12.3 SFDR (dB) 80 Operating temperature range (°C) -40 to 85 Input buffer Yes
VQFNP (RTD) 64 81 mm² (9 mm × 9 mm)
  • 16 ビット、デュアル チャネル 250/500MSPS ADC
  • ノイズ スペクトル密度： -160.4dBFS/Hz
  • 熱ノイズ：76.4dBFS
  • シングル コア (非インターリーブ) ADC アーキテクチャ
  • アパーチャ ジッタ：75fs
  • バッファ付きアナログ入力
    • プログラム可能な 100Ω および 200Ω 終端
  • 入力フルスケール：2Vpp
  • フルパワー入力帯域幅 (-3dB)：1.4GHz
  • スペクトル性能 (fIN = 70MHz、-1dBFS 時)：
    • 信号対雑音比：75.6dBFS
    • SFDR HD2、3：80dBc
    • SFDR の最大スプリアス：94dBFS
  • INL：±2LSB (標準値)
  • DNL：±0.5LSB (標準値)
  • デジタル ダウンコンバータ (DDC)
    • 最大 4 つの独立した DDC
    • 複素数と実数のデシメーション
    • デシメーション：/2、/4～/32768 のデシメーション
    • 48 ビット NCO による位相コヒーレント周波数ホッピング
  • DDR / シリアル LVDS インターフェイス
    • DDC バイパス用の 16 ビット パラレル DDR LVDS
    • デシメーション用のシリアル LVDS
    • 高比率デシメーション用の 32 ビット出力オプション
  • 消費電力：300mW / チャネル (500MSPS)
  • 16 ビット、デュアル チャネル 250/500MSPS ADC
  • ノイズ スペクトル密度： -160.4dBFS/Hz
  • 熱ノイズ：76.4dBFS
  • シングル コア (非インターリーブ) ADC アーキテクチャ
  • アパーチャ ジッタ：75fs
  • バッファ付きアナログ入力
    • プログラム可能な 100Ω および 200Ω 終端
  • 入力フルスケール：2Vpp
  • フルパワー入力帯域幅 (-3dB)：1.4GHz
  • スペクトル性能 (fIN = 70MHz、-1dBFS 時)：
    • 信号対雑音比：75.6dBFS
    • SFDR HD2、3：80dBc
    • SFDR の最大スプリアス：94dBFS
  • INL：±2LSB (標準値)
  • DNL：±0.5LSB (標準値)
  • デジタル ダウンコンバータ (DDC)
    • 最大 4 つの独立した DDC
    • 複素数と実数のデシメーション
    • デシメーション：/2、/4～/32768 のデシメーション
    • 48 ビット NCO による位相コヒーレント周波数ホッピング
  • DDR / シリアル LVDS インターフェイス
    • DDC バイパス用の 16 ビット パラレル DDR LVDS
    • デシメーション用のシリアル LVDS
    • 高比率デシメーション用の 32 ビット出力オプション
  • 消費電力：300mW / チャネル (500MSPS)

ADC3668 と ADC3669 (ADC366x) は、16 ビット、250MSPS および 500MSPS、デュアル チャネル A/D コンバータ (ADC) です。これらのデバイスは高い信号対雑音比 (SNR) を実現するよう設計されており、-160dBFS/Hz (500MSPS) のノイズ スペクトル密度を実現します。

ADC366x は、オプションのクワッド バンド デジタル ダウンコンバータ (DDC) を搭載しており、比率 2 の広帯域デシメーションから、比率 32768 の狭帯域デシメーションまでサポートしています。DDC では、位相コヒーレントと位相連続の周波数ホッピングをサポートする 48 ビット NCO を使用しています。

ADC366x には、フレキシブルな LVDS インターフェイスが装備されています。デシメーション バイパス モードでは、16 ビット幅のパラレル DDR LVDS インターフェイスを使用します。デシメーションを使用するときは、シリアル LVDS インターフェイスを使用して出力データが送信され、デシメーションの増加に応じて必要なレーン数が少なくなります。デシメーション比が高い場合、出力分解能を 32 ビットに増やすことができます。

電力効率の優れた ADC アーキテクチャは、500MSPS で 300mW/ch の消費電力を実現し、低サンプリング レートで電力スケーリングを実現します (250MSPS で 250mW/ch)。

ADC3668 と ADC3669 (ADC366x) は、16 ビット、250MSPS および 500MSPS、デュアル チャネル A/D コンバータ (ADC) です。これらのデバイスは高い信号対雑音比 (SNR) を実現するよう設計されており、-160dBFS/Hz (500MSPS) のノイズ スペクトル密度を実現します。

ADC366x は、オプションのクワッド バンド デジタル ダウンコンバータ (DDC) を搭載しており、比率 2 の広帯域デシメーションから、比率 32768 の狭帯域デシメーションまでサポートしています。DDC では、位相コヒーレントと位相連続の周波数ホッピングをサポートする 48 ビット NCO を使用しています。

ADC366x には、フレキシブルな LVDS インターフェイスが装備されています。デシメーション バイパス モードでは、16 ビット幅のパラレル DDR LVDS インターフェイスを使用します。デシメーションを使用するときは、シリアル LVDS インターフェイスを使用して出力データが送信され、デシメーションの増加に応じて必要なレーン数が少なくなります。デシメーション比が高い場合、出力分解能を 32 ビットに増やすことができます。

電力効率の優れた ADC アーキテクチャは、500MSPS で 300mW/ch の消費電力を実現し、低サンプリング レートで電力スケーリングを実現します (250MSPS で 250mW/ch)。
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設計と開発

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評価ボード

ADC3669EVM — ADC3669 評価基板

ADC3669EVM は、高速 ADC の ADC3669 ファミリを評価できるように設計された評価基板 (EVM) です。ADC3669EVM には、ADC3669 が搭載されています。ADC3669 は、LVDS インターフェイスを備えた 16 ビット デュアル チャネル ADC で、最大 500MSPS のサンプル レートで動作できます。ADC3669EVM を使用すると、デバイスのすべての速度グレードとチャネル数を評価できます。
ユーザー ガイド: PDF | HTML
サポート対象の製品とハードウェア
シミュレーション・モデル

ADC3669 IBIS Model

SBAM516.ZIP (39 KB) - IBIS モデル
サポート対象の製品とハードウェア
計算ツール

ADC3669-NOISE-ANALYSIS-CALC — Noise analysis calculation tool (SNR/SFDR) for ADC3669 with amplifier input.

Calculation tool for analyzing noise of ADC3669 with an amplifier as the input network.
サポート対象の製品とハードウェア
設計ツール

ADC-DAC-TO-VREF-SELECT-DESIGN-TOOL — The ADC-TO-VREF-SELECT tool enables the pairing of TI ADCs, DACs, and series voltage references.

The ADC-TO-VREF-SELECT tool enables the pairing of TI analog-to-digital converters (ADCs) and series voltage references. Users can select an ADC device and the desired reference voltage, and the tool will list up to two voltage reference recommendations.
サポート対象の製品とハードウェア
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFNP (RTD) 64 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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